专利汇可以提供一种用于全数字锁相环的低功耗鉴相器专利检索,专利查询,专利分析的服务。并且本 发明 属微 电子 领域,涉及一种用于全数字 锁 相环的鉴相器;该鉴相器在保证鉴相器功能正确的前提下,能降低鉴相器的功耗。本发明对传统鉴相器进行了改进,其中累加型计数器的输出为各个参考时钟周期内原传统的计数器输出码值累加的结果,而不是单一的一个时钟周期之内的输出码值,因此累加型计数器可直接由DCO的输出 信号 驱动;交换了时间-数码转换器的输出在数字鉴相器中的运算顺序,使整个鉴相器的运算步骤减少,从而降低了鉴相器结构的功耗,并使 电路 结构更加简单,易于实现。本发明所述鉴相器适用于全数字 锁相环 的电路设计,具有重要的实用价值。,下面是一种用于全数字锁相环的低功耗鉴相器专利的具体信息内容。
1.一种用于全数字锁相环的低功耗鉴相器,其特征在于,包括:累加型计数器和时间-数码转换器,其中的累加型的计数器,直接得到 同时,在电路实现时将运算改变顺序,将先做差后累加改变为先累加后做差,其运算公式为:
其中,FCW为频率控制字, 为累加的第K个时钟周期计数器的输出,σK+1为时间-数码转换器在第K+1个时钟周期的输出。
2.按权利要求1所述的用于全数字锁相环的低功耗鉴相器,其特征在于,其中的累加型计数器的输出为各个参考时钟周期内的计数器输出码值累加的结果,累加型计数器直接由数字控制振荡器的输出信号驱动。
3.按权利要求1所述的用于全数字锁相环的低功耗鉴相器,其特征在于,其中的时间-数码转换器的输出在鉴相器中直接与鉴相器的其他输入信号相加。
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