专利汇可以提供三分正交分频器专利检索,专利查询,专利分析的服务。并且一种本机 振荡器 包括耦合到VCO的输出的可编程 分频器 。可将所述分频器设定为三分频。不管除数如何,所述分频器输出 相位 彼此相差九十度的 正交 信号 (I,Q)。为进行三分,所述分频器包括三分频器。所述三分频器包括三分 电路 、延迟电路和反馈电路。所述三分电路对来自所述VCO的信号进行分频,并从其产生相位彼此相差一百二十度的三个信号C、A′和B。所述延迟电路将信号A′延迟以产生所述信号A′的延迟版本A。所述反馈电路控制所述延迟电路,使得所述延迟版本A(I)相对于所述信号C(Q)为九十度异相。,下面是三分正交分频器专利的具体信息内容。
1.一种用于将信号分频的方法,其包含:
对输入信号进行三分频以产生第一信号C和相对于所述第一信号C为约一百二十度异相的第二信号A′,所述第一信号C具有约百分之五十的工作循环,且所述第二信号A′具有约百分之五十的工作循环;以及
控制所述第二信号A′的延迟版本A相对于所述第二信号A′被延迟的延迟量,由控制环路控制所述第二信号A′的所述延迟版本A以相对于所述第一信号C为九十度异相。
2.根据权利要求1所述的方法,其中控制A的延迟量包括:
对所述第一信号C与所述第二信号的所述延迟版本A执行逻辑“与”运算,且借此产生第三信号;
将所述第一信号C反相,且借此产生所述第一信号的反相版本Cb;
对所述第一信号的所述反相版本Cb与所述第二信号的所述延迟版本A执行逻辑“与”运算,且借此产生第四信号;以及
在所述控制环路中,基于第三信号和第四信号来控制所述延迟版本A相对于所述第二信号A′的延迟量。
3.根据权利要求1所述的方法,其中控制A的延迟量包括:
产生第三信号,所述第三信号指示所述第二信号的所述延迟版本A的第一沿与所述第一信号C的一沿之间的时间量T1;以及
产生第四信号,所述第四信号指示所述第一信号C的所述沿与所述第二信号的所述延迟版本A的第二沿之间的时间量T2。
4.根据权利要求3所述的方法,其中控制A的延迟量进一步包括:
将所述第三信号转换为第一电压电平,其中所述第一电压电平指示所述时间量T1;
将所述第四信号转换为第二电压电平,其中所述第二电压电平指示所述时间量T2;以及
将所述第一和第二电压电平供应到运算放大器,其中由所述运算放大器输出的信号确定所述第二信号的所述延迟版本A相对于所述第二信号的未延迟版本A′延迟了多少。
5.根据权利要求1所述的方法,其中控制A的延迟量包括:
第一逻辑门产生第三信号,所述第三信号指示所述第二信号的所述延迟版本A的第一沿与所述第一信号C的一沿之间的时间量T1;以及
第二逻辑门产生第四信号,所述第四信号指示所述第一信号C的所述沿与所述第二信号的所述延迟版本A的第二沿之间的时间量T2。
6.根据权利要求1所述的方法,其中对所述输入信号进行分频进一步包括产生第三信号B,且其中控制A的延迟量包括:
对所述第一信号、所述第二信号和所述第三信号中的一者与所述第一信号、所述第二信号和所述第三信号中的另一者执行逻辑“与”运算;以及
对所述第一信号、所述第二信号和所述第三信号中的一者与所述第一信号、所述第二信号和所述第三信号中的另一者的反相者执行逻辑“与”运算。
7.一种电路,其包含:
分频器,其接收频率为3F的输入信号且输出频率为F的第一信号C并输出频率为F的第二信号A′,其中所述第一信号C具有约百分之五十的工作循环,且其中所述第二信号A′具有约百分之五十的工作循环,其中所述第二信号A′相对于所述第一信号C为约一百二十度异相;
延迟电路,其接收所述第二信号A′并输出所述第二信号的延迟版本A;以及反馈电路,其控制所述延迟电路,使得所述第二信号的所述延迟版本A相对于所述第一信号C为九十度异相。
8.根据权利要求7所述的电路,其中所述反馈电路包含:
产生第三信号的电路,所述第三信号指示所述第二信号的所述延迟版本A的第一沿与所述第一信号C的一沿之间的时间量T1;
产生第四信号的电路,所述第四信号指示所述第一信号C的所述沿与所述第二信号的所述延迟版本A的第二沿之间的时间量T2;以及
差动放大器电路,其接收所述第三信号和所述第四信号并从其产生控制信号,所述控制信号被供应到所述延迟电路。
9.根据权利要求8所述的电路,其中所述第三和第四信号是数字逻辑信号。
10.根据权利要求8所述的电路,其中所述第三和第四信号是电压电平信号。
11.根据权利要求8所述的电路,其中所述产生所述第三信号的电路包括第一数字逻辑门,且其中所述产生所述第四信号的电路包括第二数字逻辑门。
12.根据权利要求7所述的电路,其中所述反馈电路包括:
第一数字逻辑门,其具有耦合到第一低通滤波器的输入引线的输出引线;
第二数字逻辑门,其具有耦合到第二低通滤波器的输入引线的输出引线;以及差动放大器电路,其从所述第一低通滤波器接收信号并从所述第二低通滤波器接收信号,其中所述差动放大器电路将控制信号供应到所述延迟电路。
13.根据权利要求7所述的电路,其中所述分频器包含:
第一级,其包含第一P沟道场效应晶体管(PFET)、第二PFET、第一N沟道场效应晶体管NFET和第二NFET,其中所述第一PFET的栅极与所述第一NFET的栅极耦合在一起,其中所述第一PFET的漏极与所述第一NFET的漏极耦合在一起,其中所述第二PFET的漏极耦合到所述第一PFET的源极,其中所述第二NFET的漏极耦合到所述第一NFET的源极;
第二级,其包含第一PFET、第二PFET、第一NFET和第二NFET,其中所述第一PFET的栅极与所述第一NFET的栅极耦合在一起并耦合到所述第一级的所述第一PFET和所述第一NFET的所述漏极,其中所述第一PFET的漏极与所述第一NFET的漏极耦合在一起,其中所述第二PFET的漏极耦合到所述第一PFET的源极,其中所述第二NFET的漏极耦合到所述第一NFET的源极;以及
第三级,其包含第一PFET、第二PFET、第一NFET和第二NFET,其中所述第一PFET的栅极与所述第一NFET的栅极耦合在一起并耦合到所述第二级的所述第一PFET和所述第一NFET的所述漏极,其中所述第一PFET的漏极与所述第一NFET的漏极耦合在一起,其中所述第二PFET的漏极耦合到所述第一PFET的源极,其中所述第二NFET的漏极耦合到所述第一NFET的源极,其中所述第一PFET和第一NFET的所述漏极耦合到所述第一级的所述第一PFET和所述第一NFET的所述栅极,其中所述第一、第二和第三级的所述第二PFET的所述栅极与所述第一、第二和第三级的所述第二NFET的所述栅极耦合以接收所述输入信号。
14.根据权利要求7所述的电路,其中所述电路是无线电接收器中的本机振荡器,且其中所述输入信号具有为至少100兆赫的频率。
15.根据权利要求7所述的电路,其中所述反馈电路包括:
第一数字逻辑门,其输出所述第二信号与所述第一信号的反相者的逻辑“与”;
第二数字逻辑门,其输出所述第一信号与所述第二信号的逻辑“与”;
第三数字逻辑门,其输出所述第一信号与所述第二信号的反相者的逻辑“与”;
第四数字逻辑门,其输出所述第一信号的所述反相者与所述第二信号的所述反相者的逻辑“与”;以及
电路,其接收从所述第一、第二、第三和第四数字逻辑门输出的信号,并将控制信号供应到所述延迟电路。
16.根据权利要求7所述的电路,其中所述延迟电路包括数字逻辑反相器和N沟道场效应晶体管(NFET),其中所述数字逻辑反相器具有信号输入引线、信号输出引线、电源引线和接地引线,其中所述接地引线可经由所述NFET而电阻性地耦合到接地电位。
17.根据权利要求16所述的电路,其中所述延迟电路进一步包括P沟道场效应晶体管(PFET),其中所述数字逻辑反相器的所述电源引线可经由所述PFET而电阻性地耦合到供应电压。
18.一种电路,其包含:
三分电路,其接收频率为3F的输入信号并输出第一信号C和第二信号A′,其中所述第一信号C与所述第二信号A′具有相同频率F,其中所述第一信号C与所述第二信号A′相对于彼此为约一百二十度异相;
延迟电路,其从所述三分电路接收所述第二信号A′并输出所述第二信号的延迟版本A;以及
用于在反馈控制环路中控制所述延迟电路以使得所述第二信号的所述延迟版本A相对于所述第一信号C为九十度异相的装置。
19.根据权利要求18所述的电路,其中所述电路是无线电接收器中的本机振荡器,且其中所述输入信号具有为至少100兆赫的频率。
20.一种用于将信号分频的设备,其包含:
用于对输入信号进行三分频以产生第一信号C和相对于所述第一信号C为约一百二十度异相的第二信号A′的装置,所述第一信号C具有约百分之五十的工作循环,且所述第二信号A′具有约百分之五十的工作循环;以及
用于控制所述第二信号A′的延迟版本A相对于所述第二信号A′被延迟的延迟量的装置,由控制环路控制所述第二信号A′的所述延迟版本A以相对于所述第一信号C为九十度异相。
21.根据权利要求20所述的设备,其中用于控制A的延迟量的装置包括:
用于对所述第一信号C与所述第二信号的所述延迟版本A执行逻辑“与”运算,且借此产生第三信号的装置;
用于将所述第一信号C反相,且借此产生所述第一信号的反相版本Cb的装置:
用于对所述第一信号的所述反相版本Cb与所述第二信号的所述延迟版本A执行逻辑“与”运算,且借此产生第四信号的装置;以及
用于在所述控制环路中,基于第三信号和第四信号来控制所述延迟版本A相对于所述第二信号A′的延迟量的装置。
22.根据权利要求20所述的设备,其中用于控制A的延迟量的装置包括:
用于产生第三信号的装置,所述第三信号指示所述第二信号的所述延迟版本A的第一沿与所述第一信号C的一沿之间的时间量T1;以及
用于产生第四信号的装置,所述第四信号指示所述第一信号C的所述沿与所述第二信号的所述延迟版本A的第二沿之间的时间量T2。
23.根据权利要求22所述的设备,其中用于控制A的延迟量的装置进一步包括:
用于将所述第三信号转换为第一电压电平的设备,其中所述第一电压电平指示所述时间量T1;
用于将所述第四信号转换为第二电压电平的设备,其中所述第二电压电平指示所述时间量T2;以及
用于将所述第一电压电平和第二电压电平供应到运算放大器的装置,其中由所述运算放大器输出的信号确定所述第二信号的所述延迟版本A相对于所述第二信号的未延迟版本A′延迟了多少。
24.根据权利要求20所述的设备,其中用于对所述输入信号进行分频的装置进一步包括用于产生第三信号B的装置,且其中用于控制A的延迟量的装置包括:
用于对所述第一信号、所述第二信号和所述第三信号中的一者与所述第一信号、所述第二信号和所述第三信号中的另一者执行逻辑“与”运算的装置;以及
对所述第一信号、所述第二信号和所述第三信号中的一者与所述第一信号、所述第二信号和所述第三信号中的另一者的反相者执行逻辑“与”运算的装置。
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