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用于形成取代金属栅极的方法及相关装置

阅读:1发布:2020-06-08

专利汇可以提供用于形成取代金属栅极的方法及相关装置专利检索,专利查询,专利分析的服务。并且本 发明 涉及用于形成取代金属栅极的方法及相关装置,其提供一种方法用以在RMG加工期间排除线空穴及所得装置。数个具体 实施例 包括形成虚拟栅极于一衬底的PFET区及NFET区上面,各个虚拟栅极有在相对两侧的间隔体,以及填充在间隔体之间的空间的一ILD;移除所述栅极的虚拟栅极材料,形成一空腔于每一对间隔体之间;形成一高k介电层于该ILD及所述间隔体上面且于所述空腔中;形成一金属 覆盖 层 于该高k介电层上面;形成一第一 功函数 金属层于该金属覆盖层上面;移除该PFET区的该第一功函数金属层;形成一第二功函数金属层于在该PFET区中的该金属覆盖层上面及于在该NFET区中的该第一功函数金属层上面;以及形成一金属层于该第二功函数金属层上面,填充所述空腔。,下面是用于形成取代金属栅极的方法及相关装置专利的具体信息内容。

1.一种方法,其包含:
形成虚拟栅极于一衬底的p型通道场效应晶体管(PFET)区及n型通道场效应晶体管(NFET)区上面,各个虚拟栅极具有形成于该虚拟栅极的相对两侧上的间隔体,以及在形成于该衬底中的源极/漏极(S/D)区上面的一层间电介质(ILD),填充在所述间隔体之间的空间;
移除所述栅极的虚拟栅极材料,形成一空腔于每一对间隔体之间;
形成一高k介电层于该ILD及所述间隔体上面且于所述空腔中;
形成一金属覆盖层于该高k介电层上面;
形成一第一功函数金属层于该金属覆盖层上面;
移除该PFET区的该第一功函数金属层;
形成一第二功函数金属层于在该PFET区中的该金属覆盖层上面及于在该NFET区中的该第一功函数金属层上面;以及
形成一金属层于该第二功函数金属层上面,填充所述空腔,以及形成数个取代金属栅极(RMG)。
2.如权利要求1所述的方法,更包含:
向下平坦化该ILD的一上表面,移除多余的金属层、第一功函数金属层及第二功函数金属层和高k介电层,以及暴露所述侧面间隔体及ILD的上表面。
3.如权利要求2所述的方法,其包含:
用化学机械抛光(CMP)进行平坦化。
4.如权利要求1所述的方法,其包含:形成氮化(TiN)的该金属覆盖层。
5.如权利要求1所述的方法,其包含:
形成掺化钛(TiAlC)的该第一功函数金属层。
6.如权利要求5所述的方法,其中,该TiAlC是用于一n型装置。
7.如权利要求1所述的方法,其包含:
形成TiN的该第二功函数金属层用于一p型装置。
8.如权利要求1所述的方法,其包含:
形成钨(W)、铝(Al)或彼等的合金的该金属层。
9.如权利要求8所述的方法,其包含:
形成该金属层于在该PFET区上面的一空腔中,其中,在该PFET区中的该空腔比在该NFET区中的宽。
10.如权利要求1所述的方法,其包含:
形成多晶的所述虚拟栅极;以及
移除该多晶硅以形成所述空腔于所述间隔体之间。
11.一种装置,其包含:
形成于一衬底上面的一层间电介质(ILD),该衬底具有形成于该衬底的p型通道场效应晶体管(PFET)区及n型通道场效应晶体管(NFET)区上面的空腔,以及在各空腔的相对两侧形成于该衬底中的源极/漏极(S/D)区;
在各空腔的侧壁上的间隔体;
在各空腔中的所述间隔体之间的取代金属栅极(RMG),
其中,各RMG包含:
在该空腔的侧面及底面上的一高k介电层;
在该高k介电层上面的一金属覆盖层;
在该NFET区中的该金属覆盖层上面的一第一功函数金属层;
在该PFET区中的该金属覆盖层上面且在该NFET区中的该第一功函数金属层上面的一第二功函数金属层;以及
在该第二功函数金属层上面的一金属层。
12.如权利要求11所述的装置,其中,该金属覆盖层包含氮化钛(TiN)。
13.如权利要求11所述的装置,其中,该第一功函数金属层包含掺铝碳化钛(TiAlC)。
14.如权利要求13所述的装置,其中,该TiAlC是用于一n型装置。
15.如权利要求11所述的装置,其中,该第二功函数金属层包含用于一p型装置的TiN。
16.如权利要求11所述的装置,其中,该金属层包含钨(W)、铝(Al)或彼等的合金。
17.如权利要求16所述的装置,其中,在该PFET区中的该金属层比在该NFET区中的宽。
18.一种方法,其包含:
形成多晶硅的虚拟栅极于一衬底的p型通道场效应晶体管(PFET)区及n型通道场效应晶体管(NFET)区上面,各个多晶硅的虚拟栅极具有形成于该多晶硅的虚拟栅极的相对两侧上的间隔体,以及在形成于该衬底中的源极/漏极(S/D)区上面的一层间电介质(ILD),填充在所述间隔体之间的空间;
移除所述虚拟栅极,形成空腔于所述间隔体之间;
形成一高k介电层于该ILD及所述间隔体上面且于所述空腔中;
形成一氮化钛(TiN)覆盖层于该高k介电层上面;
形成一掺铝碳化钛(TiAlC)的n型功函数层于该TiN覆盖层上面;
移除该PFET区的该TiAlC的n型功函数层;
形成一TiN的p型功函数层于在该PFET区中的该TiN覆盖层上面且于在该NFET区中的该TiAlC的n型功函数层上面;以及
形成填充所述空腔的金属层,形成数个取代金属栅极(RMG)。
19.如权利要求18所述的方法,其包含:
形成该金属层于在该PFET区上面的一开口中,其中,在该PFET区上面的该金属层的宽度大于在该NFET区上面的该金属层的宽度。
20.如权利要求19所述的方法,其包含:
形成钨(W)、铝(Al)或彼等的合金的该金属层。

说明书全文

用于形成取代金属栅极的方法及相关装置

技术领域

[0001] 本揭示内容是有关于半导体制造。特别是,本揭示内容有关于在14纳米(nm)技术节点及以下的半导体装置制造的取代金属栅极(replacement metal gates;RMGs)。

背景技术

[0002] 在当前半导体加工中,随着栅极尺寸持续变小,在金属栅极填充期间可能形成导致不合意装置效能或失效的线空穴(line void)。就14纳米技术节点的当前RMG加工而言,在衬底(substrate)的p型通道场效应晶体管(PFET)区中可能由于填隙边限(gap fill margin)不足而出现线空穴。特别是,就当前RMG加工而言,n型通道场效应晶体管(NFET)功函数金属,例如(TiAlC),无法被PFET金属栅极中的后续阻障金属及栅极填充金属完全覆盖,而留下线空穴。此外,在线空穴中没有阻障金属及栅极填充金属的保护下,TiAlC在化学机械抛光(chemical mechanical polishing;CMP)及原位稀释氢氟酸(dilute hydrofluoric;DHF)/氢化铵(NH4OH)清洗期间会被暴露且被蚀刻去掉,这导致缺陷。此外,就习知RMG加工而言,在退火图案化步骤期间不合意地暴露及损害高电介质常数(高k)介电层,这降低装置的可靠性。
[0003] 亟须一种方法及所得装置致能栅极线空穴的减轻及栅极填充要求的有效改善,最小化高k介电层的暴露与装置可靠性的有效改善。发明内容
[0004] 本揭示内容的一方面为一种方法,其实质排除在RMG加工期间的线空穴缺陷且改善装置效能。另一方面包括在PFET图案化期间保护高k介电材料以防高k介电质损害。
[0005] 本揭示内容的其他方面及特征会在以下说明中提出以及部分在本领域一般技术人员审查以下内容或学习本揭示内容的实施后会明白。按照随附权利要求所特别提示,可实现及得到本揭示内容的优点。
[0006] 根据本揭示内容,有些技术效果部分可用一种方法达成,其包括形成虚拟栅极于一衬底的PFET区及n型通道场效应晶体管(NFET)上面,各个虚拟栅极具有形成于该虚拟栅极的相对两侧上的间隔体,以及在形成于该衬底中的源极/漏极(S/D)区上面的一层间电介质(ILD),填充在所述间隔体之间的空间;移除所述栅极的虚拟栅极材料,形成一空腔于每一对间隔体之间;形成一高k介电层于该ILD及所述间隔体上面且于所述空腔中;形成一金属覆盖层于该高k介电层上面;形成一第一功函数金属层于该金属覆盖层上面;移除该PFET区的该第一功函数金属层;形成一第二功函数金属层于在该PFET区中的该金属覆盖层上面及于在该NFET区中的该第一功函数金属层上面;以及形成一金属层于该第二功函数金属层上面,填充所述空腔,以及形成数个RMG。
[0007] 本揭示内容的数个方面包括向下平坦化该ILD的一上表面,而移除多余的金属层、第一功函数金属层及第二功函数金属层和高k介电层且暴露所述侧面间隔体及ILD的上表面。其他方面包括用CMP进行平坦化。其他方面又包括形成氮化钛(titanium nitride;TiN)的该金属覆盖层。某些方面包括形成TiAlC的该第一功函数金属层。其他方面包括该TiAlC是用于一n型装置。某些方面包括形成TiN的该第二功函数金属层用于一p型装置。其他方面更包括形成钨(W)、铝(Al)、钨合金铝合金的该金属层。其他方面包括形成该金属层于在该PFET区上面的一空腔中,其中在该PFET区中的该空腔比在该NFET区中的宽。在某些方面中,所述虚拟栅极由多晶形成;以及移除该多晶硅以在所述间隔体之间形成所述空腔。
[0008] 本揭示内容的另一方面为一种装置,其包括形成于一衬底上面的一ILD,该衬底具有形成于该衬底的PFET区及NFET区上面的空腔,以及在该衬底中形成于各空腔的相对两侧的S/D区;在各空腔中的侧壁上的间隔体;在各空腔的所述间隔体之间的RMG,其中各RMG包括:在该空腔的侧面及底面上的一高k介电层;在该高k介电层上面的一金属覆盖层;在该NFET区中的该金属覆盖层上面的一第一功函数金属层;在该PFET区中的该金属覆盖层上面且在该NFET区中的该第一功函数金属层上面的一第二功函数金属层;以及在该第二功函数金属层上面的一金属层。
[0009] 本揭示内容的数个方面包括包括TiN的该金属覆盖层。其他方面包括包括TiAlC的该第一功函数金属层。其他方面又包括该TiAlC是用于一n型装置。有些方面包括包括TiN的该第二功函数金属层用于一p型装置。其他方面包括包括钨、铝、钨合金或铝合金的该金属层。有些方面包括在该PFET区中的该金属层比在该NFET区中的宽。
[0010] 本揭示内容的又一方面包括一种方法,其包括形成多晶硅的虚拟栅极于一衬底的PFET区及NFET区上面,各个多晶硅的虚拟栅极具有形成于该多晶硅的虚拟栅极的相对两侧上的间隔体,以及在形成于该衬底中的S/D区上面的一ILD,填充在所述间隔体之间的空间;移除所述虚拟栅极,而所述间隔体之间形成空腔;形成一高k介电层于该ILD及所述间隔体上面且于所述空腔中;在该高k介电层上面形成一TiN覆盖层;在该TiN覆盖层上面形成TiAlC的n型功函数层;移除该PFET区的该TiAlC的n型功函数层;在该PFET区中的该TiN覆盖层上面以及在该NFET区中的该TiAlC的n型功函数层上面形成一TiN的p型功函数层;以及形成填充所述空腔的一金属层,形成数个RMG。
[0011] 数个方面包括形成该金属层于在该PFET区上面的一开口中,其中在该PFET区上面的该金属层的宽度大于在该NFET区上面的该金属层的宽度。附加方面包括形成钨、铝、钨合金或铝合金的该金属层。
[0012] 本领域技术人员由以下详细说明可明白本揭示内容的其他方面及技术效果,其中仅以预期可实现本揭示内容的最佳模式举例描述本揭示内容的具体实施例。应了解,本揭示内容能够做出其他及不同的具体实施例,以及在各种明显的方面,能够修改数个细节而不脱离本揭示内容。因此,附图及说明内容本质上应被视为图解说明用而不是用来限定。

附图说明

[0013] 在此用附图举例说明而不是限定本揭示内容,图中类似的元件用相同的元件符号表示。
[0014] 图1至图9示意图示根据一示范具体实施例的半导体制程。
[0015] 符号说明:
[0016] 101    PFET(p型通道场效应晶体管)区
[0017] 103    NFET(n型通道场效应晶体管)区
[0018] 105    衬底
[0019] 107    多晶硅材料
[0020] 109    间隔体
[0021] 111    ILD(层间电介质)
[0022] 113    S/D(源极/漏极)区
[0023] 201    空腔
[0024] 301    高k介电层
[0025] 401    金属覆盖层
[0026] 501    功函数金属层
[0027] 701    第二功函数金属层
[0028] 801    金属层。

具体实施方式

[0029] 为了解释,在以下的说明中,提出许多特定细节供澈底了解示范具体实施例。不过,显然没有所述特定细节或用等价配置仍可实施示范具体实施例。在其他情况下,众所周知的结构及装置用方图图示以免不必要地混淆示范具体实施例。此外,除非呈现,在本专利说明书及权利要求中表示成分、反应状态等等的数量、比例及数值性质的所有数字应被理解为在所有情况下可用措辞“约”来修饰。
[0030] 本揭示内容针对及解决线空穴的当前问题与高k介电材料在RMG加工期间的暴露。根据本揭示内容的具体实施例,提供排除RMG填隙空穴且改善装置效能的一种新颖方法及所得装置。
[0031] 此外,本领域技术人员由以下详细说明可明白其他方面、特征及技术效果,其中仅以预期可实现本揭示内容的最佳模式举例描述数个较佳具体实施例。本揭示内容能够做出其他及不同的具体实施例,以及在各种明显的方面,能够修改数个细节。因此,附图及说明内容本质上应被视为图解说明用而不是用来限定。
[0032] 请参考图1,在衬底105的PFET(p型通道场效应晶体管)区101及NFET(n型通道场效应晶体管)区103上面形成虚拟栅极。各个虚拟栅极具有多晶硅材料107与形成于多晶硅材料107的相对两侧上的间隔体109。在形成于衬底105中的S/D(源极/漏极)区113上面形成填充在间隔体109之间的空间的ILD(层间电介质)111。在各个虚拟栅极下面可形成栅极氧化物衬里(未图示)。如图2所示,移除虚拟栅极的多晶硅材料107以在每一对间隔体109之间形成空腔201。
[0033] 请参考图3,在ILD 111及间隔体109上面与在各空腔201的侧面及底面上沉积高k介电层301。高k介电层301形成的厚度有1至5纳米。在图4中,在高k介电层301上面沉积金属覆盖层401。金属覆盖层401由例如TiN(氮化钛)的金属形成且形成的厚度有1至5纳米。
[0034] 请参考图5,在金属覆盖层401上面形成例如厚度有1至10纳米的功函数金属层501。功函数金属层501由用于n型装置的功函数金属形成,例如TiAlC。如图6所示,执行图案化以蚀刻去掉在PFET区101上面的功函数金属层501。功函数金属层501仍留在NFET区103上面。由于高k介电层301被金属覆盖层401覆盖,此图案化蚀刻不会损害高k介电层301。因此,当今的制程为优于暴露高k介电层以进行蚀刻的习知RMG加工的改善。保护高k介电层301可改善装置可靠性。
[0035] 请参考图7,在PFET区101中的金属覆盖层401上面与在NFET区103中的功函数金属层501上面沉积第二功函数金属层701。第二功函数金属层701形成的厚度有1至10纳米。第二功函数金属层由用于p型装置的功函数金属形成,例如TiN。
[0036] 请参考图8,沉积例如钨、铝、钨合金或铝合金的金属层801于第二功函数金属层701上面且填充各空腔201的其余部分。由于在PFET区101上面的空腔201在金属层801之前的沉积后比NFET区103中的空腔201宽,PFET有用于金属填充的更多空间,藉此可减少栅极电阻
[0037] 在图9中,进行例如CMP的平坦化步骤用于向下平坦化到ILD 111的上表面而移除多余的金属层801、功函数金属层501及功函数金属层701与高k介电层301且暴露侧面间隔体109及ILD 111的上表面以及形成在PFET区101、NFET区103两者中形成取代金属栅极(RMG)。后面的额外RMG制造使用习知的加工步骤。
[0038] 本揭示内容的具体实施例可实现数种技术效果,包括改善间隙填充与最小化高k介电层暴露,藉此有效改善装置可靠性且减少可能导致短路的缺陷。本揭示内容在产业上可用于各种工业应用,例如,微处理器、智能手机、移动电话、手机、机顶盒、DVD烧录机及播放机、汽车导航、打印机及周边设备、网络及电信设备、游戏系统、及数字相机。本揭示内容因此在产业上可用于各种高度整合半导体装置,特别是应用于例如14纳米及以下的先进技术节点。
[0039] 在以上说明中,特别用数个示范具体实施例描述本揭示内容。不过,显然仍可做出各种修改及改变而不脱离本揭示内容更宽广的精神及范畴,如权利要求所述。因此,本专利说明书及附图应被视为图解说明用而非限定。应了解,本揭示内容能够使用各种其他组合及具体实施例以及在如本文所述的本发明概念范畴内能够做出任何改变或修改。
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