技术领域
[0001] 本
发明属于数模混合集成
电路电子电路技术领域，尤其涉及一种自适应的小数频率合成器毛刺移除系统及方法。
背景技术
[0002] 目前，最接近的
现有技术：小数频率合成器是一种输出频率的器件，具有
分辨率高、
相位噪声低和
锁定时间快的性能，广泛应用在现代无线通信、雷达和电子对抗等系统，输出频率毛刺的大小是衡量小数频率合成器性能的一个重要指标，例如在无线通信系统中，小数频率合成器的毛刺越小，带内和带外噪声耦合到带内的噪声越小，无线通信系统的灵敏度越高。
[0003] 现有技术通过高性能的电荷
泵、新型结构的鉴频鉴相器、低量化噪声的Delta-Sigma
调制器，或通过
采样保持、模拟和数字校准、离散环路
滤波器、脉冲
位置调制和重现等技术降低毛刺的大小。但是，以上技术存在脉冲位置调制和脉冲宽度调制效应，不能从根源上移除毛刺。一种基于固定宽度可变幅度
电荷泵的小数频率合成器，可以消除脉冲位置调制效应和脉冲宽度调制效应，但该方案只能根除参考毛刺。根据以上分析，目前仍缺乏根除小数频率合成器整数毛刺和分数毛刺的相关技术。
[0004] 综上所述，现有技术存在的问题是：现有技术频率合成器毛刺移出方法不能从根源上移出毛刺，目前缺乏根除小数频率合成器整数毛刺和分数毛刺的相关技术。
[0005] 解决上述技术问题的意义：根除了参考毛刺和减小分数毛刺，使小数频率合成器的输出频率具有更高的
频谱纯度，用于无线收发器时可减小带内噪声和带外耦合到带内的噪声。
发明内容
[0006] 针对现有技术存在的问题，本发明提供了一种自适应小数频率合成器毛刺移除系统及方法。本发明不仅可以根除参考毛刺而且可以减小分数毛刺。
[0007] 本发明是这样实现的，一种自适应的小数频率合成器毛刺移除系统，包括：
[0008] 鉴频鉴相器PFD：用于检测参考频率fREF和反馈频率fDIV的相位误差θerror,用脉冲UP和DN表示；当fREF超前fDIV时，UP输出有效电平；当fREF滞后fDIV时，DN输出有效电平；
[0009]
锁定检测器LD：用于检测fREF和fDIV的相位误差θerror，当θerror大于
阈值相位误差θ0，小数频率合成器处于瞬态，Lock
信号为低电平；当θerror小于阈值相位误差θ0，小数频率合成器处于锁定状态，Lock信号为高电平；
[0010] 固定宽度固
定位置可变周期脉冲发生器FFVPG：包括延迟单元TD、RS触发器、
分频器DIV、与
门、或门，用于产生固定宽度、固定位置和可变周期的数字脉冲；
[0011] 可变幅度电荷泵VACP：包括或门、D触发器、固定
电流I1、电容C、充电电流IUP、放电电流IDN，充电电流IUP和放电电流IDN的幅度可变，大小与电容C上的
电压V1成K倍正比例关系，FFVPG驱动VACP产生固定宽度、固定位置、可变幅度和可变周期的环路电流ICP；
[0012]
环路滤波器LF：采用无源高阶
低通滤波器，输入为环路电流ICP，输出为调谐电压Vtune；
[0013] 压控
振荡器VCO：采用电感电容型压控振荡器，输入为调谐电压Vtune，输出为谐振频率fVCO；
[0014] 多模分频器MMD：由2/3分频器单元组成，输入为fVCO，输出为fDIV；
[0015] Delta-Sigma调制器DSM：采用mesh 1-1-1型结构,输入为小数控制字0.F，输出为多模分频器MMD的分频比控制字NMMD。
[0016] 进一步，所述固定宽度固定位置可变周期脉冲发生器FFVPG用于产生固定宽度、固定位置和可变周期的数字脉冲；所述可变幅度电荷泵VACP用于产生幅度可变的充电电流IUP和放电电流IDN；
[0017] 所述固定位置为参考频率fREF的下降沿，固定宽度为TD，瞬态时脉冲周期为TREF，锁定时脉冲周期为N×TREF，且锁定时环路电流脉冲的幅度之和为0。
[0018] 本发明的另一目的在于提供一种自适应的小数频率合成器毛刺移除方法包括：
[0019] 通过固定宽度、固定位置和可变周期的脉冲发生器和可变幅度的电荷泵，使小数频率合成器的环路电流具有固定宽度、固定位置和可变幅度且锁定时幅度和为0。同时周期可变，瞬态时的周期为TREF，锁定时的周期为N×TRE，移除脉冲宽度调制效应和脉冲位置调制效应，根除参考毛刺和减小分数毛刺。
[0020] 进一步，根除参考毛刺方法包括：脉冲宽度固定为TD，脉冲间隔固定为TS，脉冲周期为TREF，完成一次小数分频的脉冲个数为p，对应的周期为TREF0，则TREF0＝p×TREF。a1，a2，…和ap为脉冲的幅度，大小与fREF和fDIV的相位误差成正比；
[0021] 将TD和TS时间内的脉冲幅度分别用ω个和z个离散值表示，则脉冲周期TREF内的样本点数r为：r＝ω+z，一次小数分频周期TREF0内的样本点数m为：m＝p×r；ICP(t)被离散化为ICP(n)，其中n＝1，2，…，m；
[0022] ICP(n)＝{a1a1...a100..00a2a2...a200..00apap...ap00..00}；
[0023] 设小数频率合成器在频率 的毛刺为ck，利用傅里叶变换得到ck为：
[0024]
[0025] 当k＝p，此时为参考毛刺cp，大小为
[0026]
[0027] 因为r表示一个脉冲周期TREF，等式中括号内的值相等，为X,则
[0028]
[0029] 当小数频率合成器处于锁定状态，一个小数分频周期内的相位误差为0，所以a1+a2+...ap＝0，参考毛刺cp为0，根除参考毛刺。
[0030] 进一步，根除减小分数毛刺的方法包括：锁定时脉冲周期被调整为N×TREF，此周期内的样本点r增加为N×(w+z)，一个小数分频周期内样本点m增加为p×N×(w+z)；根据等式[0031]
[0032] ck的值较脉冲周期为TREF时更小，减小分数毛刺。
[0033] 进一步，所述自适应的小数频率合成器毛刺移除方法包括以下步骤：
[0034] 步骤一，利用鉴频鉴相器检测参考频率fREF和反馈频率fDIV的相位误差θerror,用脉冲UP和DN表示；当fREF超前fDIV时，UP输出有效电平；当fREF滞后fDIV时，DN输出有效电平；
[0035] 步骤二，利用锁定检测器检测fREF和fDIV的相位误差θerror，当θerror大于阈值相位误差θ0，小数频率合成器处于瞬态，Lock信号为低电平；当θerror小于阈值相位误差θ0，小数频率合成器处于锁定状态，Lock信号为高电平；
[0036] 步骤三，利用固定宽度固定位置可变周期脉冲发生器产生固定宽度、固定位置和可变周期的数字脉冲，利用可变幅度电荷泵产生可变幅度的充电电流和放电电流；
[0037] 步骤四，利用固定宽度固定位置可变周期脉冲发生器驱动可变幅度电荷泵，产生固定宽度、固定位置、可变幅度和可变周期的环路电流脉冲，根除参考毛刺和减小分数毛刺。
[0038] 进一步，步骤三中，所述利用固定宽度固定位置可变周期脉冲发生器产生固定宽度、固定位置和可变周期的数字脉冲，包括：
[0039] 参考信号fREF通过延迟单元TD和RS触发器时产生Pulse0；fREF通过分频器DIV产生fREF1，然后通过延迟单元TD和RS触发器产生Pulse1；Pulse0和UP(DN)连接到RS触发器，产生UP_T(DN_T)，用于确定环路电流为充电(放电)；UP_T(DN_T)和Pulse0连接到与门产生Pulse_UP0(Pulse_DN0)；Pulse_UP0(Pulse_DN0)、Lock和 通过与门和或门产生Pulse_UP1(Pulse_DN1)；
[0040] 当fREF超前fDIV，且设定分频器DIV的分频比为3，UP和UP_T输出有效电平，脉冲Pulse_UP0和脉冲Pulse0相等；当θerror>θ0，环路处于瞬态，Lock输出低电平，此时Pulse_UP1和Pulse_UP0相等，宽度固定为TD，位置为fREF的下降沿，周期为TREF；当θerror<θ0，环路锁定，Lock输出高电平，Pulse_UP1为Pulse1与Pulse_UP0的乘积，宽度仍固定为TD，位置为fREF的下降沿，周期为3×TREF。
[0041] 进一步，步骤三，所述利用可变幅度电荷泵产生可变幅度的充电电流和放电电流，包括：
[0042] UP和DN通过或门转换为充
电信号Charge，并驱动电流对电容充电到电压V1；充电前，Pulse0通过D触发器使CL变为高电平，将电容上的电压置零；当VACP开始工作时，UP和DN通过或门将CL置为低电平；电压V1与相位误差θerror成正比；充电电流IUP和放电电流IDN为K×V1，其中K是电压到电流的转换因子，为固定常数；VACP的充电电流IUP的幅度和放电电流IDN的幅度可变并且与相位误差θerror成正比。
[0043] 本发明的另一目的在于提供一种搭载所述自适应的小数频率合成器毛刺移除系统的无线通信小数频率合成器。
[0044] 综上所述，本发明的优点及积极效果为：本发明提供一种自适应的小数频率合成器毛刺移除系统及方法，鉴频鉴相器PFD用于检测参考频率fREF和fDIV的相位误差θerror；当fREF超前fDIV时，UP输出有效电平；当fREF滞后fDIV时，DN输出有效电平；锁定检测器LD用于检测fREF和fDIV的相位误差θerror，当θerror大于阈值相位误差θ0，小数频率合成器处于瞬态，Lock信号为低电平；当θerror小于阈值相位误差θ0，小数频率合成器处于锁定状态，Lock信号为高电平；固定宽度固定位置可变周期脉冲发生器FFVPG用于产生固定宽度、固定位置和可变周期的数字脉冲；可变幅度电荷泵VACP用于产生可变幅度的充电电流和放电电流脉冲；固定宽度固定位置可变周期脉冲发生器FFVPG驱动可变幅度电荷泵VACP，生成固定宽度、固定位置、可变幅度和可变周期的环路电流。本发明可根除参考毛刺和减小分数毛刺。
[0045] 相比于现有技术，本发明的优点进一步包括：本发明提出一种自适应毛刺移除技术。通过一种固定位置、固定宽度和可变周期脉冲发生器和一种可变幅度电荷泵，使环路电流脉冲不仅有固定宽度、固定位置、可变幅度和可变周期，且锁定时电流脉冲幅度之和为0。环路电流脉冲的固定宽度、固定位置和可变幅度特性用于移除整数毛刺；环路电流脉冲的可变周期特性用于移除分数毛刺。
[0046] 本发明通过设计可变幅度的电荷泵和固定位置、固定宽度和可变周期脉冲发生器，使小数频率合成器的环路电流脉冲不仅具有固定位置、固定宽带和可变幅度，而且在瞬态时的周期为TREF，在锁定时的周期为N倍TREF，用于移除脉冲位置调制效应和脉冲宽度调制效应，根除参考毛刺和减小分数毛刺。
附图说明
[0047] 图1是本发明
实施例提供的自适应的小数频率合成器毛刺移除系统结构示意图。
[0048] 图中：1、鉴频鉴相器PFD；2、锁定检测器LD；3、固定宽度固定位置可变周期脉冲发生器FFVPG；4、可变幅度电荷泵VACP；5、环路滤波器LF；6、压控振荡器VCO；7、多模分频器MMD；8、Delta-Sigma调制器DSM。
[0049] 图2是本发明实施例提供的自适应的小数频率合成器毛刺移除系统原理图。
[0050] 图3是本发明实施例提供的FFVPG电路图。
[0051] 图4是本发明实施例提供的VACP电路图。
[0052] 图5是本发明实施例提供的自适应小数频率合成器毛刺移除方法
流程图。
[0053] 图6是本发明实施例提供的FFVPG的时序图。
[0054] 图7是本发明实施例提供的VACP的时序图。
[0055] 图8是本发明实施例提供的FFVPG驱动VACP下的环路电流脉冲示意图。
[0056] 图9是本发明实施例提供的环路电流脉冲示意图。
[0057] 图10是本发明与传统小数频率合成器和一种基于固定宽度可变幅度电荷泵(FWVA-CP)的小数频率合成器的性能比较图。
具体实施方式
[0058] 为了使本发明的目的、技术方案及优点更加清楚明白，以下结合实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
[0059] 现有技术频率合成器毛刺移出方法不能从根源上移出毛刺，目前缺乏根除小数频率合成器整数毛刺和分数毛刺的相关技术。
[0060] 针对现有技术存在的问题，本发明提供了一种自适应小数频率合成器毛刺移除系统及方法，下面结合附图对本发明作详细的描述。
[0061] 如图1至图4所示，本发明实施例提供的自适应小数频率合成器系统包括：
[0062] 包括鉴频鉴相器PFD 1、锁定检测器LD 2、固定宽度固定位置可变周期脉冲发生器FFVPG 3、可变幅度电荷泵VACP 4、环路滤波器LF 5、压控振荡器VCO6、多模分频器MMD 7、Delta-Sigma调制器DSM 8，其中参考频率为fREF，参考周期为TREF。
[0063] 鉴频鉴相器PFD 1：用于检测参考频率fREF和fDIV的相位误差θerror,用脉冲UP和DN表示；当fREF超前fDIV时，UP输出有效电平；当fREF滞后fDIV时，DN输出有效电平。
[0064] 锁定检测器LD 2：用于检测fREF和fDIV的相位误差θerror，当θerror大于阈值相位误差θ0，小数频率合成器处于瞬态，Lock信号为低电平；当θerror小于阈值相位误差θ0，小数频率合成器处于锁定状态，Lock信号为高电平。
[0065] 固定宽度固定位置可变周期脉冲发生器FFVPG 3：包括延迟单元TD 3.1、RS触发器3.2、分频器DIV3.3、与门3.4、或门3.5，用于产生固定宽度、固定位置和可变周期的数字脉冲。
[0066] 可变幅度电荷泵VACP 4：包括或门4.1、D触发器4.2、驱动电流4.3、电容4.4、充电电流IUP4.5、放电电流IDN4.6，用于产生可变幅度的充电电流IUP和放电电流。
[0067] 如图3所示，本发明实施例提供的固定宽度固定位置可变周期脉冲发生器FFVPG 3用于产生固定位置、固定宽度和可变周期的数字脉冲，可变幅度电荷泵VACP 4用于产生可变幅度的充电电流IUP3.5和放电电流IDN3.6。
[0068] 所述固定位置为参考频率fREF的下降沿，固定宽度为TD，瞬态时脉冲周期为TREF，锁定时脉冲周期为N×TREF，且锁定时环路电流脉冲的幅度之和为0。
[0069] 本发明实施例提供自适应小数频率合成器毛刺移除方法包括：
[0070] 通过设计固定宽度、固定位置和可变周期的脉冲发生器和可变幅度电荷泵，使小数频率合成器的环路电流脉冲具有固定宽度、固定位置、可变幅度且锁定时环路电流脉冲幅度之和为0，同时，周期可变，在瞬态时的周期为TREF，在锁定时的周期为N倍TREF，移除脉冲位置调制效应和脉冲宽度调制效应，根除参考毛刺和减小分数毛刺。
[0071] 如图5所示，本发明实施例提供的自适应的自适应的小数频率合成器毛刺移除方法包括以下步骤：
[0072] S101，利用鉴频鉴相器检测参考频率fREF和fDIV的相位误差θerror,用脉冲UP和DN表示；当fREF超前fDIV时，UP输出高电平；当fREF滞后fDIV时，DN输出高电平。
[0073] S102，利用锁定检测器检测fREF和fDIV的相位误差θerror，当θerror大于阈值相位误差θ0，小数频率合成器处于瞬态，Lock信号为低电平；当θerror小于阈值相位误差θ0，小数频率合成器处于锁定状态，Lock信号为高电平。
[0074] S103，利用固定宽度固定位置可变周期脉冲发生器产生固定位置、固定宽度和可变周期的数字脉冲，利用可变幅度电荷泵产生可变幅度的充电电流和放电电流。
[0075] S104，利用固定宽度固定位置可变周期脉冲发生器驱动可变幅度电荷泵的充电电流和放电电流，产生固定宽度、固定位置、可变幅度和可变周期的环路电流脉冲，根除参数毛刺和减小分数毛刺。
[0076] 步骤S103中，本发明实施例提供的利用固定宽度固定位置可变周期脉冲发生器产生固定位置、固定宽度和可变周期的数字脉冲包括：
[0077] 参考信号fREF通过延迟单元TD和RS触发器时产生Pulse0；fREF通过分频器DIV产生fREF1，然后通过延迟单元TD和RS触发器产生Pulse1；Pulse0和UP(DN)连接到RS触发器，产生UP_T(DN_T)，用于确定环路电流为充电(放电)；UP_T(DN_T)和Pulse0连接到与门产生Pulse_UP0(Pulse_DN0)；Pulse_UP0(Pulse_DN0)、Lock和 通过与门和或门产生Pulse_UP1(Pulse_DN1)。
[0078] 当fREF超前fDIV，且分频器DIV的分频比为3，UP和UP_T输出有效电平，脉冲Pulse_UP0和脉冲Pulse0相等；当θerror>θ0，环路处于瞬态，Lock输出低电平，此时Pulse_UP1和Pulse_UP0相等，宽度固定为TD，位置为fREF的下降沿，周期为TREF；当θerror<θ0，环路锁定，Lock输出高电平，此时Pulse_UP1为Pulse1与Pulse_UP0的乘积，宽度仍固定为TD，位置仍为fREF的下降沿，周期变为3×TREF。
[0079] 步骤S103中，本发明实施例提供的利用可变幅度电荷泵产生可变幅度的充电电流和放电电流包括：
[0080] UP和DN通过或门转换为充电信号Charge，并驱动电流对电容充电到电压V1；充电前，Pulse0通过D触发器使CL变为高电平，将电容上的电压置零；当VACP开始工作时，UP和DN通过或门将CL置为低电平；电压V1与相位误差θerror成正比；充电电流IUP和放电电流IDN为K×V1，其中K是电压到电流的转换因子，为固定常数；VACP的充电电流IUP 4.5的幅度和放电电流IDN 4.6的幅度可变并且与相位误差θerror成正比。
[0081] 下面结合具体实施例对本发明作进一步说明。
[0082] 实施例1：
[0083] 如图2所示的小数频率合成器，主要通过PFD 1、LD 2、FFVPG 3和VACP 4等四个模
块产生环路电流脉冲。FFVPG 3产生固定位置、固定宽度和可变周期的数字脉冲，VACP 4产生可变幅度的充电电流和放电电流。FFVPG 3驱动VACP 4产生图2所示的环路电流脉冲，其中固定位置为fREF的下降沿，固定宽度为TD，瞬态时脉冲周期为TREF，锁定时脉冲周期为N×TREF，且锁定时环路电流脉冲的幅度之和为0。
[0084] PFD 1检测fREF和fDIV的相位误差θerror,用脉冲UP和DN表示。当fREF超前fDIV时，UP输出有效电平；当fREF滞后fDIV时，DN输出有效电平。
[0085] LD 2检测fREF和fDIV的相位误差θerror，当θerror大于阈值相位误差θ0，小数频率合成器处于瞬态，Lock信号为低电平。当θerror小于阈值相位误差θ0，小数频率合成器处于锁定状态，Lock信号为高电平。
[0086] FFVPG 3如图3。参考信号fREF通过延迟单元TD 3.1和RS触发器3.2时产生Pulse0。fREF通过分频器DIV 3.3产生fREF1，然后通过延迟单元TD 3.1和RS触发器3.2产生Pulse1。
Pulse0和UP(DN)连接到RS触发器3.2，产生UP_T(DN_T)，用于确定环路电流为充电(放电)。
UP_T(DN_T)和Pulse0连接到与门3.4产生Pulse_UP0(Pulse_DN0)。Pulse_UP0(Pulse_DN0)、Lock和 通过与门3.4和或门3.5产生Pulse_UP1(Pulse_DN1)。
[0087] 当fREF超前fDIV，且分频器DIV 3.3的分频比为3，FFVPG 3的时序如图6，UP和UP_T输出有效电平，脉冲Pulse_UP0和脉冲Pulse0相等。当θerror>θ0，环路处于瞬态，Lock输出低电平，此时Pulse_UP1和Pulse_UP0相等，宽度固定为TD，位置为fREF的下降沿，周期为TREF。当θerror<θ0，环路锁定，Lock输出高电平，此时Pulse_UP1为Pulse1与Pulse_UP0的乘积，宽度仍固定为TD，位置仍为fREF的下降沿，但是周期变为3×TREF。
[0088] VACP 4如图4，结合它的时序图图7，VACP的功能解释如下。UP和DN通过或门4.1转换为充电信号Charge，并驱动电流4.3对电容4.4充电到电压V1。每次充电前，Pulse0通过D触发器4.2使CL变为高电平，将电容4.4上的电压置零。当VACP开始工作时，UP和DN通过或门将CL置为低电平。因此，电压V1与相位误差θerror成正比。充电电流IUP 4.5和放电电流IDN 4.6为K×V1，其中K是电压到电流的转换因子，为固定常数。所以，VACP的充电电流IUP 4.5的幅度和放电电流IDN 4.6的幅度可变并且与相位误差θerror成正比。
[0089] FFVPG 3驱动VACP 4，环路电流脉冲ICP的时序如图8。当环路处于瞬态时，Pulse_UP0作用，环路电流脉冲ICP的周期为TREF；当环路处于瞬态时，Pulse_UP1作用，每3个TREF采集一个充电电流IUP，所以环路电流脉冲ICP的周期为3×TREF。
[0090] 综上所述，利用图2所示的小数频率合成器结构，利用图3所示的FFVPG和图4所示的VACP可以产生图9所示的环路电流脉冲，实现根除整数毛刺和减小分数毛刺的目的。
[0091] 实施例2：
[0092] 图2所示小数频率合成器的环路电流脉冲ICP(t)的
波形如图9，瞬态时环路电流脉冲的周期为TREF，锁定时环路电流脉冲的周期为N×TREF。
[0093] 以瞬态时的电流脉冲波形为例，其特性如下：脉冲宽度固定为TD，脉冲间隔固定为TS，脉冲周期为TREF，完成一次小数分频的脉冲个数为p，对应的周期为TREF0，则TREF0＝p×TREF。a1，a2，…和ap为脉冲的幅度，其大小与fREF和fDIV的相位误差成正比。
[0094] 将TD和TS时间内的脉冲幅度分别用ω个和z个离散值表示，则脉冲周期TREF内的样本点数r为：r＝ω+z，一次小数分频周期TREF0内的样本点数m为：m＝p×r。此时，ICP(t)被离散化为ICP(n)，其中n＝1，2，…，m。
[0095] ICP(n)＝{a1a1...a100..00a2a2...a200..00apap...ap00..00} (1)
[0096] 设小数频率合成器在频率 处的毛刺为ck，利用离散傅里叶变换得到ck为：
[0097]
[0098] 当k＝p，此时为参考毛刺cp，大小为
[0099]
[0100] 因为r表示一个脉冲周期TREF，则等式(3)中括号内的值相等，令其为X,则[0101]
[0102] 当小数频率合成器处于锁定状态，一个小数分频周期内的相位误差为0，所以a1+a2+...ap＝0，根据等式(4)参考毛刺cp为0，即该技术可以根除参考毛刺。
[0103] 此外，因为锁定时脉冲周期被调整为N×TREF，此周期内的样本点r增加为N×(w+z)，一个小数分频周期内样本点m增加为p×N×(w+z)。根据等式(2)，ck的值较脉冲周期为TREF时更小，因此减小了分数毛刺。
[0104] 下面结合具体实验对本发明作进一步描述。
[0105] 图10为基于图2的小数频率合成器，选取MMD的整数值为120，小数值0.F为0.13,表征0.F的二进制位数为19位，参考频率为20MHz时调谐电压Vtune的频谱，根据图10得到，推荐的小数频率合成器FN-PLL与传统的FN-PLL和一种固定宽度可变幅度电荷泵：FWVA-CP的FN-PLL的性能比较。根据结果得到，推荐的小数频率合成器和基于FWVA-CP的FN-PLL一样没有参考毛刺，但是分数毛刺远小于基于FWVA-CP的FN-PLL。
[0106] 以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内所作的任何
修改、等同替换和改进等，均应包含在本发明的保护范围之内。
