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同时对多台图形发生器内的FPGA进行程序加载的方法

阅读：170发布：2023-02-22

专利汇可以提供同时对多台图形发生器内的FPGA进行程序加载的方法专利检索，专利查询，专利分析的服务。并且本发明公开了同时对多台图形发生器内的FPGA进行程序加载的方法，包括1、用户登录电脑；2、在电脑中选定需要进行升级程序加载的图形发生器；3、电脑与选定的图形发生器建立通信；4、从电脑中选中FPGA程序升级文件，通过交换机以广播包的形式向已经建立通信的图形发生器的ARM下发FPGA加载控制协议，各个图形发生器的ARM获取对应的FPGA加载控制协议；5、每台图形发生器的ARM根据FPGA升级文件所在的文件路径从电脑中把该路径对应的FPGA升级文件拷贝到图形发生器中；6、每台图形发生器的ARM，将图形发生器的FPGA升级文件加载到对应的FPGA中。本发明能提升批量图形发生器的FPGA程序升级效率。，下面是同时对多台图形发生器内的FPGA进行程序加载的方法专利的具体信息内容。

权利要求

1.一种同时对多台图形发生器内的FPGA进行程序加载的方法，其特征在于，它包括如下步骤：
步骤1：用户登录电脑(1)；
步骤2：在电脑(1)的上层图形发生器控制软件中选定多个需要进行升级程序加载的图形发生器(2)；
步骤3：电脑(1)通过交换机(3)与上述选定的图形发生器(2)建立通信连接；
步骤4：用户通过操作上层图形发生器控制软件，从电脑(1)的存储器中选中图形发生器的FPGA程序升级文件，用户操作上层图形发生器控制软件通过交换机(3)以广播包的形式向上述已经建立通信连接的图形发生器(2)内部的ARM处理器下发FPGA加载控制协议，该FPGA加载控制协议包括图形发生器存放机架地址、图形发生器地址、命令字和协议文本，该协议文本包括FPGA升级文件所在的文件路径，上述各个图形发生器(2)内部的ARM处理器通过匹配图形发生器存放机架地址、图形发生器地址和命令字获取对应的FPGA加载控制协议；
步骤5：每台图形发生器内的ARM处理器根据步骤4中获取的FPGA升级文件所在的文件路径从电脑(1)中把该路径对应的FPGA升级文件拷贝到图形发生器(2)的存储器中；
步骤6：每台图形发生器内的ARM处理器根据图形发生器内部通信协议，将图形发生器(2)的存储器内的FPGA升级文件加载到对应的FPGA中，即完成同时对多台图形发生器内的FPGA进行程序加载的过程；
所述命令字包括升级命令字和查询命令字；
所述步骤3～6中，电脑(1)的上层图形发生器控制软件定时向每个图形发生器(2)的ARM处理器查询当前各个图形发生器(2)的FPGA升级程序加载状态，并将各个图形发生器(2)的FPGA升级程序加载状态在电脑(1)进行显示，升级进度通过进度条提示用户。
2.根据权利要求1所述的同时对多台图形发生器内的FPGA进行程序加载的方法，其特征在于：所述FPGA升级程序加载状态包括当前升级进度、升级失败、升级完成或升级超时四种状态。
3.根据权利要求1所述的同时对多台图形发生器内的FPGA进行程序加载的方法，其特征在于：所述电脑(1)的通信端通过交换机(3)连接每个图形发生器(2)的通信端。

说明书全文

同时对多台图形发生器内的FPGA进行程序加载的方法

技术领域

[0001] 本发明涉及FPGA(Field-Programmable Gate Arrays，现场可编程逻辑阵列)的程序加载技术领域，具体地指同时对多台图形发生器内的FPGA进行程序加载的方法。

背景技术

[0002] 目前，设备出货后，需要对图形发生器内的FPGA程序进行加载，加载过程为一对一加载，无法同时对多台图形发生器内的FPGA程序进行升级。同时，每次FPGA程序加载前图形发生器都需要挂载文件系统(挂载所需时间约为1分钟)，一台一台的挂载过程消耗了大量的时间。

[0003] 另外，使用一个ARM(Advanced RISC Machines)处理器通过SPI总线连接多个SPI类闪存进行一对多的图形发生器FPGA程序升级，可以满足出货前量产升级的需求，但是由于需要从图形发生器中将FPGA拆卸下来后才能进行FPGA的升级，不适用于出货后的现场升级应用。

发明内容

[0004] 本发明的目的就是要提供一种同时对多台图形发生器内的FPGA进行程序加载的方法，该方法能提升批量图形发生器的FPGA程序升级效率。

[0005] 为实现此目的，本发明所设计的同时对多台图形发生器内的FPGA进行程序加载的方法，其特征在于，它包括如下步骤：

[0006] 步骤1：用户登录电脑；

[0007] 步骤2：在电脑的上层图形发生器控制软件中选定多个需要进行升级程序加载的图形发生器；

[0008] 步骤3：电脑通过交换机与上述选定的图形发生器建立通信连接；

[0009] 步骤4：用户通过操作上层图形发生器控制软件，从电脑的存储器中选中图形发生器的FPGA程序升级文件，用户操作上层图形发生器控制软件通过交换机以广播包的形式向上述已经建立通信连接的图形发生器内部的ARM处理器下发FPGA加载控制协议，该FPGA加载控制协议包括图形发生器存放机架地址、图形发生器地址、命令字和协议文本，该协议文本包括FPGA升级文件所在的文件路径，上述各个图形发生器内部的ARM处理器通过匹配图形发生器存放机架地址、图形发生器地址和命令字获取对应的FPGA加载控制协议；

[0010] 步骤5：每台图形发生器内的ARM处理器根据步骤4中获取的FPGA升级文件所在的文件路径从电脑中把该路径对应的FPGA升级文件拷贝到图形发生器的存储器中；

[0011] 步骤6：每台图形发生器内的ARM处理器根据图形发生器内部通信协议，将图形发生器的存储器内的FPGA升级文件加载到对应的FPGA中，即完成同时对多台图形发生器内的FPGA进行程序加载的过程。

[0012] 本发明的有益效果：

[0013] 本发明通过上述步骤实现了同时对多台图形发生器内的FPGA进行程序加载(升级)，同时对多台图形发生器挂载文件系统，极大的提高了批量图形发生器升级的效率，缩短了图形发生器批量升级的时间，并且，升级的过程中多台图形发生器只需通过交换机接入电脑即可，不需要将FPGA从图形发生器中拆下，升级过程方便，尤其适用于图形发生器出货后的批量升级。附图说明

[0014] 图1为本发明的结构示意图；

[0015] 其中，1—电脑、2—图形发生器、3—交换机。

具体实施方式

[0016] 以下结合附图和具体实施例对本发明作进一步的详细说明：

[0017] 如图1所示同时对多台图形发生器内的FPGA进行程序加载的方法，其特征在于，它包括如下步骤：

[0018] 步骤1：用户登录电脑1(用户通过超级密码登录电脑1，只有超级用户才具有升级权限)；

[0019] 步骤2：在电脑1的上层图形发生器控制软件中选定多个需要进行升级程序加载的图形发生器2，(可以对一个图形发生器2单独升级，可以对图形发生器2多选升级，也可以整个图形发生器存放机架内的所有图形发生器2一起升级)；

[0020] 步骤3：电脑1通过交换机3与上述选定的图形发生器2建立通信连接；

[0021] 步骤4：用户通过操作上层图形发生器控制软件，从电脑1的存储器中选中图形发生器的FPGA程序升级文件，用户操作上层图形发生器控制软件通过交换机3以广播包的形式向上述已经建立通信连接的图形发生器2内部的ARM处理器下发FPGA加载控制协议，该FPGA加载控制协议包括图形发生器存放机架地址、图形发生器地址、命令字和协议文本，该协议文本包括FPGA升级文件所在的文件路径，上述各个图形发生器2内部的ARM处理器通过匹配图形发生器存放机架地址、图形发生器地址和命令字获取对应的FPGA加载控制协议；

[0022] 步骤5：每台图形发生器内的ARM处理器根据步骤4中获取的FPGA升级文件所在的文件路径从电脑1中把该路径对应的FPGA升级文件拷贝到图形发生器2的存储器中；

[0023] 步骤6：每台图形发生器内的ARM处理器根据图形发生器内部通信协议，将图形发生器2的存储器内的FPGA升级文件加载到对应的FPGA中，即完成同时对多台图形发生器内的FPGA进行程序加载的过程。

[0024] 上述技术方案中，所述命令字包括升级命令字和查询命令字。

[0025] 上述技术方案的步骤3～6中，电脑1的上层图形发生器控制软件定时向每个图形发生器2的ARM处理器查询当前各个图形发生器2的FPGA升级程序加载状态，并将各个图形发生器2的FPGA升级程序加载状态在电脑1进行显示，升级进度通过进度条提示用户，升级过程中不允许用户对电脑1或图形发生器2进行其他操作。

[0026] 上述技术方案中，所述FPGA升级程序加载状态包括当前升级进度、升级失败、升级完成或升级超时四种状态。

[0027] 上述技术方案中，所述电脑1的通信端通过交换机3连接每个图形发生器2的通信端。

[0028] 本发明通过上述设计可以实现当有个别被选中的图形发生器2初次加载FPGA程序失败时，下次可以单独选中这些图形发生器2进行重新加载。

[0029] 本发明中用户通过上层图形发生器控制软件中的Update模块(升级模块)进行FPGA程序加载操作，上层图形发生器控制软件通过JCMCPA通信模块和图形发生器2中的ARM处理器进行UDP(User Datagram Protocol，用户数据报协议)数据交互，ARM处理器负责获取和加载FPGA程序。

[0030] 本说明书未作详细描述的内容属于本领域专业技术人员公知的现有技术。

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