一种钟控动态电压比较器集成电路
阅读：1038发布：2020-05-13
专利汇可以提供一种钟控动态电压比较器集成电路专利检索，专利查询，专利分析的服务。并且本实用新型公开了一种钟控动态比较器集成 电路 ，包括轨到轨前置放大电路、中间级放大电路、钟控 锁 存比较电路和输出电路；轨到轨前置放大电路由P型和N型两种差分对并行连接组成，构成钟控动态比较器集成电路的差分输入vinp和vinn；中间级放大电路连接轨到轨前置放大电路，由四级 电流 镜负载的差分放大电路构成；钟控锁存比较电路连接中间级放大电路，为钟控并联锁存放大电路；输出电路连接锁存比较电路，由自偏置差分放大电路和反向器构成。针对于常见钟控动态比较器的 电压 范围受限问题，支持轨到轨输入输出、具有较高速度以及灵敏度、带有正反两向同步输出、具有较低功耗。，下面是一种钟控动态电压比较器集成电路专利的具体信息内容。
1.一种钟控动态电压比较器集成电路，其特征在于，包括：
轨到轨前置放大电路，由P型和N型两种差分对并行连接组成，构成所述钟控动态电压比较器集成电路的差分输入vinp和vinn；
中间级放大电路，连接所述轨到轨前置放大电路，由四级电流镜负载的差分放大电路构成；
钟控锁存比较电路，连接所述中间级放大电路，为钟控并联锁存放大电路；
输出电路，连接所述锁存比较电路，由自偏置差分放大电路和反向器构成。
2.根据权利要求1所述的钟控动态电压比较器集成电路，其特征在于，所述轨到轨前置放大电路，还包括：
N型差分对负载电路，其输出连接所述中间级放大电路；
电流镜电路，将所述P型差分对的输出加载到所述N型差分对负载电路上；
使能开关，用于所述轨到轨前置电路的开启关断使能；
偏置电路，为所述轨到轨前置放大电路提供偏置电流和偏置电压。
3.根据权利要求1所述的钟控动态电压比较器集成电路，其特征在于，每级电流负载的差分放大电路包括：
电流镜负载；
二极管负载；
N型差分输入对；
第一镜像电流源，连接所述N型差分输入对电路。
4.根据权利要求1所述的钟控动态电压比较器集成电路，其特征在于，所述钟控锁存比较电路包括：
N型差分输入对电路；
由NOMS管组成的第二镜像电流源，加载在所述N型差分输入对电路上；
反向器，接时钟信号；
并联锁存电路，连接所述N型差分输入对电路的输出。
5.根据权利要求1所述的钟控动态电压比较器集成电路，其特征在于，所述反向器包括串联的第一反向器、第二反向器和第三反向器；
其中，所述第二反向器的输出为正向输出Vout，所述第三反向器的输出为反向输出Vout-。
一种钟控动态电压比较器集成电路
技术领域
[0001] 本实用新型属于集成电路技术领域，具体地说，是涉及一种钟控动态电压比较器集成电路。
背景技术
[0002] 电压比较器电路在很多模拟集成电路项目中的应用是十分广泛的，尤其是在常见的模数转换电路中，比较器起着至关重要的作用。
[0003] 比较器的分类方式多样，其中根据比较器工作在持续时间或时钟采样时间的不同可大致分为静态比较器（即常规比较器）以及动态比较器。前者多适用于需要连续时间内不间断比较的情况，其特点是offset小但功耗大；后者则多用于模数转换电路，特点是速度快功耗小，但offset大。静态比较器电路的框架一般是由各类放大器与正反馈比较结构电路组成，甚至只由放大电路组成。其中放大电路一般作为输入为比较器提供输入信号的差异放大服务，为后面的比较提供更良好的比较信号，而正反馈比较结构则是比较的核心，快速地比较并将差异结果迅速向后续结构输出，最终实现对电压的比较功能。而动态比较器在锁存比较结构上添加了时钟控制，即离散采样的工作方式，这样减少了功耗消耗，且方便于数字模块中的应用。
[0004] 现有的钟控动态比较器芯片电路多是仅支持轨到轨输出的电路，缺少对轨到轨输入功能的支持，导致输入电压受限制；部分电路的灵敏度过小，速度略低，而部分比较电路的功耗过大，且只有正向输出，没有同步的反向输出接口。发明内容
[0005] 本实用新型的目的在于针对于常见钟控动态比较器的电压范围受限问题，提出一种支持轨到轨输入输出的、具有较高速度以及灵敏度的、带有正反两向同步输出的、较低功耗的钟控动态电压比较器集成电路。
[0006] 本实用新型采用以下技术方案予以实现：
[0007] 提出一种钟控动态电压比较器集成电路，包括：轨到轨前置放大电路，由P型和N型两种差分对并行连接组成，构成所述钟控动态电压比较器集成电路的差分输入vinp和vinn；中间级放大电路，连接所述轨到轨前置放大电路，由四级电流镜负载的差分放大电路构成；钟控锁存比较电路，连接所述中间级放大电路，为钟控并联锁存放大电路；输出电路，连接所述锁存比较电路，由自偏置差分放大电路和反向器构成。
[0008] 进一步的，所述轨到轨前置放大电路，还包括：N型差分对负载电路，其输出连接所述中间级放大电路；电流镜电路，将所述P型差分对的输出加载到所述N型差分对负载电路上；使能开关，用于所述轨到轨前置电路的开启关断使能；偏置电路，为所述轨到轨前置放大电路提供偏置电流。
[0010] 进一步的，所述钟控锁存比较电路包括：N型差分输入对电路；由NOMS管组成的第二镜像电流源，加载在所述N型差分输入对电路上；反向器，接时钟信号；并联锁存电路，连接所述N型差分输入对电路的输出。
[0011] 进一步的，所述反向器包括串联的第一反向器、第二反向器和第三反向器；其中，所述第二反向器的输出为正向输出Vout，所述第三反向器的输出为反向输出Vout-。
[0012] 与现有技术相比，本实用新型的优点和积极效果是：本实用新型提出的钟控动态电压比较器集成电路，针对于常见钟控动态比较器的电压范围受限问题，支持轨到轨输入输出、具有较高速度以及灵敏度、带有正反两向同步输出、具有较低功耗。
附图说明
[0014] 图1 为本实用新型提出的钟控动态电压比较器集成电路的电路架构图；
[0015] 图2为本实用新型提出的轨到轨前置电路的实施例电路图；
[0016] 图3为本实用新型提出的中间级放大电路的实施例电路图；
[0017] 图4为本实用新型提出的锁存比较电路的实施例电路图；
[0018] 图5为本实用新型提出的输出电路的实施例电路图；
[0019] 图6为本实用新型提出的钟控动态电压比较器集成电路的模块示意图；
[0020] 图7为本实用新型提出的钟控动态电压比较器集成电路的仿真图；
[0021] 图8为本实用新型提出的钟控动态电压比较器集成电路的仿真图；
[0022] 图9为本实用新型提出的钟控动态电压比较器集成电路的仿真图。
具体实施方式
[0023] 下面结合附图对本实用新型的具体实施方式作进一步详细的说明。
[0024] 本实用新型旨在提出一种支持轨到轨输入输出、具有较高速度以及灵敏度、带有正反两向同步输出、具有较低功耗的钟控动态电压比较器电路。
[0025] 如图1所示，本实用新型提出的钟控动态电压比较器集成电路包括轨到轨前置放大电路11、中间级放大电路、钟控锁存比较电路13和输出电路14；轨到轨前置放大电路11由P型和N型两种差分对并行连接组成，构成钟控动态电压比较器集成电路的差分输入vinp和vinn；中间级放大电路12连接轨到轨前置放大电路11，由四级电流镜负载的差分放大电路构成；钟控锁存比较电路13连接中间级放大电路12，为钟控并联锁存放大电路；输出电路14连接锁存比较电路13，由自偏置差分放大电路和反向器构成。
[0026] 具体的，轨到轨前置放大电路11由P型与N型两组差分对并行连接构成；二者无需要多大的放大增益，只需保证低压输入时P型差分工作而高压输入时N型差分对工作，且保持相对良好的带宽即可。这样可以保证无论输入高电压或低电压，比较器都可以正常工作，且因为带宽比较大，所以对于高频信号会依然保持良好的放大作用。
[0027] 如图2所示，PMOS管M2、M3构成P型差分输入对，与NMOS管M0、M1构成的N型差分输入对并行连接，M3与M1的栅极相接构成输入vinp，M2与M0的栅极相接构成输入vinn，电流通过NMOS管M9、M6与M7、M8构成的电流镜电路加载到N型差分对负载电路M10、M13上，之后通过PMOS管M10、M13的漏端输出到后续的中间级放大模块。NMOS管M71构成使能开关，起到开启关断使能作用。剩下的MOS管M24、M25、M37、M38、M39、M40、M36、M22、M5、M23则构成了电路的偏置电路，为电路提供静态工作电流和电压；图中vdd为3.3V，gnd为0V。
[0028] 中间级放大电路12采用四级电流负载的差分放大电路构成；该四级放大器同样不需要大的放大增益，只需要保证相对良好的带宽与适宜的输出电压范围即可，这样可以保证对于高频信号的放大作用。
[0029] 如图3所示，第一级放大器由NMOS管M101、M102构成N型差分输入对，而 M101的栅极与图2中M10的漏极相连接，M102的栅极与图2中M13的漏极相连接；M103与M104分别作为M101、M102的电流镜负载，两者的栅极接图2中M24的栅极；M106与M105分别作为M101、M102的二极管负载；作为第一镜像电流源使用的M100与M99的栅极分别连接图2中M5与M23的栅极；第二级放大器由NMOS管M110、M109构成N型差分输入对，而 M110的栅极与M101的漏极相连接，M109的栅极与M102的漏极相连接，M111与M114分别作为M110、M109的电流镜负载，两者的栅极接图2中M24的栅极，M112与M113分别作为M110、M109的二极管负载；作为第一镜像电流源使用的M108与M107的栅极分别连接图2中M5与M23的栅极；第三级放大器由NMOS管M116、M121构成N型差分输入对，而 M116的栅极与M110的漏极相连接，M121的栅极与M109的漏极相连接，M120与M117分别作为M116、M121的电流镜负载，两者的栅极接图2中M24的栅极；M119与M118分别作为M116、M121的二极管负载，作为第一镜像电流源使用的M122与M115的栅极分别连接图2中M5与M23的栅极；第四级放大器由NMOS管M128、M127构成N型差分输入对，而 M128的栅极与M116的漏极相连接，M127的栅极与M121的漏极相连接，M129与M132分别作为M128、M127的电流镜负载，两者的栅极接图2中M24的栅极，M130与M131分别作为M128、M127的二极管负载，作为第一镜像电流源使用的M126与M125的栅极分别连接图2中M5与M23的栅极；图中M103源端接vdd，M99源端连接gnd。
[0031] 如图4所示，MOS管M67、M68构成N型差分输入对，而 M67的栅极与图3中M128的漏极相连接，M68的栅极与图3中M127的漏极相连接。作为第二镜像电流源使用的M69与M70的栅极分别连接图3中M126与M125的栅极。M156与M155构成反向器，M156的栅极接时钟信号clk。M14、M15与M12、M11分别构成并联的锁存结构，M14、M15的漏端分别与M12、M11漏端相连，M157与M158并联后跨接在该两点之间作为开关， M157与M158的栅极分别连接M156的栅极与漏极，M14的源端接vdd，M12的源端接gnd。
[0032] 输出电路14为具有轨到轨输出以及提供大电流输出能力的输出电路，该电路没有很大的静态电流，拥有一定的尾电流自适应能力，另外其输出处带有反向器，可以同时输出正向与反向的输出结果信号。
[0033] 如图5所示，MOS管M28、M29、M30、M31、M32、M33构成具有吸入与供出大电流能力的输出部分，液叫自偏置差分放大电路，而M28与M29限制着所能流过的最大电流。其余的MOS管M34、M35、M41、M42、M74、M77构成三个反向器，MOS管M28的源级接vdd电源电压，MOS管M28的源级接gnd地电压，而MOS管M30、M31的栅极分别接图4电路中的MOS管M11与M15的漏极，MOS管M32、M33的栅极分别接图4电路中的MOS管M14与M12的漏极，MOS管M42、M77的漏极则是该模块的两个输出端口vout与vout-。
[0034] 如图6所示，为整体电路的接口定义与模块表征符号，其输入引脚有七个，分别为3.3V电源电压接口vdd、3.3V 启动及使能信号接口en、电源地接口gnd、5uA基准电流输入接口iin、时钟ckl、以及差分输入接口vinp和vinn，输出引脚有两个，分别为未经过反向器反向的输出接口vout，以及经过反向器反向的输出接口vout-。
[0035] 下面对本实用新型提出的钟控动态电压比较器集成电路的设计仿真和结果做出实施例说明。
[0037] 如图7所示，曲线1位时钟clk端口，曲线2位正向输出端vout，曲线3为输入端vinp，从该仿真得到的结果可以看出，该比较器可以在1G赫兹时钟下，正常比较100MHZ频率的信号。
[0038] 之后，在上述仿真的基础上，将差分输入信号的频率增加至500MHZ，跑关于该信号下的瞬态仿真，用以观察该信号电压下的输出信号是否满足所需。
[0039] 仿真结果如图8所示，曲线1位时钟clk端口，曲线2位正向输出端vout，曲线3为输入端vinp，由仿真结果来看，该钟控动态比较电路能够比较输入的500MHZ的差分输入信号并准确的输出，且输出信号达到了轨到轨输出的标准，同时，整体电流最大不超过400uA，实现了电路的低功耗。
[0040] 之后再在上述第二次仿真的基础上，将差分输入信号的波形换为方波，跑关于该信号下的瞬态仿真，用以观察该信号电压下的输出信号是否满足所需。
[0041] 仿真结果如图9所示，曲线1位时钟clk端口，曲线2为正向输出端vout，曲线3为输入 vinp，曲线4为反向输出端vout-，曲线5为输入端vinn，由此图仿真结果来看，该钟控动态比较电路能够比较输入的500MHZ的差分输入信号并准确的输出，且输出信号达到了轨到轨输出的标准，同时整体电流最大不超过400uA，实现了电路的低功耗。
[0042] 最后，将输入电压信号改为任意值，发现比较器皆正常工作，证明实现了轨到轨输入输出功能。
[0043] 应该指出的是，上述说明并非是对本实用新型的限制，本实用新型也并不仅限于上述举例，本技术领域的普通技术人员在本实用新型的实质范围内所做出的变化、改型、添加或替换，也应属于本实用新型的保护范围。
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