一种大尺寸芯片的分层隔离封装结构
阅读：930发布：2022-03-08
专利汇可以提供一种大尺寸芯片的分层隔离封装结构专利检索，专利查询，专利分析的服务。并且本实用新型涉及一种大尺寸芯片的分层隔离封装结构，通过多次包封、削减、电 镀 等工艺流程，形成具有芯片、金属 凸 块 、第三塑封体、导电金属、第一 铜 垫、第二铜垫、导电铜柱、外引脚和重布线层的分层隔离封装结构，能够有效避免大尺寸的芯片背面上的第一铜垫与外引脚 接触 造成 短路 的现象发生，突破了传统封装中 框架 结构的限制，做到相同封装尺寸内放置较大的芯片，采用设置导电铜柱和第三塑封体的隔离，不会出现短路现象发生，在有限的封装尺寸内，能够最大化利用有效空间以扩大芯片的尺寸，达到产品性能的最优化，使封装产品可靠性提高，次品率大大降低，提高工作效率的同时，大大节约了生产成本。(ESM)同样的 发明 创造已同日 申请 发明 专利，下面是一种大尺寸芯片的分层隔离封装结构专利的具体信息内容。
1.一种大尺寸芯片的分层隔离封装结构，其特征在于，包括芯片（10）、金属凸块（20）、第三塑封体（40c）、导电金属（41a）、第一铜垫（50a）、第二铜垫（50b）、导电铜柱（60a、60b）、外引脚（70a、70b）和重布线层（RDL），所述芯片（10）、金属凸块（20）、导电金属（41a）、第一铜垫（50a）、第二铜垫（50b）、导电铜柱（60a、60b）和重布线层（RDL）均设与所述第三塑封体（40c）的内部，所述外引脚（70a、70b）设于所述第三塑封体（40c）的外部，所述金属凸块（20）与所述芯片（10）的正面电联接，所述第一铜垫（50a）与所述芯片（10）的背面电联接，且第一铜垫（50a）覆盖整个芯片（10）的背面，所述金属凸块（20）与所述重布线层（RDL）的一端连接，重布线层（RDL）另一端通过导电金属（41a）与所述第二铜垫（50b）连接，所述导电铜柱（60a、60b）分别与所述第一铜垫（50a）、第二铜垫（50b）电连接，所述外引脚（70a、70b）分别与导电铜柱（60a、60b）电联接。
2.根据权利要求1所述的一种大尺寸芯片的分层隔离封装结构，其特征在于，所述第一铜垫（50a）和第二铜垫（50b）之间相互不接触，且处于同一水平面上，并且厚度相同。
3.根据权利要求1所述的一种大尺寸芯片的分层隔离封装结构，其特征在于，所述重布线层（RDL）与所述第一铜垫（50a）相互平行，所述导电金属（41a）处于所述第二铜垫（50b）与重布线层（RDL）之间，且导电金属（41a）的两端分别与第二铜垫（50b）和重布线层（RDL）相互垂直连接。
4.根据权利要求1所述的一种大尺寸芯片的分层隔离封装结构，其特征在于，所述导电铜柱（60a、60b）上的分别与所述外引脚（70a、70b）连接的一面，均处于并裸露在所述第三塑封体（40c）上的远离芯片（10）正面的一侧的外表面上，并且分别与所述外引脚（70a、70b）连接，且外引脚（70a、70b）均紧贴在所述第三塑封体（40c）的外表面上，外引脚（70a、70b）分别将导电铜柱（60a、60b）裸露在第三塑封体（40c）外表面的部分全部覆盖。
5.根据权利要求1所述的一种大尺寸芯片的分层隔离封装结构，其特征在于，所述金属凸块（20）通过焊接、直接电镀或者化镀的方式与芯片（10）的正面连接固定。
6.根据权利要求1所述的一种大尺寸芯片的分层隔离封装结构，其特征在于，所述第一铜垫（50a）与所述芯片（10）的背面之间通过TiNiAg或者TiCu金属过渡层连接。
一种大尺寸芯片的分层隔离封装结构
技术领域
背景技术
[0003] 由于半导体组件、微电机组件（MEMS）或光电组件等电子组件具有微笑精细的电路及构造，因此，为避免粉尘、酸碱物质、湿气和氧气等污染或侵蚀电子组件，进而影响其可靠度及寿命，工艺上需要通过封装技术来提供上述电子组件的有关电能创术、信号传输、热量散失，以及保护与支持等功能。
[0004] 半导体封装是指将通过测试的晶圆按照产品型号及功能需求加工得到独立芯片的过程。封装过程为：来自晶圆前道工艺的晶圆通过划片工艺后被切割为小的晶片（Die），然后将切割好的晶片用胶水贴装到相应的基板（引线框架）架的小岛上，再利用超细的金属（金锡铜铝）导线或者导电性树脂将晶片的接合焊盘（Bond Pad）连接到基板的相应引脚（Lead）,并构成所要求的电路；然后再对独立的晶片用塑料外壳加以封装保护，塑封之后还要进行一系列操作，封装完成后进行成品测试，通常经过入检Incoming、测试Test和包装Packing等工序，最后入库出货。
[0005] 对于IC封装行业，需要在小的封装尺寸内封装更大的芯片以满足相应的大功率的性能需求。但由于传统封装中框架结构的限制，无法做到相同封装尺寸内放置较大的芯片；而且大芯片在封装过程中，由于芯片较大，垂直方向上，芯片上铜垫的已到达外引脚的位置与外引脚必然接触短路，给封装工艺带来很大的麻烦，而且次品率大大增加，要么需要增加其他辅助设施避免短路，但是会造成工艺流程繁琐，降低工作效率，提高了生产成本。
实用新型内容
实用新型内容
[0006] 本实用新型正是针对现有技术存在的不足，提供了一种大尺寸芯片的分层隔离封装结构。
[0007] 为解决上述问题，本实用新型所采取的技术方案如下：
[0008] 一种大尺寸芯片的分层隔离封装结构，包括芯片、金属凸块、第三塑封体、导电金属、第一铜垫、第二铜垫、导电铜柱、外引脚和重布线层，所述芯片、金属凸块、导电金属、第一铜垫、第二铜垫、导电铜柱和重布线层均设与所述第三塑封体的内部，所述外引脚设于所述第三塑封体的外部，所述金属凸块与所述芯片的正面电联接，所述第一铜垫与所述芯片的背面电联接，且第一铜垫覆盖整个芯片的背面，所述金属凸块与所述重布线层的一端连接，重布线层另一端通过导电金属与所述第二铜垫连接，所述导电铜柱分别与所述第一铜垫、第二铜垫电连接，所述外引脚分别与导电铜柱电联接。
[0009] 进一步的，所述第一铜垫和第二铜垫之间相互不接触，且处于同一水平面上，并且厚度相同。
[0010] 进一步的，所述重布线层与所述第一铜垫相互平行，所述导电金属处于所述第二铜垫与重布线层之间，且导电金属的两端分别与第二铜垫和重布线层相互垂直连接。
[0011] 进一步的，所述导电铜柱上的分别与所述外引脚连接的一面，均处于并裸露在所述第三塑封体上的远离芯片正面的一侧的外表面上，并且分别与所述外引脚连接，且外引脚均紧贴在所述第三塑封体的外表面上，外引脚分别将导电铜柱裸露在第三塑封体外表面的部分全部覆盖。
[0013] 进一步的，所述第一铜垫与所述芯片的背面之间通过TiNiAg或者TiCu金属过渡层连接。
[0014] 本实用新型与现有技术相比较，本实用新型的有益效果如下：
[0015] 本实用新型提供的一种大尺寸芯片的分层隔离封装结构，在生产过程中，将封装结构设计成芯片、金属凸块、第三塑封体、导电金属、第一铜垫、第二铜垫、导电铜柱、外引脚和重布线层的组合结构，将第一铜垫、第二铜垫分别和两个外引脚之间通过设置两个导电铜柱和第三塑封体隔离，能够有效避免大尺寸的芯片背面上的第一铜垫与外引脚接触造成短路的现象发生，特别是在生产过程中，突破了传统封装中框架结构的限制，做到相同封装尺寸内能够放置较大的芯片，采用设置导电铜柱和第三塑封体的隔离，不会出现短路现象发生，在有限的封装尺寸内，能够最大化利用有效空间以扩大芯片的尺寸，达到产品性能的最优化，使封装产品可靠性提高，次品率大大降低，提高工作效率的同时，大大节约了生产成本。附图说明
[0016] 图1为本实用新型一种大尺寸芯片的分层隔离封装结构的结构示意图；
[0017] 图2为本实用新型一种大尺寸芯片的分层隔离封装结构的制作工艺流程图；
[0018] 图3 图15为本实用新型一种大尺寸芯片的分层隔离封装结构的一实施方式的工~艺流程图。
具体实施方式
[0019] 下面将结合具体的实施方式来说明本实用新型的内容，所述实施方式的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的组件或具有相同或类似功能的组件。
[0020] 本实用新型所提到的方向用语，例如：上、下、左、右、前、后、内、外、正面、背面、侧面等，仅是参考附图的方向，以下通过参考附图描述的实施方式及使用的方向用语是示例性的，仅用于解释本实用新型，而不能理解为对本实用新型的限制。此外，本实用新型提供的各种特定的工艺和材料的例子，都是本领域普通技术人员可以意识到其他工艺的应用和/或其他材料的使用。
[0021] 请参阅图1，图1为本实用新型一种大尺寸芯片的分层隔离封装结构的结构示意图。
[0022] 一种大尺寸芯片的分层隔离封装结构，包括芯片10、金属凸块20、第三塑封体40c、导电金属41a、第一铜垫50a、第二铜垫50b、导电铜柱60a、60b、外引脚70a、70b和重布线层RDL，所述芯片10、金属凸块20、导电金属41a、第一铜垫50a、第二铜垫50b、导电铜柱60a、60b和重布线层RDL均设与所述第三塑封体40c的内部，所述外引脚70a、70b设于所述第三塑封体40c的外部，所述金属凸块20与所述芯片10的正面电联接，所述第一铜垫50a与所述芯片10的背面电联接，且第一铜垫50a覆盖整个芯片10的背面，所述金属凸块20与所述重布线层RDL的一端连接，重布线层RDL另一端通过导电金属41a与所述第二铜垫50b连接，所述导电铜柱60a、60b分别与所述第一铜垫50a、第二铜垫50b电连接，所述外引脚70a、70b分别与导电铜柱60a、60b电联接。
[0023] 所述第一铜垫50a和第二铜垫50b之间相互不接触，且处于同一水平面上，并且厚度相同。所述重布线层RDL与所述第一铜垫50a相互平行，所述导电金属41a处于所述第二铜垫50b与重布线层RDL之间，且导电金属41a的两端分别与第二铜垫50b和重布线层RDL相互垂直连接。
[0024] 所述导电铜柱60a、60b上的分别与所述外引脚70a、70b连接的一面，均处于并裸露在所述第三塑封体40c上的远离芯片10正面的一侧的外表面上，并且分别与所述外引脚70a、70b连接，且外引脚70a、70b均紧贴在所述第三塑封体40c的外表面上，外引脚70a、70b分别将导电铜柱60a、60b裸露在第三塑封体40c外表面的部分全部覆盖。
[0025] 所述金属凸块20通过焊接、直接电镀或者化镀的方式与芯片10的正面连接固定。
[0026] 所述第一铜垫50a与所述芯片10的背面之间通过TiNiAg或者TiCu金属过渡层（图中未示出）连接。
[0027] 请参阅图2，图2为本实用新型一种大尺寸芯片的分层隔离封装结构的制作工艺流程图。所述一种大尺寸芯片的分层隔离封装结构的工艺包括如下步骤：
[0028] S1：将金属凸块安装到待处理芯片上，芯片贴装到载体上；S2：第一次包封；S3：进行剥离工艺；S4：第一铜垫、第二铜垫安装；S5：导电铜柱安装；S6：第二次包封；S7：第一次削减；S8：设置过孔；S9：过孔内填充导电金属；S10：安装重布线层；S11：第三次包封；S12：第二次削减；S13：安装外引脚。以下结合附图及实施方式对上述步骤进行详细说明。
[0029] 请一并参阅图3 图15，其中图3 图15为本实用新型一种大尺寸芯片的分层隔离~ ~封装结构的一实施方式的工艺流程图。
[0030] 关于步骤S1：将金属凸块安装到待处理芯片上，芯片贴装到载体上。
[0031] 请一并参阅图3和图4，其中图3为本实施方式中金属凸块与芯片的结构示意图，图4为本实施方式中金属凸块、芯片与载体的结构示意图。
[0032] 提供一待处理芯片10，在所述芯片10的正面上（图3中芯片的上端面）设有金属凸块20，金属凸块20与芯片10电联接，金属凸块20与芯片10之间可通过焊接、直接电镀或者化镀的方式连接固定。将所述芯片10的背面（图4中芯片的下端面）贴装在载体30上，所述载体30为框架或者基板，框架或者基板包括传统使用的框架、金属板、合金板、BT材料、FR-4材料、硅基材料、EMC材料或薄膜材料中的一种或多种材料的组合，但本实用新型对此不作限定，所述芯片10与载体30之间通过胶水、可溶物或者可熔物进行黏结，如水凝胶、热解胶或光解胶等，便于后期芯片10与载体30之间的剥离，载体30的面积大于芯片10的面积，便于后续的包封工艺，在实际生产过程中，提供的待处理芯片10能够替换成已完成金属凸块20工艺步骤的芯片10与金属凸块20的结合体，如此，减少工艺流程步骤，提高工作效率。
[0033] 其中，水凝胶（Hydrogel）是一类极为亲水的三维网络结构凝胶，它在水中迅速溶胀并在此溶胀状态可以保持大量体积的水而不溶解，由于存在交联网络，水凝胶可以溶胀和保有大量的水，水的吸收量与交联度密切相关。交联度越高，吸水量越低。这一特性很像一种软组织。水凝胶中的水含量可以低到百分之几，也可以高达99%。凝胶的聚集态既非完全的固体也非完全的液体。固体的行为是一定条件下可维持一定的形状与体积，液体行为是溶质可以从水凝胶中扩散或渗透。水凝胶可以通过置于水中进行加热的方式进行去除。
[0035] 光解胶具有一定的粘合力，可以起到定位、支撑的作用，经光照后，会发生光分解反应变为水溶性，能实现简单剥离。
[0036] 关于步骤S2：第一次包封。
[0037] 请参阅图5，并结合图4，图5为本实施方式中第一次包封结构示意图。
[0038] 对芯片10和金属凸块20进行包封，形成第一塑封体40a，塑封体的材料为本领域普通技术人员所熟知的任何塑封材料，如树脂材料，所述第一塑封体40a承载在所述载体30上，且芯片10和金属凸块20全部处于所述第一塑封体40a内，并与外界大气隔绝。
[0039] 关于步骤S3：进行剥离工艺。
[0040] 请参阅图6，并结合图5，图6为本实施方式中第一次包封后对载体进行剥离的结构示意图。
[0041] 对所述载体30进行剥离，使载体30与第一塑封体40a之间分开，此时，原本芯片10与载体30贴合的一面裸露在外，即芯片10的整个背面裸露在第一塑封体40a的外面，对载体30进行的剥离工艺为同属技术领域人员所使用的常规手段，如化学方式剥离，或者物理方式剥离均可，在此不做详细解释。
[0042] 关于步骤S4：第一铜垫、第二铜垫的安装。
[0043] 请参阅图7，并结合图6，图7为本实施方式中第一铜垫和第二铜垫的安装结构示意图。
[0044] 在所述第一塑封体40a上的载体30剥离处的一侧外表面上设置第一铜垫50a和第二铜垫50b，所述第一铜垫50a和第二铜垫50b均与所述第一塑封体40a的外表面贴合，且第一铜垫50a和第二铜垫50b之间不接触，所述第一铜垫50a与所述芯片10的背面相互贴合并且电联接，所述第一铜垫50a覆盖整个芯片10的背面，如此，整个芯片10与外界大气隔绝。
[0045] 由于芯片10的背面通常是纯硅材料，与其他金属不能渗入连接，所以在安装第一铜垫50a时，在第一铜垫50a和芯片10之间设置Tinian或TiCu金属层，进行过度连接，提高连接性能和导电性，避免后期第一铜垫50a与芯片10之间相互脱离，造成封装结构损坏的现象发生，也大大降低次品率。
[0046] 第二铜垫50b黏结在第一塑封体40a的外表面，且第一铜垫50a和第二铜垫50b处于同一水平面上，并且它们的厚度相同，从而节省占用空间。
[0047] 关于步骤S5：导电铜柱安装。
[0048] 请参阅图8，并结合图7，图8为本实施方式中导电铜柱安装的结构示意图。
[0049] 在所述第一铜垫50a和第二铜垫50b上的远离第一塑封体40a的一侧分别设置导电铜柱60a、60b，所述导电铜柱60a、60b分别与第一铜垫50a和第二铜垫50b固定连接，所述两个导电铜柱60a、60b处于同一水平面上，且厚度相同，节省占用空间。
[0050] 关于步骤S6：第二次包封。
[0051] 请参阅图9，并结合图8，图9为本实施方式中第二次包封的结构示意图。
[0052] 对第一铜垫50a、第二铜垫50b和导电铜柱60a、60b进行包封，请参阅图 9中虚线a以下部分，包封后，联合所述第一塑封体40a形成第二塑封体40b，所述第二塑封体40b包括第一塑封体40a，且与第一塑封体40a形成一体，所述第一铜垫50a、第二铜垫50b和导电铜柱60a、60b均处于所述第二塑封体40b内。
[0053] 由于第二塑封体40b包括第一塑封体40a，且与第一塑封体40a形成一体，从而，原来处于第一塑封体40a内的所有部件也自然地全部处于第二塑封体40b内，所以在附图9之后的附图中，将不再显示第一塑封体40a的标识。
[0054] 关于步骤S7：第一次削减。
[0055] 请参阅图10，并结合图9，图10为本实施方式中第一次削减后的封装结构示意图。
[0056] 将第二塑封体40b上的靠近金属凸块20的一面采用研磨、蚀刻或激光处理等方式进行削减，直至金属凸块20裸露至第二塑封体40b的外表面为止，为后续工艺的顺利进行提供保障，如图9和图10中虚线b以上部分。
[0057] 关于步骤S8：设置过孔。
[0058] 请参阅图11，并结合图10，图11为在第二塑封体上设置过孔的结构示意图。
[0059] 在第二塑封体40b上，沿着竖直方向，从第二塑封体40b上的靠近金属凸块20的外表面处向着第二铜垫50b的上端面进行激光或机械钻孔，形成过孔41，第二铜垫50b的上端面暴露在过孔41内，与外界大气接触，过孔41的中轴线与第二铜垫50b所处的平面垂直，所述过孔41的形状为沉孔，四周均具有第二塑封体40b围绕所形成的内壁，为后期电镀填孔时，避免电镀液外流的现象发生。
[0060] 关于步骤S9：过孔内填充导电金属，和关于步骤S10：安装重布线层。
[0061] 关于步骤S9和S10，可在过孔内填充导电金属之后，安装重布线层，也可以在安装重布线层的同时，在过孔内填充导电金属，即重布线层与导电金属同时电镀生成。
[0062] 根据实际生产过程的需要进行步骤的调整，本实施方式采用前者进行描述。
[0063] 请参阅图12，并结合图11，图12为本实施方式中过孔填充及重布线层安装的结构示意图。
[0064] 在过孔41内通过电镀的方式设置导电金属41a，导电金属41a一端连接所述第二铜垫50b的顶端端面，另一端延伸至所述第二塑封体40b上的靠近金属凸块20一面的外表面处，在实际操作过程中，电镀时，可将过孔41内填满所述导电金属41a，也可不用填满。然后在所述第二塑封体40b上的靠近金属凸块20的外表面处设置一层重布线层RDL，所述重布线层RDL的两端分别连接所述金属凸块20和导电金属41a，连接后，使导电铜柱60a、第一铜垫50a、芯片10、金属凸块20、重布线层RDL、导电金属41a、第二铜垫50b和导电铜柱60b形成一个串联的导通电路结构。
[0065] 关于步骤S11：第三次包封。
[0066] 请参阅图13，并结合图12，图13为本实施方式中第三次包封的结构示意图。
[0067] 对重布线层RDL进行包封，请参阅图13中虚线c以上部分，包封后，联合第二塑封体40b形成第三塑封体40c，所述第三塑封体40c包括第二塑封体40b，且与第二塑封体40b形成一体，所述重布线层RDL处于所述第三塑封体40c内。
[0068] 由于第三塑封体40c包括第二塑封体40b，且与第二塑封体40b形成一体，从而，原来处于第二塑封体40b内的所有部件也自然地全部处于第三塑封体40c内，所以在附图13之后的附图中，将不再显示第二塑封体40b的标识。
[0069] 关于步骤S12：第二次削减。
[0070] 请参阅图14，并结合图13，图14为本实施方式中的第二次削减后的封装结构示意图。
[0071] 将所述第三塑封体40c上的靠近导电铜柱60a、60b的一面采用研磨、蚀刻或者激光切割等方式进行削减，直至导电铜柱60a、60b裸露至表面为止，为后续工艺的顺利进行提供保障，请参阅图13和图14中虚线d以下部分。
[0072] 关于步骤S13：安装外引脚。
[0073] 请参阅图15，并结合图14，图15为本实施方式中外引脚的安装结构示意图。
[0074] 在第三塑封体40c上的靠近导电铜柱60a、60b的外表面分别设置与导电铜柱60a、60b分别对应连接的外引脚70a、70b，所述外引脚70a、70b处于第三塑封体40c的外表面。
[0075] 上述所有步骤中所涉及到的重布线层RDL、第一铜垫50a、第二铜垫50b、导电铜柱60a、60b和外引脚70a、70b均通过光刻和电镀形成。
[0076] 如图15所示，在传统封装工艺中，大尺寸芯片封装时，第一铜垫50a上的端头e处很容易与外引脚70a的f处接触，导致短路现象发生，通过本实用新型所提供的工艺流程，并通过设置导电铜柱60a、60b和第三塑封体40c的隔离，能够有效避免e处和f处的接触短路现象发生，而且适用于任何大尺寸芯片的封装，确保不会短路，使有限的封装体空间放置更大的芯片，使空间利用率最大化，以扩大芯片尺寸，使产品性能最优化，提高封装产品的可靠性。
[0077] 本实用新型与现有技术相比较，本实用新型的有益效果如下：
[0078] 本实用新型提供的一种大尺寸芯片的分层隔离封装结构，在生产过程中，将封装结构设计成芯片、金属凸块、第三塑封体、导电金属、第一铜垫、第二铜垫、导电铜柱、外引脚和重布线层的组合结构，将第一铜垫、第二铜垫分别和两个外引脚之间通过设置两个导电铜柱和第三塑封体隔离，能够有效避免大尺寸的芯片背面上的第一铜垫与外引脚接触造成短路的现象发生，特别是在生产过程中，突破了传统封装中框架结构的限制，做到相同封装尺寸内能够放置较大的芯片，采用设置导电铜柱和第三塑封体的隔离，不会出现短路现象发生，在有限的封装尺寸内，能够最大化利用有效空间以扩大芯片的尺寸，达到产品性能的最优化，使封装产品可靠性提高，次品率大大降低，提高工作效率的同时，大大节约了生产成本。
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