| 序号 | 专利名 | 申请号 | 申请日 | 公开（公告）号 | 公开（公告）日 | 发明人 |
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| 261 | Efficient address generation of prunes interleaver and prune de-interleaver | JP2010539758 | 2008-12-17 | JP2011508530A | 2011-03-10 | マンサワー、モハマッド |
| プルーンインタリーバおよびプルーンデインタリーバのアドレスを効率的に生成する技法を説明する。 一態様では、線形アドレスに対応する無効なマッピングの総数を決定することによって、線形アドレスを、プルーンインタリーバのインタリーブされたアドレスにマッピングすることができる。 中間アドレスを入手するために、線形アドレスと無効なマッピングの総数との合計をとることができる。 次に、プルーンインタリーバのインタリーブされたアドレスを、中間アドレスの非プルーンインタリーバ関数に基づいて決定することができる。 プルーンインタリーバは、プルーンビット逆転インタリーバ、ビット逆転関数および線形合同シーケンス関数からなるプルーンターボインタリーバ、またはある他のタイプのインタリーバとすることができる。 無効なマッピングの総数を、反復的に決定することができ、各反復を、異なるタイプのプルーンインタリーバについて異なる形で実行することができる。 | ||||||
| 262 | Systems and methods for phase dependent data detection in iterative decoding | JP2010001623 | 2010-01-07 | JP2011034659A | 2011-02-17 | YANG SHAOHUA; LI ZONGWANG; TAN WEIJUN; FITZPATRICK KELLY |
| PROBLEM TO BE SOLVED: To provide systems and methods for data processing. SOLUTION: A data processing circuit includes a first data detection circuit that applies a phase dependent data detection algorithm to a data set such that a first output of the first data detection circuit varies depending on a phase of the data set presented to the first data detection circuit. A first phase of the data set is presented to the first data detection circuit. The circuit further includes a decoder circuit that applies a decoding algorithm to the first output to yield a decoded output, and a phase shift circuit that phase-shifts the decoded output such that a second phase of the data set is provided as a phase shifted output. A second detection circuit applies a phase dependent data detection algorithm to the phase shifted output such that a second output of the second data detection circuit varies from the first output at least in part due to a different phase of the data set presented to the second data detection circuit. COPYRIGHT: (C)2011,JPO&INPIT | ||||||
| 263 | Error correction method for Reed-Solomon Product Code | JP2006518081 | 2004-07-01 | JP4624348B2 | 2011-02-02 | ルベーグ サヴィエ; ミュラー シュテファン; カブツ マーテン |
| 264 | Transmission configuration in a mobile communication system method | JP2007097882 | 2007-04-03 | JP4615541B2 | 2011-01-19 | 寧 佑 尹; 永 朝 李; 純 逸 権; 沂 濬 金 |
| 265 | Method and apparatus for generating a plurality of cyclic redundancy check (crc) | JP2010525747 | 2008-09-12 | JP2010539840A | 2010-12-16 | ファルーク カーン; ジアンフォン チャン; ホウユ ピ |
| 巡回冗長検査（ＣＲＣ）を生成する方法及び装置を開示する。 本発明の一態様において、複数の巡回冗長検査は、選択された巡回冗長検査生成多項式を用いて複数のビットに基づいて計算され、少なくとも１つの巡回冗長検査は、一定のビット順序を有する上記複数のビットの第１のサブセットに基づいて計算され、少なくとも他の巡回冗長検査は、異なるビット順序を有する上記複数のビットの第２のサブセットに基づいて計算される。 上記複数のビットの第２のサブセットは、上記複数のビットの第１のサブセットとオーバーラップされてもよい。
【選択図】 図１ |
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| 266 | Delivery of dynamic stream interleaving and sub-stream-based | JP2010504224 | 2008-04-16 | JP2010535435A | 2010-11-18 | クリシュ、ジョルダン・ジェイ．; パクザド、パヤム; ビシサノ、ロレンゾ; ルビー、マイケル; ワトソン、マーク |
| A communications system can provide methods of dynamically interleaving streams, including methods for dynamically introducing greater amounts of interleaving as a stream is transmitted independently of any source block structure to spread out losses or errors in the channel over a much larger period of time within the original stream than if interleaving were not introduced, provide superior protection against packet loss or packet corruption when used with FEC coding, provide superior protection against network jitter, and allow content zapping time and the content transition time to be reduced to a minimum and minimal content transition times. Streams may be partitioned into sub-streams, delivering the sub-streams to receivers along different paths through a network and receiving concurrently different sub-streams at a receiver sent from potentially different servers. When used in conjunction with FEC encoding, the methods include delivering portions of an encoding of each source block from potentially different servers. | ||||||
| 267 | Receiving apparatus and method, program, and receiving system | JP2009072161 | 2009-03-24 | JP2010226474A | 2010-10-07 | YOKOGAWA MINESHI; SHINTANI OSAMU |
| PROBLEM TO BE SOLVED: To decode PLP and L1 by one LDPC decoder in a DVB-T.2 receiver. SOLUTION: In a receiving apparatus, a timing chart is indicated in symbol units for each of an input signal Sa of a demodulator, an output signal Sb of the demodulator, an output signal Sc of a frequency deinterleaver, and an output signal Sd (a target of LDPC decoding) of an LDPC decoder. Among the output signals Sc of the frequency deinterleaver, PLP (data) is supplied to a time deinterleaver, while L1 (included in a P2 symbol) is supplied to the LDPC decoder. As a result, a decoding target of the LDPC decoder becomes the signal Sd as shown in Fig.2. That is, when data symbols are accumulated in the time deinterleaver, LDPC decoding for an LDPC code of the corresponding PLP (data) is started. In addition, when L1 is output from the frequency deinterleaver, LDPC decoding for the L1 is interrupted. The receiving apparatus can be applied to the receiving apparatus of DVB-T.2. COPYRIGHT: (C)2011,JPO&INPIT | ||||||
| 268 | Method and apparatus for channel interleaving in Ofdm system | JP2010511127 | 2008-06-09 | JP2010529772A | 2010-08-26 | ジアン−アン・ツァイ; ツォウイェ・ピ; ファルーク・カン |
| 本発明は、無線通信システムにおけるチャンネルインタリービングのための方法及び装置を提供する。 本発明の一態様では、データリソース要素は多重符号ブロックに割り当てられ、それぞれの符号ブロックに割り当てられたデータリソース要素の数は実質的に同一である。 本発明の他の態様では、ＴＤＭファースト接近及びＦＤＭファースト接近が提案される。 ＴＤＭファースト接近において、複数の符号ブロックのうち少なくとも一つは複数の連続データ伝送ＯＦＤＭシンボルを用いて割り当てられる。 ＦＤＭファースト接近において、複数の符号ブロックのうち少なくとも一つはすべてのデータ伝送ＯＦＤＭシンボルを用いて割り当てられる。 ＴＤＭファースト接近及ＦＤＭファースト接近のいずれか一つは、符号ブロックの数、又は伝送ブロックサイズ、あるいはデータレートによって選択される。 | ||||||
| 269 | Digital broadcasting system and method thereof | JP2009272143 | 2009-11-30 | JP2010051022A | 2010-03-04 | YU JUNG-PIL; PARK EUI-JUN; KWON YONG-SIK; CHANG YONG-DEOK; JEONG HAE-JOO; KIM JOON-SOO; JEONG JIN-HEE; JI KUM-RAN; KIM JONG-HUN |
| <P>PROBLEM TO BE SOLVED: To enhance reception performance of an ATSC VSB system being a terrestrial DTV system for the United States. <P>SOLUTION: A digital broadcasting transmitter includes: a processor for robustly processing a stream to be transmitted against an error; and a trellis-parity corrector trellis-encoding the processed stream, resetting at least one internal memory to be used for trellis encoding at a prescribed time point, and correcting a parity changed by resetting. The processor includes the first converter inputting and converting the byte unit stream; an outer encoder encoding the converted stream and outputting the symbol unit stream; an outer interleaver for interleaving the stream to be output from the outer encoder; and the second converter converting the interleaved symbol unit stream into the byte unit stream. <P>COPYRIGHT: (C)2010,JPO&INPIT | ||||||
| 270 | Transmitter implementing the method and said method for transmitting a stream of data in a wireless system having at least two antennas | JP2009531816 | 2007-10-08 | JP2010506524A | 2010-02-25 | アルノー ゲゲン |
| 本発明は少なくとも２つのアンテナを有する送信機においてデータのストリームを送信する方法、およびこの方法を実装した送信機に関する。
上記方法は、 −データエレメントのストリームをｋビットの第１の語に分割し、 −多値符号で第１の語を符号化し（１）、第１の語は多値符号のシンボルであり、時空間符号語毎にビット数を分割している符号シンボルのビットの中でサイズ（ｋ）であり、 −シンボル単位インターリーブ器によって符号化されたシンボルをインターリーブし（２）、 −ｌｏｇ ２ （Ｍ）ビットのグループ中に得られたインターリーブされたシンボルを分割し、 −Ｍ個の点の信号空間を用いて、複素シンボル上にｌｏｇ ２ （Ｍ）ビットのグループをマッピングし（３）、その後、 −時空間符号を用いて複素シンボルを符号化し（４）、時空間符号語を得るステップを含む。 【選択図】図１ |
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| 271 | System and method for effectively transferring electronic information | JP2009137205 | 2009-06-08 | JP2009296599A | 2009-12-17 | CARPIO FREDRIK; GEORGIS NIKOLAOS; FRAZIER MILTON |
| PROBLEM TO BE SOLVED: To effectively transfer electronic information while coping with a large increase in a request of a system resource, and a data amount. SOLUTION: A system for effectively transferring the electronic information includes a transmitter with an encoder that performs a parity encoding procedure. The encoder creates parity blocks for embedding in transmission packets. The parity blocks may be based upon data segments from one or more of the transmission packets. The system also includes a receiver with a decoder that utilizes the parity blocks for performing a packet validation procedure to identify corrupted packets from among the transmission packets. The decoder also performs a packet reconstruction procedure with selected ones of the data segments and the parity blocks to produce reconstructed data segments for the corrupted packets. COPYRIGHT: (C)2010,JPO&INPIT | ||||||
| 272 | Decoding device, decoding method, and recording and reproducing device | JP2008148473 | 2008-06-05 | JP2009295237A | 2009-12-17 | KANEOKA TOSHITOMO |
| PROBLEM TO BE SOLVED: To achieve high correcting capability without causing an incorrect sector even by using an interleaving method. SOLUTION: An event error correcting unit acquires an error-corrected portion in a decoded data string by comparing a decoded data string (refer to (a)) with a decoded data string (refer to (b)) after error correction. The event error correcting unit carries out bit-flipping (refer to (d)) of the data within a merge section (continuous events) in the decoded data string when the error-corrected portion in the acquired and decoded data string is in an event information string (c). COPYRIGHT: (C)2010,JPO&INPIT | ||||||
| 273 | Systems and methods for queue based data detection and decoding | JP2009107302 | 2009-04-27 | JP2009273123A | 2009-11-19 | YANG SHAOHUA; ZHONG HAO; TAN WEIJUN; RAUSCHMAYER RICHARD; XING YUAN LEE |
| <P>PROBLEM TO BE SOLVED: To provide systems and methods for data processing. <P>SOLUTION: A variable iteration data processing system, for example, is disclosed which includes at least a first detector, a second detector, a decoder, and a queuing buffer. The first detector is operable to perform one data detection on an input data set at a first time. The decoder receives a derivation of an output from the first detector and performs a decoding process. When the decoding process fails to converge, the decoder output is passed to the second detector for a subsequent detection and decoding process at the second time. <P>COPYRIGHT: (C)2010,JPO&INPIT | ||||||
| 274 | Replaying unit for digital media | JP2009127978 | 2009-05-27 | JP2009224020A | 2009-10-01 | BRENNAN MARTIN JOHN |
| <P>PROBLEM TO BE SOLVED: To provide a reading unit for reading data from a digital data carrier. <P>SOLUTION: A deinterleaving unit fills a first buffer area with a stream of input data, fills a second buffer area with a stream of input data, designates the first buffer area as an odd-numbered buffer area, designates the second buffer area as an even-numbered buffer area, designates a third buffer area as an input buffer area, processes a stream of data by filling an input buffer while generating an output data stream by alternately extracting data from the odd-numbered buffer area and the even-numbered buffer area to generate output data, and thereafter, redesignates the second buffer area as an odd-numbered buffer area, redesignates the third buffer area as an even-numbered buffer area, redesignates the first buffer area as an input buffer area, and repeats data processing using the redesignated buffer areas. <P>COPYRIGHT: (C)2010,JPO&INPIT | ||||||
| 275 | Digital broadcasting system and method | JP2008536518 | 2006-10-23 | JP2009524945A | 2009-07-02 | キム，ジュン−スー; キム，ジョン−フン; クォン，ヨン−シク; ジ，クム−ラン; ジョン，ジン−ヒ; ジョン，ヘ−ジュー; チャン，ヨン−ドク; パク，ウィ−ジュン; ユー，ジョン−ピル |
| 米国向けの地上波ＤＴＶシステムであるＡＴＳＣ ＶＳＢ方式の受信性能を向上することができるデジタル放送システム及びその方法を提供する。
デジタル放送システムが開示される。 本システムは、ノーマルストリーム及びターボストリームを多重化してデュアル伝送ストリームを生成する伝送ストリーム生成装置と、デュアル伝送ストリーム内に付加基準信号を挿入し、ターボストリームに対する信号処理を行ってデュアル伝送ストリームを再構成した後、再構成されたデュアル伝送ストリームを出力する送信装置、及び再構成されたデュアル伝送ストリームを受信し、ターボストリームを別にターボデコーディング処理してからデュアル伝送ストリームに再挿入し、ターボストリームが再挿入されたデュアル伝送ストリームをデコーディング処理してノーマルストリームデータ及びターボストリームデータを復元する受信装置とを含む。 |
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| 276 | Error correction method for Reed-Solomon Product Code | JP2006518081 | 2004-07-01 | JP2009514126A | 2009-04-02 | ルベーグ サヴィエ; ミュラー シュテファン; カブツ マーテン |
| 本発明はリードソロモンプロダクトコードの軟判定復号化に関する。 本発明によれば、符号化されたデータストリームのエラー訂正のための方法において、この方法は以下のステップを含む、すなわち、入力側バッファ２において復調されたデータストリームをセーブし、入力側バッファ２において第１の訂正プロセスをオンザフライで実施し、訂正の後で外部ＤＲＡＭ３にデータを転送し、エンベデッドＳＲＡＭ１１に外部ＤＲＡＭ３からデータをコピーし、エンベデッドＳＲＡＭ１１においてマルチパス訂正をスタートし、マルチパス訂正の後でエンベデッドＳＲＡＭ１１から外部ＤＲＡＭ３へ訂正されたデータをコピーバックするステップを含む。 | ||||||
| 277 | Receiver and receiving method | JP2007039391 | 2007-02-20 | JP2008205801A | 2008-09-04 | MUKAI HIROTO; MURAKAMI YUTAKA; KOBAYASHI SEIHO; YOMO HIDEKUNI; KUNIEDA MASANORI |
| <P>PROBLEM TO BE SOLVED: To provide a receiver for shortening processing delay of a parallel interference canceler. <P>SOLUTION: The receiver 2 includes: a plurality of receiving antennas 104A and 104B for receiving a data sequence; an address generating part 632 for converting a writing or reading order of channel estimated values according to a predefined rearrangement rule; a channel estimation storing part 634 for writing a channel estimated value in an exchanged order; an address generating part 638 for converting a writing or reading order of data sequences according to the rearrangement rule; a signal storing part 639 for writing or reading data sequences in the converted order; a replica generating part 636 for remodulating the data sequences to generate a replica signal on the basis of the channel estimated value; a canceling part 642 for extracting the channel estimated values and the data sequences in turn and using the channel estimated values, the data sequences and the replica signal to generate a stream signal obtained by canceling an interference signal of the data sequences; and an error correction decoding part 650 for performing error correction decoding on the basis of the stream signal. <P>COPYRIGHT: (C)2008,JPO&INPIT | ||||||
| 278 | Turbo decoding device | JP2003164120 | 2003-06-09 | JP4131680B2 | 2008-08-13 | 祐治 桑原 |
| 279 | Pseudo product code decoding apparatus and method | JP3473299 | 1999-02-12 | JP4126795B2 | 2008-07-30 | 耕平 山本; 雅之 服部 |
| A pseudo product code decoding apparatus has the following units: a first error correction code decoding unit for effecting error correction by using parity symbols of a first linear-structure error correction code contained in an input symbol train that constitutes a pseudo product code codeword; a second error correction code decoding unit for effecting error correction by using parity symbols of a second linear-structure error correction code; a second-series information symbol extracting unit for extracting second-series information symbols; a subtraction code generating unit for generating a subtraction code of a pseudo product code codeword formed of the second-series information symbols, with the first-series information symbol portion and the second linear-structure error correction code portion being changed to zero codes; a transforming unit for transforming the pseudo product code codeword into a product code codeword through execution of subtracting processing with the subtraction code; an error correction code repetitive decoding unit for effecting decoding processings a plurality of times, thereby effecting error correction; and a first-series information symbol extracting unit for extracting the first-series information symbols. |
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| 280 | Equalization method and apparatus | JP2002119003 | 2002-04-22 | JP4108359B2 | 2008-06-25 | ピドウェルベスキー アレックス; エム ロマン デニス; ジェー ビーケン マーク; アール シャイブリ リチャード |
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