| 序号 | 专利名 | 申请号 | 申请日 | 公开（公告）号 | 公开（公告）日 | 发明人 |
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| 81 | 一种晶振控制装置 | CN202210140696.2 | 2022-02-16 | CN116647229A | 2023-08-25 | 戴山彪; 朱磊 |
| 本申请公开了一种晶振控制装置，包括：差分放大器，第一输入端的输入电压为基准电压，第二输入端与晶振的第一端连接，差分放大器的输出端与晶振的第二端连接；自偏置控制模组的输入端与晶振的输出端连接；自偏置控制模组的输出端与差分放大器的偏置端连接；在晶振处于起振状态时，差分放大器的输出端的电压幅度由第一电压值增加到第二电压值，自偏置控制模组提供的偏置电流由第一电流值降低到第二电流值，差分放大器的增益大于预设增益；在晶振处于共振状态时，差分放大器的输出端的电压幅度保持在第二电压值，偏置电流保持在第二电流值，差分放大器的增益降低至所述预设增益值。本方案实现了晶振快速起振且降低了工作时的功耗。 | ||||||
| 82 | 晶体振荡器和用于晶体振荡器的启动方法 | CN202210150718.3 | 2022-02-14 | CN116633346A | 2023-08-22 | A·卡萨格兰德; J-L·阿伦德 |
| 本公开涉及一种晶体振荡器和用于启动晶体振荡器的操作的启动方法，晶体振荡器包括：振荡器结构，包括晶体谐振器和连接到晶体谐振器的电子振荡器电路，振荡器结构具有第一端子和第二端子，启动控制器，其能够操作为通过用可从时钟信号获取的激励信号序列激励振荡器结构来开始振荡器结构中的振荡，当由定时信号触发时，激励信号序列至少包括第一激励信号和第二激励信号，比较器，包括第一和第二输入端子以及输出端子，第一输入端子连接到第一端子第二输入端子连接到第二端子，比较器能够操作为提供比较信号，还包括数字存储器；以及相移单元，其操作为基于比较信号并且基于由数字存储器提供的数字数据来生成或修改定时信号。 | ||||||
| 83 | 晶体振荡电路及其起振方法 | CN202210097581.X | 2022-01-26 | CN116545385A | 2023-08-04 | 胡家杰 |
| 本发明提供了一种晶体振荡电路，连接外部晶体振荡器模块，其包括环形振荡器、频率校准模块、使能控制模块、滤波隔直模块以及晶体振荡器驱动电路模块；环形振荡器用于产生输出频率信号；频率校准模块用于产生振荡频率控制信号，使得环形振荡器产生的输出频率信号校准至预设的目标频率，并将校准至目标频率时对应的振荡频率控制信号进行锁存；使能控制模块用于控制环形振荡器启动或关闭；晶体振荡器驱动电路模块用于向晶体振荡器提供偏置电流。本发明还提供一种晶体振荡电路起振方法。采用本发明的技术方案可减少电路工艺偏差和温度变化对注入时钟频率的影响，使晶体振荡器起振时间少且功耗低。 | ||||||
| 84 | 并串转换电路及并串转换时钟信号的生成方法 | CN202310100042.1 | 2023-02-09 | CN116137535A | 2023-05-19 | 苏鹏洲; 王晓阳; 何亚军 |
| 本申请提供一种并串转换电路及并串转换时钟信号的生成方法，属于数据传输技术领域，所述电路包括：并串转换子电路、并串转换时钟信号生成子电路和参考时钟生成子电路；参考时钟生成子电路用于生成参考时钟信号并分别向并串转换子电路和并串转换时钟信号生成子电路发送参考时钟信号，并串转换时钟信号生成子电路用于基于参考时钟信号生成并串转换时钟信号；并串转换子电路包括数据输入单元和与数据输入单元电连接的并串转换单元；数据输入单元用于基于参考时钟信号获取并行数据，并串转换单元用于基于并串转换时钟信号将并行数据转换为串行数据，能在避免并串转换误差的基础上降低并串转换电路的面积和功耗，提高并串转换电路的适用范围。 | ||||||
| 85 | 晶振驱动电路 | CN201911164284.7 | 2019-11-25 | CN111082802B | 2023-04-28 | 邵博闻 |
| 本发明公开了一种晶振驱动电路，包含：第一～第四PMOS，第一～第四NMOS，第一～第三电阻，第一及第二开关，电容；本发明所述的晶振驱动电路，通过两个开关及一电容组成开关电容，在晶振起振前开关电容不工作，不影响驱动电路的启动速度，而当晶振起振后，开关电容工作使第四PMOS关断，降低偏置电流为原始值，不增加偏置电流的功耗。 | ||||||
| 86 | 晶体起振电路、方法及芯片 | CN202111189081.0 | 2021-10-12 | CN115967396A | 2023-04-14 | 黄洪杰 |
| 本公开涉及一种晶体起振电路、方法及芯片，该方法通过在接收到晶体起振信号的情况下，针对每个级别的驱动模块，通过调节测试电阻模块接入该驱动模块的阻值，确定该驱动模块对应的目标余量值，根据多个级别的该驱动模块的多个该目标余量值，从多个级别的驱动模块中确定该目标晶体的目标驱动模块；控制该目标驱动模块驱动该目标晶体，能够在一个晶体起振电路中设置多个级别的驱动模块，并通过该测试电阻模块测试每个驱动模块的驱动能力，然后从多个级别的驱动模块中确定驱动能力与该目标晶体匹配的目标驱动模块，从而能够针对不同的晶体匹配适应于该晶体的驱动模块，并在保证驱动能力满足晶体驱动需求的情况下，降低驱动功耗。 | ||||||
| 87 | 一种晶体振荡器的直流偏置电路及芯片 | CN202210110012.4 | 2022-01-28 | CN114448426B | 2022-11-29 | 田磊; 张卓; 吴晓闻 |
| 本发明提供一种晶体振荡器的直流偏置电路及芯片，包括：偏置电压模块，用于为所述放大管提供偏置电压；第一偏置电流模块，用于为所述放大管提供偏置电流；第二偏置电流模块，用于为所述偏置电压模块提供偏置电流；滤波模块，包括电流镜单元和第一电容，用于滤除所述直流偏置电路中的交流成分。本发明采用有源的直流偏置电路替换偏置电阻，有效减小了芯片的面积；同时设置有滤波模块，可有效滤除电路中的交流成分，降低了直流偏置电路对负阻的影响，确保在不同条件下，晶体振荡器均能可靠起振。 | ||||||
| 88 | 用于硅谐振压力传感器的自适应闭环反馈控制系统及方法 | CN202210637646.5 | 2022-06-08 | CN114726363B | 2022-11-01 | 胡宗达; 梁应剑; 张林; 张坤; 赵鑫; 李明兴 |
| 本发明提供了一种用于硅谐振压力传感器的自适应闭环反馈控制系统及方法，属于MEMS压力传感器技术领域。该系统包括V/F转换电路、与所述V/F转换电路连接的硅谐振压力芯体、与所述硅谐振压力芯体连接的C/V电路、分别与所述C/V电路连接的自适应反馈控制模块和微分器以及与所述微分器连接的AGC电路，所述AGC电路与所述自适应反馈控制模块连接。本发明通过自适应反馈控制，满足驱动端信号和检测端信号‑90°的相位差特性，保证其不受外界环境温度的影响，满足移相抗干扰的能力，保证硅谐振压力传感器始终工作在谐振状态，减小了因外界环境影响造成频率漂移或幅值波动带来的影响。 | ||||||
| 89 | 一种晶振启动稳定性的电路设计、测试及调整方法 | CN202210185926.7 | 2022-02-28 | CN114689964A | 2022-07-01 | 张文发; 罗坚; 刘九龙; 肖帅; 王泉观 |
| 本发明属于晶振稳定性测试技术领域，具体涉及一种晶振启动稳定性的电路设计、测试及调整方法，包括以下步骤：S1.搭建测试电路；S2.选定电路元器件及设备参数；S3.按测试电路操作步骤抓取启动波形；S4.判断波形幅度是否被识别；若未能识别，结束；S5.若波形幅度被识别，判断波形频率是否为工作频率；若为工作频率，结束；S6.若不是工作频率，选择合适的电路设计方案，结束。本发明提供的方法测试，不仅对于仪器设备要求较低，测试精度稳定可靠，同时提供多种有效方案，当晶振启动不稳定时，可以根据实际产品需求调整设计方案，获得有效的测试方案，从而达到提升产品质量的目的。 | ||||||
| 90 | 一种食品杀菌保鲜系统及方法 | CN201711017509.7 | 2017-10-26 | CN109699869B | 2022-06-07 | 聂永培 |
| 本发明公开了一种食品杀菌保鲜系统及方法，其中食品杀菌保鲜系统包括高压电源、脉冲发生器控制单元、第一电极和第二电极，高压电源的输出端与脉冲发生器控制单元相连，脉冲发生器的第一输出端与第一电极电连接，脉冲发生器的第二输出端与第二电极电连接，第一电极与第二电极之间形成电场；还包括与脉冲发生器控制单元电连接的智能移动终端；第一电极和第二电极为相互平行的平板电极。本发明利用高压脉冲电场实现食品的杀菌保鲜，实现了食品在加工、存储、运输过程中的全程保鲜，其能耗只有传统杀菌保鲜方法能耗的十分之一甚至更少，耗时极短，低碳环保，可以使用互联控制，操作方便，适用范围广，对食品品质和风味无影响。 | ||||||
| 91 | 晶体振荡器起振电路、功能模块以及电子设备 | CN202210107062.7 | 2022-01-28 | CN114499500A | 2022-05-13 | 林武 |
| 本发明实施例公开了一种晶体振荡器起振电路、功能模块以及电子设备。该晶体振荡器起振电路包括：振荡模块，振荡模块用于生成振荡信号；起振控制模块，振荡模块与起振控制模块连接；起振控制模块用于根据振荡信号调节振荡模块的反馈系数，以缩短振荡模块的起振时间。本方案通过调节振荡模块的反馈系数，缩短振荡模块的起振时间，从而使振荡模块更快的达到稳定振荡，可以更有效的避免振荡器不能启振的发生，进而降低了晶体振荡器的起振功耗。 | ||||||
| 92 | 一种超宽频段晶体驱动电路 | CN202111052787.2 | 2021-09-09 | CN113872591A | 2021-12-31 | 宋登明 |
| 本发明公开了一种超宽频段晶体驱动电路，涉及集成电路技术领域，尤其涉及一种晶体驱动电路。该超宽频段晶体驱动电路包括反馈电阻模块、起振电路模块和第一选择器；反馈电阻模块连接于起振电路模块，起振电路模块连接于第一选择器、外部晶体和外部负载端；第一选择器连接于起振电路模块；起振电路模块还包括低频起振子电路和中高频起振子电路；当需要启动外部晶体时，驱动电路根据所需频率连接对应晶体；发送控制信号至反馈电阻模块，以将反馈电阻模块的阻值配置到启动晶体所需的阻值；发送选择信号至起振电路模块，以接通起振电路模块；第一选择器根据选择信号将选择后的晶体振荡信号输出至后续电路。本发明的晶体驱动电路减小了芯片面积和成本。 | ||||||
| 93 | 用于晶体振荡器的周期性启动器 | CN201680036534.7 | 2016-06-21 | CN107787552B | 2021-09-03 | A·库马尔 |
| 本发明揭示一种具有接近振荡器中的晶体谐振频率的脉冲重复率的循环脉冲振荡器，其将更有效的起动能提供到晶体振荡器电路，且因此提供快很多的起动时间。起动脉冲振荡器运行若干循环或直到晶体振荡器振幅建立期望值。所述脉冲振荡器可具有从大约三分之一所述晶体谐振频率到大约一半所述晶体谐振频率的重复率，因此将更有效的起动能提供到所述晶体振荡器电路。 | ||||||
| 94 | 晶振驱动电路 | CN201710990918.9 | 2017-10-23 | CN107666314B | 2021-06-08 | 邵博闻 |
| 本发明公开了晶振驱动电路，包括：第一～第六MOS、第一～第二电阻和隔直耦合装置；第一～第三MOS的第一端连接电源电压，第四～第六MOS的第一端连接地；第一MOS第二端通过第一电阻连接第四MOS第二端，第二MOS的第二端连接第五MOS第二端，第三MOS第二端连接第六MOS第二端；第一～第三MOS的第三端互连并与第五MOS的第二端连接，第四MOS第三端连接隔直耦合装置第一端，第五MOS第三端连接在第四MOS第二端和第一电阻之间，第六MOS第三端连接隔直耦合装置第二端；隔直耦合装置第一端连接在第一MOS第二端和第一电阻之间，隔直耦合装置第二端通过第二电阻连接第三MOS第二端。本发明的晶振驱动电路相对现有技术振幅能够受控并且功耗更低。 | ||||||
| 95 | 控制晶体振荡器的电路和方法 | CN201911097726.0 | 2019-11-12 | CN111342839A | 2020-06-26 | A·阿米得 |
| 本发明题为“控制晶体振荡器的电路和方法”，本发明公开了一种晶体振荡器电路，该晶体振荡器电路可被控制以用于快速启动和高效操作。该控制包括调节施加到晶体管的体端子的电压，以便控制该晶体振荡器的放大。该放大可以在启动时相对于晶体振荡器的运动电阻而增加，以减少振荡所需的启动时间。该放大也可以减小，以便在启动后更高效地保持振荡。在一些实施方式中，用于控制的晶体管是全耗尽绝缘体上硅(FDSOI)晶体管，其适应宽范围的体偏置电压。 | ||||||
| 96 | 一种低相位噪声抗振型晶体振荡器 | CN201911199686.0 | 2019-11-29 | CN110958014A | 2020-04-03 | 田雨; 谭峰; 叶芃; 邱渡裕; 郭连平; 曾浩; 杨扩军; 蒋俊 |
| 本发明公开了一种低相位噪声抗振型晶体振荡器，采用基于模拟电路的闭环反馈补偿构架，其功分器将压控晶体振荡器的输出信号分为两路，其中一路输入相位～电压转换电路，根据压控晶体振荡器输出信号的相位转换为对应的电压信号，再经过电压比对电路与参考电压作差，产生补偿电压差信号，再经过加法电路与压控电压V0进行相加，得到补偿后的压控电压滤波器对压控电压Vc滤波后，并加载到压控晶体振荡器的压控端进行补偿，实现对输出信号相位的补偿。与现有有源补偿的抗振型晶体振荡器相比，直接将与振动实时相关的相位，转换为与之成一一对应映射关系的补偿电压进行补偿，该方法能够克服现有抗振型晶体振荡器中由于使用加速度感器引起的迟滞问题。 | ||||||
| 97 | 振荡电路和集成电路 | CN201910620232.X | 2019-07-10 | CN110336558A | 2019-10-15 | 张凡元; 许志玲; 许建超; 夏书香 |
| 一种振荡电路，该振荡电路通过一个自启动的基准电路在镜像电路的输入端形成偏置电流，镜像电路镜像偏置电流产生基准电流，将基准电流接入到振荡单元产生振荡信号并通过整形输出，可见本振荡电路结构简单，不需要启动电路，能耗低，且产生的基准电流与电源电压无关。 | ||||||
| 98 | 一种晶体振荡器快速起振方法 | CN201510707808.8 | 2015-10-23 | CN105871369B | 2019-04-09 | 郑卫国; 赵娜如 |
| 本发明公开了一种晶体振荡器快速起振方法，包括以下步骤：(1)石英晶体XTAL及其并联的负载电容C1构成晶体谐振回路；(2)差分放大器OTA和受控电流源g1以及晶体谐振电路组成的正反馈主振环路Loop1；(3)差分放大器OTA和受控电流源g2以及电容C2组成的电容补偿环路Loop2；(4)振荡过程中，补偿环路对主振环路产生等效负电容，用来减小或抵消主振环路中晶体两端的并联等效电容；(5)加大正反馈增益，不用担心受到晶体等效并联电容限制，加快电路起振。本电路和方法可以克服常规晶体振荡电路中正反馈增益增大到一定程度后无助于加快起振的障碍，通过补偿并减小晶体并联等效电容和芯片封装管脚寄生电容，能够有效加快晶体振荡器起振速度。 | ||||||
| 99 | 一种基于忆阻器的快速起振晶体振荡器 | CN201610255443.4 | 2016-04-22 | CN105959000B | 2019-02-15 | 刘洋; 高宝玲; 刘伟忠; 王俊杰 |
| 本发明公开了一种基于忆阻器的快速起振晶体振荡器，包括晶体谐振器、温补网络和振荡电路模块。其中振荡电路模块包括MOS或BJT等有源器件，电感、电阻、电阻等无源器件以及由m×n个忆阻器构成的忆阻器网络，利用忆阻器阻值连续可变的特性，通过调整忆阻器的阻值使振荡电路模块的等效负阻增加，从而有效减小晶体振荡器的起振时间，减小了晶振电路设计的难度。 | ||||||
| 100 | 晶振驱动电路 | CN201710990918.9 | 2017-10-23 | CN107666314A | 2018-02-06 | 邵博闻 |
| 本发明公开了晶振驱动电路，包括：第一～第六MOS、第一～第二电阻和隔直耦合装置；第一～第三MOS的第一端连接电源电压，第四～第六MOS的第一端连接地；第一MOS第二端通过第一电阻连接第四MOS第二端，第二MOS的第二端连接第五MOS第二端，第三MOS第二端连接第六MOS第二端；第一～第三MOS的第三端互连并与第五MOS的第二端连接，第四MOS第三端连接隔直耦合装置第一端，第五MOS第三端连接在第四MOS第二端和第一电阻之间，第六MOS第三端连接隔直耦合装置第二端；隔直耦合装置第一端连接在第一MOS第二端和第一电阻之间，隔直耦合装置第二端通过第二电阻连接第三MOS第二端。本发明的晶振驱动电路相对现有技术振幅能够受控并且功耗更低。 | ||||||
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