一种用余数插补比较法产生矩形波的虚拟信号发生器
专利汇可以提供一种用余数插补比较法产生矩形波的虚拟信号发生器专利检索，专利查询，专利分析的服务。并且一种用余数插补比较法产生矩形波的虚拟 信号 发生器，包括PC、总线 接口 与译码 电路 、 波形 参数 存储器 、分频选择器、可编程 分频器 、 晶体 振荡器 、数据选择器、余数比较器、计数器、 频率 比较器、占空比比较器、 倍频器 、地址发生器、波形数据存储器、 数模转换 器、 开关 电路、输出电路，它以CPLL/FPGA可编程器件为核，将信号发生器所需的计算机接口电路及虚拟仪器中的数字部分全部构造在核中。这种信号发生器通过余数插补和数字比较自动产生频率、占空比满足用户要求且步进可调的矩形波信号，并且仪器的 硬件 开支小、成本低、功能多、系统功能扩展方便、可靠性高、维护简便。，下面是一种用余数插补比较法产生矩形波的虚拟信号发生器专利的具体信息内容。
1、一种用余数插补比较法产生矩形波的虚拟信号发生器，其特 征在于：包括
-PC，包括输入键盘、显示器、处理器等，用于根据用户输入的 波形数据产生波形参数数据，并将其存储于波形参数存储器中；
-总线接口与译码电路，用于完成PC总线的隔离、驱动、译码 和复位；
-晶振电路，用于产生一个精确的时钟信号，作为可编程分频器 的基准信号；
-波形参数存储器，用于存储由PC计算得到的波形参数数据；
-频率比较器，用于将计数器的输出与存储器中的频率数据进行 比较，其结果送到计数器的输入端；
-计数器，用于以可编程分频器的输出作为时钟信号进行计数， 频率比较器的输出结果控制计数器的清零，其计数结果送余数比较 器；
-余数比较器，用于将计数器的输出与存储器中的余数进行比 较，并将其结果作为数据选择器的控制信号；
-数据选择器，用于根据余数比较器的结果，从波形参数存储器 中选择分频预置数到可编程分频器的预置数端；
-可编程分频器，用于以数据选择器的输出数据作为分频预置数，将 输入信号进行分频，并把其输出信号作为可编程分频器的置数控制信号、 计数器的输入时钟、占空比比较器的输入信号；
-占空比比较器，用于将可编程分频器的输出与存储器中的占空比数 据进行比较，输出频率和占空比满足要求的周期性的矩形波或方波信号。
2、根据权利要求1所述的一种用余数插补比较法产生矩形波的虚拟 信号发生器，其特征在于：还包括
-分频选择电路，用于将晶振电路产生的时钟信号分别进行1分频、 10分频、100分频、1000分频、10000分频，并根据输入波形参数将其 中一路分频信号送到可编程分频器的输入端。
3、根据权利要求1或2所述的一种用余数插补比较法产生矩形波的 虚拟信号发生器，其特征在于：还包括
-倍频器，用于将占空比比较器输出的信号进行倍频；
-波形数据存储器，用于存储量化的波形数据；
-地址发生器，用于按倍频器输出信号的频率节奏将存放于波形数据 存储器中的量化数据送到数模转换器的输入端；
-数模转换器，用于在倍频器输出信号的控制下，将存储器量化的波 形数据转换成相应的波形；
4、根据权利要求3所述的一种用余数插补比较法产生矩形波的虚拟 信号发生器，其特征在于：还包括
-开关选择电路，用于从占空比比较器和数模转换器的输出信号中选 择一路作为输出信号；
-输出电路，用于对开关选择电路输出的信号进行滤波、幅度控制、 极性变换及负载驱动。
技术领域
本发明涉及一种信号发生器，特别是指一种用余数插补比较法产 生矩形波的虚拟信号发生器。
技术背景
信号发生器是一种常用的电子仪器，广泛应用于生产、教学、科 研等领域。在使用信号发生器时，经常提出要一个频率可改变，占空 比可调的信号，以往的信号发生器实现这一要求采用的方法是：(1) 采用数字逻辑电路，这种电路通用性和灵活性差，并且精度较差。(2) 以锁相环为核心实现信号产生，这种信号发生器其输出信号的精度较 高，但其价格也比较昂贵。
发明内容
为实现上述目的，本发明采用的技术方案是：
以CPLL/FPGA可编程器件为核，将信号发生器所需的计算机接口 电路及虚拟仪器中的数字部分全部构造在核中，辅之以晶振、保护电 路制成一个ISA卡，插入PC机的ISA插槽，再结合外部控制电路组 成虚拟信号发生器。
本发明包括：-PC，包括输入键盘、显示器、处理器等，用于根 据用户输入的波形数据产生波形参数数据，并将其存储于波形参数存 储器中；-总线接口与译码电路，用于完成PC总线的隔离、驱动、 译码和复位；-晶振电路，用于产生一个精确的时钟信号，作为可编 程分频器的基准信号；-分频选择电路，用于将晶振电路产生的时钟 信号分别进行1分频、10分频、100分频、1000分频、10000分频， 并根据输入波形参数将其中一路分频信号送到可编程分频器的输入 端；-波形参数存储器，用于存储由PC依用户输入波形数据计算得 到的波形参数数据；-频率比较器，用于将计数器的输出与存储器中 的频率数据进行比较，其结果送到计数器的输入端；-计数器，用于 以可编程分频器的输出作为时钟信号进行计数，频率比较器的输出结 果控制计数器的清零，其计数结果送余数比较器；-余数比较器，用 于将计数器的输出与存储器中的余数进行比较，其结果作为数据选择 器选择控制信号；-数据选择器，用于根据余数比较器的结果，从波 形参数存储器中选择分频预置数到可编程分频器的预置数端；-可编 程分频器，用于以数据选择器的输出数据作为分频预置数，将输入信 号进行分频，并把其输出信号作为可编程分频器的置数控制信号、计 数器的输入时钟、占空比比较器的输入信号；-占空比比较器，用于 将可编程分频器的输出与存储器中的占空比数据进行比较，输出频率 和占空比满足要求的周期性的矩形波或方波信号至开关电路和倍频 器；-倍频器，用于将占空比比较器输出的信号进行40倍频；-波 形数据存储器，用于存储量化的波形数据；-地址发生器，用于按倍 频器输出信号的频率节奏将存放于波形数据存储器中的量化数据送 到数模转换电路的输入端；-数模转换器，用于在倍频器输出信号的 控制下，将存储器中量化的波形数据转换成相应的波形；-开关选择 电路，用于从占空比比较器和数模转换器的输出信号中选择一路作为 输出信号；-输出电路，用于对开关选择电路输出的信号进行滤波、 幅度控制、极性变换及负载驱动。
本发明以CPLD/FPGA可编程器件为核，将信号发生器所需计算机 接口电路及虚拟仪器中的数字部分全部构造在核中，辅之以晶振、保 护电路制成一个ISA卡，插入PC机的ISA插槽，再结合外部控制电 路组成虚拟信号发生器，这种信号发生器通过余数插补和数字比较自 动产生频率、占空比满足用户要求且步进可调的矩形波信号，并且仪 器的硬件开支小、成本低、功能多、输出信号性能好、系统功能扩展 方便、可靠性高、维护简便。
下面结合附图对本发明的构成及工作原理作进一步的描述。
附图说明
具体实施方式
本发明中余数插补比较法产生频率、占空比步进可调的矩形波信 号或方波信号的原理如下：
设用户要求产生频率为f、占空比为1∶m的矩形波信号，时基 频率为fCLK1，则
fCLK1/f＝S...Y S为商，Y为余数
令S＝DR，Y＝Y1，DR+1＝DF，f＝F1
1(S)＝fCLK1·TCLK1＝(DR·F1+Y1)·TCLK1
＝DR·F1·TCLK1+(DF-DR)·Y1·TCLK1
＝Y1·DF·TCLK1+(F1-Y1)·DR·TCLK1 …(1)
令T1＝Y1·DF·TCLK1，T2＝(F1-Y1)·DR·TCLK1 …(2)
从(1)、(2)式知要得到T1，可以对fCLK1进行DF分频，同理要 得到T2必须对fCLK1进行DR分频。在(2)式中表明T1内对CLK1进行 DF分频后计数应有Y1个，T2内对CLK1进行DR分频后计数应有 (F1-Y1)个，则在这1S时间内CLK1分频后所计的脉冲个数为Y1+ (F1-Y1)＝F1＝f，即为用户所需信号频率。
参见图2，它是产生频率、占空比可调的矩形波信号的具体电路 图，图中JIEKO为总线接口与译码模块，JICUN为波形参数寄存器模 块，CNT为10n(0≤n≤4)分频模块，MUX为频率选择模块。CNT14 为1 4位减1计数器，CNT20为20位加1计数器，CMPY、CMPF为20 位比较器，CMPZ为13位比较器。其工作过程如下：设要产生占空比 为1∶m、频率为f的矩形波信号，波形参数的计算为：
fCLK1/f＝DR[12..0]...Y1[19..0]，取DR[12..0]+1→DF[12..0]， f→F1[19..0]
因占空比为1∶m，现以CNT14中完成信号计时，CNT14输入时钟 CLK1的频率为fc1k1，若输出信号的高电平时间为X×Tc1k1，CNT14计数 初数为DF，则1∶m＝X×Tc1k1∶DF×TCLK1，X＝DF/m，[X]→Z1[12..0]，[X] 为X第一位小数4舍5入后取整。当用户输入信号参数后，PC机根 据软件计算出来的DF、DR、Z1、F1、Y1参数自动送到波形参数寄存 器，CNT14为14位二进制同步减法计数器，其计数使能CNT_EN、时 钟使能CLK_EN均为高电平有效，Q13为预置数命令端，当Q13＝1预 置命令有效。CNT20为20位二进制加法计数器，CMPZ、CMPF、CMPY 模块均为功能相同的数据比较器，CMPY余数比较器中，当Y1＞Y0 时SEL1＝1，否则SEL1＝0，BUSMUK模块为选择器，当SEL＝1时选 datab，否则选dataa。
现以开机时Q13＝1、Y0为全0来分析信号产生过程。
因Q13＝1，Y0＝0，则SEL1＝1，DATA[12..0]＝DF[12..0]，因 Q13是高电平有效，所以CNT14立即将DF数据装载到CNT14，装载后 立即使Q13＝0，以后便在CLK1时钟下按DF初值作减1计数。当Z0 减到0再减1，Q13＝1，再重装DF→CNT14...此时在CMPZ中，当Z1 ＞Z0时，OUTA＝OUT2＝1，否则OUTA＝OUT2＝0，故OUT2输出高电平 时间为[DF/m]TCLK1，低电平时间为(DF-[DF/m])×TCLK1，则OUT2的占 空比为1∶m就得基本满足。Q13的每一次上跳又使CNT20加1，当Y1 ＞Y0时SEL＝1，使CNT14每次重装DF初值，当Y1≤Y0 SEL1＝0， DATA接通DR，使CNT14每次按DR重装计数，见图3，很明显T1段 信号周期为DF×TCLK1，T2段为DR×TCLK1。当F1＞F0时CMPF输出F＝1， 对CNT20无影响，当某时刻CNT14在Q13＝1时再装DR时，Q13同时 使CNT20加1后有F1≤F0时即CNT20计数到F1时F＝0，它便使CNT20 全部异步清0，SEL1＝1，因CNT14装载命令是高电平有效且此时仍 有Q13＝1，CNT14便在下一个CLK1有效时又装载DF为初值，重复上 述过程，故图3中T1要重复Y1次计数，T2要重复(F1-Y1)次计 数，故T周期信号的脉冲个数为F1，而T＝Y1×T1+(F1-Y1)×T2 ＝Y1×DF×TCLK1+(F1-Y1)×DR×TCLK1因fc1k1＝f×DR+Y1＝F1×DR +Y1，所以T＝(Y1+F1×DR)×TCLK1＝fc1k1×TCLK1＝1(S)，这说 明在1秒时间内正好出现了f个脉冲，且每个脉冲的占空比为1∶m， 产生了所要的信号。
本信号发生器在选取50MHz、精度为±5×10-7的VTX71型晶振， 其输出的矩形波经分析和EE3347型多功能计数器测试，其主要技术 参数为： 1、频率1Hz～1MHz、步进1Hz、准确度10-3。 2、当f≤0.5MHz，占空比1％～99％、步进1％、准确度0.5％； 当0.5MHz＜f≤1MHz，占空比2％～98％、步进2％、准确度1％。 3、当f≤0.5MHz，周期准确度1.1％； 当0.5MHz＜f≤1MHz，周期准确度2.1％。
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