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逻辑到物理映射

阅读：400发布：2020-05-08

专利汇可以提供逻辑到物理映射专利检索，专利查询，专利分析的服务。并且本公开包含用于逻辑到物理映射的设备和方法。数个实施例包含逻辑到物理L2P更新表、L2P表高速缓存和控制器。所述控制器可经配置以使待应用于L2P表的更新列表被存储在所述L2P更新表中。，下面是逻辑到物理映射专利的具体信息内容。

权利要求

1.一种设备，其包括：
逻辑到物理L2P更新表和L2P表高速缓存；以及
控制器，其中所述控制器经配置以使待应用于L2P表的更新列表被存储在所述L2P更新表中。
2.根据权利要求1所述的设备，其中所述L2P更新表和所述L2P表高速缓存包括耦合到所述控制器的易失性存储器的部分。
3.根据权利要求1所述的设备，其中所述L2P表高速缓存经配置以存储所述L2P表的一部分。
4.根据权利要求1到3中任一项所述的设备，其中所述控制器经配置以：
使对应于已更新的L2P条目的数据存储在所述L2P更新表中；以及
使对应于来自非易失性存储器中的所述L2P表的L2P区域的数据存储在所述L2P表高速缓存中以促进由所述控制器对所述L2P表的查找和更新操作。
5.根据权利要求1到3中任一项所述的设备，其中所述控制器还经配置以：
响应于确定所述L2P更新表中存在空间以接收转译单元TU更新，使已更新TU添加到所述L2P更新表；以及
响应于确定所述L2P更新表中不存在空间以接收所述已更新TU，在所述L2P表高速缓存中执行区域高速缓存查找以确定所述已更新TU是否存储在所述L2P表高速缓存中。
6.根据权利要求1到3中任一项所述的设备，其中所述控制器还经配置以使所述L2P表高速缓存用作缓冲区以从所述L2P表的非易失性存储器存储读取L2P区域。
7.根据权利要求1到3中任一项所述的设备，其中所述控制器还经配置以响应于确定由主机请求的数据条目未存储在所述L2P更新表中而在所述L2P表高速缓存中执行搜索以查找所述数据条目的位置。
8.根据权利要求1到3中任一项所述的设备，其中所述L2P更新表包括多个散列表，其中所述多个散列表当中的每个散列表对应于特定L2P区域。
9.根据权利要求1到3中任一项所述的设备，其中所述控制器经配置以使用单个动态随机存取存储器存取命令将存储在所述L2P更新表中的所述L2P条目写入。
10.一种方法，其包括：
确定逻辑到物理L2P更新表中是否存在空间以接收由主机写入操作产生的已更新转译单元TU；
响应于对所述L2P更新表中存在空间以接收TU更新的所述确定，将所述已更新TU添加到所述L2P更新表。
11.根据权利要求10所述的方法，其还包括响应于确定所述L2P更新表中不存在空间以接收所述已更新TU，在L2P表高速缓存中执行区域高速缓存查找以确定所述已更新TU是否存储在所述L2P表高速缓存中。
12.根据权利要求11所述的方法，其还包括响应于确定所述已更新TU未存储在所述L2P表高速缓存中，将区域从L2P表加载到所述L2P表高速缓存中。
13.根据权利要求10到11中任一项所述的方法，其还包括：
响应于确定所述已更新TU未存储在所述L2P表高速缓存中，将区域从L2P表加载到所述L2P表高速缓存中；以及
利用所述L2P更新表中加载的条目来更新所述L2P表高速缓存。
14.根据权利要求13所述的方法，其还包括将已更新L2P更新表写入到所述L2P表高速缓存以更新其中存储的条目。
15.一种方法，其包括：
确定特定条目是否存储在逻辑到物理L2P更新表中；以及
响应于对所述特定条目存储在所述L2P更新表中的所述确定，读取与所述特定条目相关联的数据。
16.根据权利要求15所述的方法，其还包括：
响应于确定所述特定条目未存储在所述L2P更新表中，确定所述特定条目是否存储在L2P表高速缓存中；以及
响应于对所述特定条目存储在所述L2P表高速缓存中的所述确定，读取与所述特定条目相关联的数据。
17.根据权利要求15所述的方法，其还包括：
响应于确定所述特定条目未存储在所述L2P更新表或所述L2P表高速缓存中，加载L2P高速缓存表区域；以及
从所述L2P高速缓存表读取与所述特定条目相关联的数据。
18.根据权利要求15到17中任一项所述的方法，其中所述特定条目已在阈值时间段内更新。
19.根据权利要求15到17中任一项所述的方法，其还包括作为对所述特定条目存储在所述L2P更新表中的所述确定的部分，确定所述特定条目是否存储在与所述L2P更新表相关联的散列表中。
20.根据权利要求15到17中任一项所述的方法，其中所述特定条目自上次执行无用单元收集操作以来就已被更新。

说明书全文

逻辑到物理映射

技术领域

[0001] 本公开大体上涉及半导体存储器和方法，且更具体地说，涉及逻辑到物理映射。

背景技术

[0002] 存储器装置通常提供为计算机或其它电子装置中的内部半导体集成电路和/或外部可移除装置。存在许多不同类型的存储器，包含易失性和非易失性存储器。易失性存储器可能需要电力来维持其数据，且可包含随机存取存储器(RAM)、动态随机存取存储器(DRAM)和同步动态随机存取存储器(SDRAM)等。非易失性存储器可在未供电时保留所存储数据，且可包含例如NAND快闪存储器、NOR快闪存储器、相变随机存取存储器(PCRAM)、电阻性随机存取存储器(RRAM)和磁性随机存取存储器(MRAM)等存储存储器。

[0003] 存储器装置可组合在一起以形成固态驱动器(SSD)。SSD可包含非易失性存储器(例如，NAND快闪存储器和/或NOR快闪存储器)，和/或可包含易失性存储器(例如，DRAM和/或SRAM)，以及各种其它类型的非易失性和易失性存储器。举例来说，快闪存储器装置可包含将数据存储在例如浮动栅极的电荷存储结构中的存储器单元，且可用作非易失性存储器以用于广泛范围的电子应用。快闪存储器装置通常使用允许高存储器密度、高可靠性和低功耗的单晶体管存储器单元。

[0004] SSD可用于替代硬盘驱动器作为计算机的主存储体，因为固态驱动器在性能、大小、重量、耐用性、操作温度范围和功耗方面可具有优于硬盘驱动器的优势。举例来说，当与磁盘驱动器相比时，SSD可因其不含移动部分而具有优异性能，这可避免与磁盘驱动器相关联的寻道时间、时延和其它机电延迟。附图说明

[0005] 图1是根据本公开的数个实施例的呈包括存储器系统的计算系统形式的设备的功能框图。

[0006] 图2说明根据本公开的数个实施例的逻辑到物理映射结构的实例。

[0007] 图3说明根据本公开的数个实施例的用于执行与逻辑到物理映射相关联的主机读取的流程图。

[0008] 图4说明根据本公开的数个实施例的用于执行与逻辑到物理映射相关联的主机写入的流程图。

具体实施方式

[0009] 主机系统将使用逻辑地址对存储在SSD上的数据块进行寻址。数据将被存储在SSD中，在非易失性存储器中的物理地址处。SSD的控制器通常维持从主机所用的逻辑地址映射到其中存储数据的物理地址的表。此表被称为L2P表。当主机希望读取数据时，SSD将在L2P表中查找物理地址，以便提取请求的数据。当主机在SSD中写入或更新数据时，L2P表将被更新。L2P表本身将存储在SSD的非易失性存储器中，但要由SSD控制器使用或更新，则必须首先将其提取到在SSD控制器中的或附接到所述SSD控制器的易失性存储器中。如果L2P表已更新，则必须在某个点将更新写回到非易失性存储器中所存储的表中。在SSD的设计过程中，必须确定是否将指定控制器中或附接到控制器的易失性存储器来保持SSD的整个逻辑地址空间的完整L2P表，或是否将仅指定较少易失性存储器且每次仅可将来自非易失性存储器的L2P表的部分加载到控制器存储器中(即，将控制器非易失性存储器用作L2P表的高速缓存)。

[0010] 本文提供用于改进逻辑到物理映射的设备和方法。在本公开的一或多个实施例中，一种设备可包含逻辑到物理(L2P)更新表、L2P表高速缓存和控制器。所述控制器可经配置以使待应用于L2P表的更新列表被存储在所述L2P更新表中。

[0011] 逻辑块寻址是主机可用以识别数据的逻辑区域的方案。来自主机的逻辑地址被转译成转译单元(TU)，所述转译单元是L2P表管理的非易失性存储器的最小单元。可将L2P表中的每个TU置于非易失性存储器中的独特位置。另外，TU还可对应于物理地址。数据的逻辑区域可以是数据的字节数目(例如256字节、512字节或1,024字节)。然而，实施例不限于这些实例。

[0012] 与需要足够易失性存储器同时加载整个表相反，将易失性存储器的一部分用作L2P表的高速缓存允许所需易失性存储器(例如DRAM或SRAM)更少。然而，由于需要将L2P表的部分(称为区域)加载到高速缓存中，且相比于整个表可能同时驻存在易失性存储器中的情况，需要更频繁地将易失性存储器中的已更新部分写回到非易失性存储器中，因此存在整个装置的性能代偿。

[0013] 取决于易失性存储器与非易失性存储器的确切比例，可因高速缓存命中而修改L2P高速缓存的时间影响，然而，对于大型SSD，高速缓存命中率可能很小。本公开的数个实施例可提供例如增大L2P高速缓存效率的益处(例如，通过有效地增大L2P高速缓存方案的高速缓存命中率)。

[0014] 本文所描述的各种实施例可提供一种L2P高速缓存方法，其中将可供用于L2P高速缓存的一定量的易失性存储器(例如，DRAM或SRAM)划分成多个部分。举例来说，可将可供用于L2P映射的所述量的易失性存储器划分成L2P表高速缓存部分和L2P更新部分。L2P表高速缓存部分在任何时间点都将整个L2P表的子集保持为高速缓存。L2P表的区域根据需要加载到此高速缓存中以进行读取和更新，且那些区域在更新后将被写回到非易失性存储器中的L2P表中。L2P更新部分含有待应用于L2P表但尚未应用的更新列表(即，它们适用的表的区域尚未被读取到高速缓存中、被修改且接着写出回到非易失性存储器)。

[0015] 此外，本文中的实施例可允许基于每L2P区域将存储在L2P更新部分中的更新排序到散列表(例如存储桶)中，这可允许基于对L2P条目的更新所在的散列表的内容的读取来确定应用于L2P区域的更新。这可允许更快地处理已更新L2P条目和/或可增大L2P更新过程的效率，因为在至少一个实施例中，与一些可能需要搜索大的数据结构以查找相关已更新L2P条目的方法相反，仅可读取已更新L2P条目所在的散列表。举例来说，L2P更新过程可比一些先前方法更高效。在至少一个实施例中，相比于其中由处理器将整个L2P区域从非易失性存储器读取到易失性存储器、随后从易失性存储器读取的方法，已更新L2P条目可能仅需要进行单次易失性存储器读取。

[0016] 如本文所使用，“数个”某物可指一或多个此类事物。举例来说，数个存储器单元可指一或多个存储器单元。另外，如本文尤其相对于图中的参考标号所使用，标志符“N”指示如此指定的数个特定特征可被包含在本公开的数个实施例中。

[0017] 本文中的图式遵循编号惯例，其中前一或多个数字对应于图式图号，且其余的数字识别图中的元件或组件。可通过使用类似数字来识别不同图之间的类似元件或组件。举例来说，114可表示图1中的元件“14”，且类似元件在图2中可表示为114。

[0018] 图1是根据本公开的数个实施例的呈包括存储器系统104的计算系统101形式的设备的功能框图。如本文所使用，“设备”可指但不限于各种结构或结构的组合中的任一种，例如电路或电路系统、一或多个裸片、一或多个模块、一或多个装置或一或多个系统等。

[0019] 举例来说，存储器系统104可以是固态驱动器(SSD)。在图1所说明的实施例中，存储器系统104包含主机接口106、充当系统104的存储体的存储器(例如，数个存储器装置110-1、110-2、…、110-N)以及耦合到主机接口106和存储器装置110-1、110-2、…、110-N的控制器108(例如，SSD控制器)。存储器装置110-1、110-2、…、110-N可包含例如数个非易失性存储器阵列。

[0020] 举例来说，非易失性阵列可以是例如具有NAND架构的快闪阵列、相变阵列等。实施例不限于特定类型的存储器阵列或阵列架构。

[0021] 举例来说，在操作中，数据可作为数据页写入到存储器系统的存储器装置(例如存储器系统104的存储器装置110-1、…、110-N)和/或从所述存储器装置读取。由此，数据页可称作存储器系统的数据传送大小。被称作扇区(例如，主机扇区)的数据段中的数据可被传送到主机102/从主机传送。由此，数据的扇区可称作主机的数据传送大小。在一些实施例中，NAND块可称作擦除块，其中块是擦除单位，且页是读取和/或写入的量度。

[0022] 主机接口106可用于在存储器系统104与例如主机102的另一装置之间传达信息。主机102可包含存储器存取装置(例如处理器)。如本文所使用，“处理器”可指数个处理器，例如并行处理系统、数个协处理器等。实例主机可包含个人膝上型计算机、台式计算机、数码相机、数字记录和播放装置、移动(例如智能)电话、PDA、存储卡读取器、接口集线器等。

[0023] 主机接口106可呈标准化物理接口形式。举例来说，当将存储器系统104用于计算系统101中的信息存储时，主机接口106可以是串行高级技术附件(SATA)物理接口、外围组件互连高速(PCIe)物理接口或通用串行总线(USB)物理接口，以及其它物理连接器和/或接口。然而，一般来说，主机接口106可提供接口以用于在存储器系统104与具有主机接口106的兼容接受器的主机(例如主机102)之间传送控制、地址、信息(例如数据)和其它信号。

[0024] 控制器108可包含例如控制电路系统和/或逻辑(例如硬件和固件)。控制器108可被包含在与存储器110-1、110-2、…、110-N相同的物理装置(例如相同的裸片)上。举例来说，控制器108可以是耦合到包含物理主机接口106和存储器110-1、110-2、…、110-N的印刷电路板的专用集成电路(ASIC)。替代地，控制器108可被包含在单独的物理装置上，所述物理装置以通信方式耦合到包含存储器110-1、110-2、…、110-N的物理装置。在数个实施例中，控制器108的组件可作为分布式控制器散布在多个物理装置上(例如，在与存储器相同的裸片上的一些组件，以及在不同裸片、模块或板上的一些组件)。

[0025] 控制器108可与存储器装置110-1、110-2、…、110-N通信以感测(例如读取)、编程(例如写入)和/或擦除信息，以及其它操作。控制器108可具有可以是数个集成电路和/或离散组件的电路系统。在数个实施例中，控制器108中的电路系统可包含用于控制跨存储器装置110-1、110-2、…、110-N的存取的控制电路系统和/或用于在主机102与存储器系统104之间提供转译层(例如，快闪转译层)的电路系统。

[0026] 系统104还包含耦合到控制器108的易失性存储器113。易失性存储器113可在控制器内部或外部附接到所述控制器。尽管被描述为易失性存储器，但在一些实施例中，存储器113还有可能是非易失性的。此易失性存储器113内分配了一部分空间用于L2P表高速缓存
114。另外，易失性存储器113的一部分被分配给L2P更新表115。

[0027] 易失性存储器113的L2P表高速缓存114部分可供控制器用于从存储器装置110-1、…、110-N中的一或多者加载L2P表111-1、…、111-N的区域。如果条目在加载到L2P表高速缓存114中时进行了修改，则经修改条目将以控制器108确定的频率和速率写出回到非易失性存储器110-1..110-N中的L2P表110-1..110-N中。

[0028] 在一些实施例中，L2P更新表115将分成一组散列表。举例来说，L2P更新表115可维持L2P表111-1、…、111-N的每个区域的散列表。

[0029] 当控制器108由于主机102写入操作而需要更新L2P表110-1、…、110-3中并未含在当前加载到L2P表高速缓存114中的区域中的条目时，则为了避免加载L2P区域、对其修改且将其立即写回到非易失性存储器110-1、…、110-3中的L2P表的即时开销，所述控制器将仅仅在L2P更新易失性存储器113中将条目插入对应于L2P表的区域的散列表中，且随后由此信息更新L2P表。

[0030] 通过使用L2P更新易失性存储器散列表保持所需更新，可将非易失性存储器110-1..110-N的实际操作推迟到待处理的L2P表的区域存在多个更新为止。接着，当将此L2P表区域从L2P表110-1..110-N加载到L2P表高速缓存114时，可同时应用所有更新，之后将L2P区域写回到L2P表111-1、…、111-N。这可显著减小更新L2P表110-1、…、110-N所需的对非易失性存储器110-1..110-N读取和写入操作的次数。

[0031] 图2说明根据本公开的数个实施例的逻辑到物理映射结构的实例。如图2中所展示，驱动器上分配给L2P映射的总空间被划分成多个区域243-1、…、243-N以促进高速缓存。区域数目可基于SSD的总大小。举例来说，具有大存储容量(例如16,000太字节(TB))的SSD可存在数千个此类区域。

[0032] 全部L2P表243-1、…、243-N存储在NAND 240中。在任何时间点，此表的数个区域可在易失性存储器(例如图1中展示的易失性存储器113)中被高速缓存在L2P表高速缓存214中。基于从主机系统发送的命令和/或SSD控制器的内部操作，存储在高速缓存中的特定L2P区域将随着时间推移而改变。

[0033] L2P更新数据结构215也将存储在控制器易失性存储器中，所述L2P更新数据结构可以是散列表245-1、…、245-N。无论每个L2P区域243是否在当前加载到L2P表高速缓存中，将存在用于所述区域的表。L2P更新结构中的散列表可具有固定大小，或可动态分配。

[0034] 响应于L2P条目已更新，例如响应于对L2P条目的转译单元(TU)更新，可将TU以及其新位置添加到分配给L2P更新部分215的散列表245-1、…、245-N。对L2P条目的更新可通过将TU写入到新物理非易失性存储器位置(例如地址)而产生。在一些实施例中，TU更新可由无用单元收集操作、由主机写入或由可能需要对L2P条目更新的另一操作引起。

[0035] 在一些实施例中，对应于特定NAND区域114-1、…、243-N的散列表245-1、…、245-N的大小、每个特定散列表245-1、…、245-N中的条目数目可改变。举例来说，由于每个散列表245-1、…、245-N中的仅有条目是对应于通过主机写入或无用单元收集操作而更新的TU的条目，因此每个相应散列表245-1、…、245-N的大小可基于发生多少TU更新而改变。在一些实施例中，这可允许并合写入可能性的增大，因为每次写入使表245-1、…、245-N仅存储对应于与其相关联的相应NAND区域243-1、…、243-N的已更新TU。另外，因为与一些方法相比，TU可以更密集方式存储信息，所以与一些方法相比，更大数目的L2P更新可存储在易失性存储器中。此外，与一些方法相比，通过将更大数目的更新存储在易失性存储器中，可减小数据涌到非易失性的频率。

[0036] 在一些实施例中，可在散列表245-1、…、245-N中执行大量查找。为了以高效方式促进大量查找，可使用各种散列化机制。例如，可使用布谷鸟散列化(cuckoo hashing)机制，其中针对例如散列表245-1、…、245-N的表中的散列函数的值来解决解决散列冲突。在一些实施例中，结合所公开的L2P映射使用布谷鸟散列化机制可允许利用散列表245-1、…、245-N的大约91％。布谷鸟散列化机制的实例可包含结合单个表使用三个散列。举例来说，对于散列表245-1、…、245-N中的每个条目，可存在三个可能的位置。然而，实施例不限于使用布谷鸟散列化机制，且可使用其它散列化机制，例如乘法散列化机制。

[0037] 图3说明根据本公开的数个实施例的用于使用逻辑到物理映射执行主机读取的流程图350。在一些实施例中，根据本公开的执行主机读取包含首先检查L2P更新部分以确定其是否含有关于TU的物理位置的信息，所述TU含有主机在请求的数据。如果L2P更新部分中没有存储最近已更新TU，则可检查L2P表高速缓存以确定待读取的数据是否存储在其中。如果待读取的数据不在当前已加载于易失性存储器中的L2P表高速缓存的区域内，则将需要从非易失性存储器L2P表中加载所述数据。

[0038] 在351处开始根据本公开的执行主机读取的过程，在框352处执行L2P更新表查找。执行更新表查找352可包含在L2P更新部分中搜索条目以确定是否存在对应于待由主机读取的数据的最近更新的TU。在一些实施例中，在L2P更新部分中搜索条目可包含搜索L2P更新部分中包含的散列表以确定是否存在对应于待由主机读取的数据的最近更新的TU。如果被搜索用于主机读取的条目位于L2P更新部分中，例如，如果搜索的条目被“找到”，则在355处执行主机读取操作，且过程在框356处结束。

[0039] 如果“未找到”被搜索用于主机读取的条目，则可在框353处执行L2P表高速缓存查找。在353处执行L2P表高速缓存查找可包含在L2P表高速缓存中搜索条目以确定待由主机读取的条目是否存储在L2P表高速缓存中。如果找到所述条目，则在框355处在L2P表中指定的物理非易失性位置处执行主机读取操作，且在框356处结束执行主机读取操作的过程。

[0040] 然而，如果在L2P更新部分或L2P表高速缓存中未找到所述条目，则可在框354处执行加载区域操作。所述加载区域操作可包含加载存储在非易失性存储器上的L2P区域。在加载后，可随后搜索L2P区域以定位被搜索用于主机读取的条目。在加载存储在非易失性存储器上的L2P区域之后，在框355处可在L2P表中指定的物理非易失性位置处执行主机读取操作，且在框356处结束执行主机读取操作的过程。在一些实施例中，如果L2P表高速缓存中需要额外空间，则可在先前已加载的区域没有更新的情况下将其舍弃，或在所述区域已被更新的情况下将其写回到非易失性存储器中，以在L2P区域高速缓存中释放额外空间。

[0041] 图4说明根据本公开的数个实施例的用于使用逻辑到物理映射执行主机写入的流程图459。应注意，以与图4中描述的主机写入过程类似的方式执行无用单元收集操作。在460处，开始根据本公开的执行主机写入操作的过程，在框461处执行将来自主机的数据写入到非易失性存储器中可用的空位置。应注意，在一些实施方案中，由于将高速缓存用于主机数据，因此可能推迟这种主机数据到非易失性存储器阵列的实际写入。

[0042] 在框462处，可确定L2P表高速缓存是否含有寻址主机写入数据的逻辑地址的所需区域。举例来说，可在框462处确定L2P表高速缓存是否已具有先前已加载到L2P表高速缓存中的所需区域。如果所述区域已被加载到L2P表高速缓存中(例如，框462的“是”分支)，则不必将更新添加到L2P更新表，且流程可继续到框466，这将在下文中更详细地描述。然而，如果L2P表高速缓存不包所需区域(例如，框462的“否”分支)，则流程可继续到框463。

[0043] 在框463处，可确定L2P更新表中是否存在空间。举例来说，在框463处，可确定L2P更新部分是否含有足够的可用空间以接收由主机写入操作产生的已更新TU。如果在L2P更新部分中存在足够空间来接收已更新TU，则在468处，可将条目插入到L2P更新表中，且在框469处，可结束执行主机写入的过程。在一些实施例中，可在框468处将条目插入到L2P映射部分中包含的散列表中。

[0044] 如果更新表中没有足够空间来存储已更新TU，则可在框464处执行L2P表高速缓存查找以确定当前是否已在高速缓存中加载了适当的区域。执行区域高速缓存查找可包含搜索L2P表高速缓存以确定其中是否存储了对应的条目。如果在框464处未找到对应的条目，则在465处将从非易失性存储器中加载L2P表高速缓存区域。应注意，可能必须在易失性存储器中创建空间，通过将L2P表的另一区域舍弃或写回到非易失性存储器来实现这一点。

[0045] 在将L2P表的适当区域加载到L2P表高速缓存中后，接着在466处，除了此主机写入操作所需的更新之外，可利用L2P更新表中所述区域的所有相关条目更新所述区域。在更新后，所述区域将接着在467处被写回到存储在非易失性存储器中的L2P表。应注意，这种写回到非易失性存储器可能是即时的，也可能会延迟。在L2P表高速缓存中的区域已更新且任选地写回到非易失性存储器后，可在469处结束主机写入所需的表更新。

[0046] 尽管已在本文中说明并描述了具体实施例，但所属领域的技术人员应了解，经计算以实现相同结果的布置可取代所展示的具体实施例。本公开意欲涵盖本公开的数个实施例的调适或变化。应理解，以说明方式而非限制方式进行了以上描述。在查阅以上描述后，以上实施例和本文未具体描述的其它实施例的组合对于所属领域的技术人员来说将显而易见。本公开的数个实施例的范围包含其中使用上述结构和方法的其它应用。因此，本公开的数个实施例的范围应参考所附权利要求书以及此类权利要求被赋予的等同物的完整范围而确定。

[0047] 在前述具体实施方式中，出于简化本公开的目的而将一些特征一起分组在单个实施例中。本公开的这一方法不应被理解为反映本公开的所公开实施例必须使用比每个权利要求中明确陈述的特征多的特征的意图。实际上，如所附权利要求书所反映，本发明主题在于单个公开实施例的不到全部的特征。因此，所附权利要求书特此并入于具体实施方式中，其中每个权利要求就其自身而言作为单独实施例。

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