技术领域
[0001] 本
申请涉及
半导体制造技术领域，具体涉及一种MOSFET器件的制造方法。
背景技术
[0002] 相关技术中，在功率金
氧半场效晶体管(Power Metal-Oxide-Semiconductor Field-Effect Transistor，Power MOSFET)器件的
制造过程中，在
硅衬底上形成硅氧化物层后，需要分别进行硅氧化物层的
刻蚀和硅衬底的刻蚀，在硅衬底上形成沟槽。
[0003] 由于硅氧化物层和硅衬底的刻蚀速率不同，且需要刻蚀的厚度也不相同，因此硅氧化物层的刻蚀步骤在轰击能
力比较强的
电容耦合等离子体(Capacitively Coupled Plasma，CCP)刻蚀设备中进行，硅衬底的刻蚀步骤在轰击能力比较弱，等离子体损伤比较小的电感耦合等离子体(Inductively Coupled Plasma，ICP)刻蚀机中进行。
[0004] 图1至图3示出了相关技术提供的MOSFET器件的制造过程的示意图。参考图1，硅(Si)衬底110上形成有硅氧化物(例如
二氧化硅SiO2)层120，硅衬底110上不需要刻蚀的区域
覆盖有光阻101，需要刻蚀的部位如虚线所示；参考图2，在CCP刻蚀设备中对硅氧化物层101进行刻蚀，使硅衬底110暴露；参考图3，在ICP刻蚀设备中对硅衬底110进行刻蚀，形成沟槽。
[0005] 由于硅氧化物层和硅衬底的刻蚀步骤需要在不同的刻蚀设备中完成，因此工艺较为复杂，制造效率较低。
发明内容
[0006] 本申请提供了一种MOSFET器件的制造方法，可以解决相关技术中提供的MOSFET器件的制造方法由于需要在不同的刻蚀设备中对硅氧化物和硅衬底进行刻蚀所导致的工艺复杂，制造效率低的问题。
[0007] 一方面，本申请
实施例提供了一种MOSFET器件的制造方法，包括：
[0008] 提供一硅衬底，所述硅衬底上形成有硅氧化物层；
[0009] 通过
光刻工艺在所述硅氧化物层上的预定区域覆盖光阻(Photoresist，PR)；
[0010] 通过ICP刻蚀设备对除所述预定区域以外的其它区域的硅氧化物层进行刻蚀，直至所述硅衬底暴露，通过调节刻蚀过程中的刻蚀参数使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率；
[0011] 通过所述ICP刻蚀设备对所述其它区域的硅衬底进行刻蚀，形成沟槽，通过调节刻蚀过程中的参数控制每个所述沟槽之间均一性。
[0012] 可选的，在对所述其它区域的硅氧化物层进行刻蚀时，对硅氧化物的刻蚀速率和对硅的刻蚀速率的比值大于2。
[0013] 可选的，所述通过调节刻蚀过程中的刻蚀参数使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率，包括：
[0014] 通过调节刻蚀过程中的偏置
电压(Bias Voltage)、源(Source)功率、反应气体流速和气压中的至少一种使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率。
[0015] 可选的，所述偏置电压的取值范围为600伏特(V)至700伏特。
[0016] 可选的，所述源功率的取值范围为800瓦(W)至1000瓦。
[0017] 可选的，所述反应气体包括四氟化
碳(CF4)、二氟甲烷(CH2F2)和氦气(He)。
[0018] 可选的，所述四氟化碳的流速的取值范围为30标准状态毫升/分(Standard Cubic Centimeter per Minute，SCCM)至80SCCM。
[0019] 可选的，所述二氟甲烷的流速的取值范围为30SCCM至80SCCM。
[0020] 可选的，所述氦气的流速的取值范围为50SCCM至200SCCM。
[0021] 可选的，所述气压的取值范围为10毫托(mTorr)至20毫托。
[0022] 可选的，所述通过调节刻蚀过程中的参数控制每个所述沟槽之间均一性，包括：
[0023] 通过调节刻蚀过程中的偏置电压、源功率、反应气体流速和气压中的至少一种控制所述每个沟槽之间均一性。
[0024] 可选的，所述偏置电压的取值范围为100伏特至200伏特。
[0025] 可选的，所述源功率的取值范围为1000瓦至1500瓦。
[0026] 可选的，所述反应气体包括
氢溴酸(HBr)、氯气(Cl2)、四氟化碳和氧气(O2)。
[0027] 可选的，所述氢溴酸的流速的取值范围为300SCCM至400SCCM。
[0028] 可选的，所述氯气的流速的取值范围为100SCCM至200SCCM。
[0029] 可选的，所述四氟化碳的流速的取值范围为30SCCM至50SCCM。
[0030] 可选的，所述氧气的流速的取值范围为10SCCM至20SCCM。
[0031] 可选的，所述气压的取值范围为10毫托至30毫托。
[0032] 本申请技术方案，至少包括如下优点：
[0033] 通过ICP刻蚀设备对MOSFET器件的硅氧化物层进行刻蚀，通过调节刻蚀过程中的参数使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率，通过ICP刻蚀设备对其它区域的硅衬底进行刻蚀，形成沟槽，通过调节刻蚀过程中的参数控制每个沟槽之间均一性，从而实现了在同一刻蚀设备中对MOSFET器件的硅氧化物层和硅衬底进行刻蚀，降低了MOSFET器件的制造工艺的复杂度，在一定程度上提高了MOSFET器件的制造效率。
附图说明
[0034] 为了更清楚地说明本申请具体实施方式或
现有技术中的技术方案，下面将对具体实施方式或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图是本申请的一些实施方式，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
[0035] 图1至图3是相关技术提供的MOSFET器件的制造过程的示意图；
[0036] 图4是本申请一个示例性实施例提供的MOSFET器件的制造方法的
流程图；
[0037] 图5和图6是本申请一个示例性实施例提供的MOSFET器件的制造过程的示意图。
具体实施方式
[0038] 下面将结合附图，对本申请中的技术方案进行清楚、完整的描述，显然，所描述的实施例是本申请的一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在不做出创造性劳动的前提下所获得的所有其它实施例，都属于本申请保护的范围。
[0039] 在本申请的描述中，需要说明的是，术语“中心”、“上”、“下”、“左”、“右”、“竖直”、“
水平”、“内”、“外”等指示的方位或
位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。此外，术语“第一”、“第二”、“第三”仅用于描述目的，而不能理解为指示或暗示相对重要性。
[0040] 在本申请的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电气连接；可以是直接相连，也可以通过中间媒介间接相连，还可以是两个元件内部的连通，可以是无线连接，也可以是有线连接。对于本领域的普通技术人员而言，可以具体情况理解上述术语在本申请中的具体含义。
[0041] 此外，下面所描述的本申请不同实施方式中所涉及的技术特征只要彼此之间未构成冲突就可以相互结合。
[0042] 参考图4，其示出了本申请一个示例性实施例提供的MOSFET器件的制造方法的流程图，如图4所示，该方法包括：
[0043] 步骤S1，提供一硅衬底，该硅衬底上形成有硅氧化物层。
[0044] 步骤S2，通过光刻工艺在硅氧化物层上的预定区域覆盖光阻。
[0045] 参考图5，其示出了在硅氧化物(例如二氧化硅SiO2)层520上的预定区域覆盖光阻501的剖面图。如图5所示，硅衬底510上形成有硅氧化物层520。其中，光阻501未覆盖的区域可以是MOSFET器件的有源区，预定区域即为硅氧化层520上除有源区以外的其它区域。
[0046] 示例性的，可通过
涂胶机在硅氧化物层520上涂布光阻，通过曝光机对其它区域进行曝光后进行显影，去除其它区域的光阻，即可实现在硅氧化物层520上的预定区域覆盖光阻。
[0047] 步骤S3，通过ICP刻蚀设备对除预定区域以外的其它区域的硅氧化物层进行刻蚀，直至硅衬底暴露，通过调节ICP刻蚀设备的刻蚀参数使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率。
[0048] 可选的，本实施例中，通过调节刻蚀过程中的偏置电压、源功率、反应气体流速和气压中的至少一种使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率，且使硅衬底510的中心区域和边缘区域的硅氧化物刻蚀结果较为一致，硅衬底510的中心/边缘的关键尺寸(Critical Dimension，CD)的均一性较好(例如，CD的均一性的均值低于2％)。可选的，本实施例中，在对其它区域的硅氧化物层进行刻蚀时，对硅氧化物的刻蚀速率和对硅的刻蚀速率的比值大于2。
[0049] 可选的，本实施例中，偏置电压的取值范围为600伏特至700伏特：可选的，源功率的取值范围为800瓦至1000瓦。
[0050] 可选的，本实施例中，反应气体包括四氟化碳、二氟甲烷和氦气；可选的，四氟化碳的流速的取值范围为100SCCM至200SCCM四氟化碳的流速的取值范围为30SCCM至80SCCM；可选的，二氟甲烷的流速的取值范围为30SCCM至80SCCM；可选的，氦气的流速的取值范围为50SCCM至200SCCM。
[0051] 可选的，本实施例中，气压的取值范围为10毫托至20毫托。
[0052] 理想的气体流速配比能够良好的控制反应副产物在
侧壁的堆积，本申请中提供的反应气体的流速配比能够保证侧壁倾斜
角不会过于倾斜，且使硅衬底510的中心/边缘的关键尺寸的均一性较好。
[0053] 步骤S4，通过ICP刻蚀设备对其它区域的硅衬底进行刻蚀，形成沟槽，通过调节刻蚀过程中的参数控制每个沟槽之间均一性。
[0054] 参考图6，其示出了通过步骤S3和步骤S4的刻蚀之后，形成沟槽502的示意图。如图6所示，通过本实施例的方式进行刻蚀之后的效果与相关技术中提供的刻蚀方法的刻蚀效果基本相同。
[0055] 可选的，本实施例中，通过调节刻蚀过程中的偏置电压、源功率、反应气体流速和气压中的至少一种控制每个沟槽502之间均一性，使沟槽502的均一性的均值低于2％。示例性的，沟槽502的均一性指沟槽502的高度、宽度和倾斜度等参数的均一性。
[0056] 可选的，本实施例中，偏置电压的取值范围为100伏特至200伏特；可选的，源功率的取值范围为1000瓦至1500瓦。
[0057] 可选的，本实施例中，反应气体包括氢溴酸、氯气、四氟化碳和氧气；可选的，氢溴酸的流速的取值范围为300SCCM至400SCCM；可选的，氯气的流速的取值范围为100SCCM至200SCCM；可选的，四氟化碳的流速的取值范围为30SCCM至50SCCM；可选的，氧气的流速的取值范围为10SCCM至20SCCM。
[0058] 可选的，本实施例中，气压的取值范围为10毫托至30毫托。
[0059] 综上所述，本实施例中，通过ICP刻蚀设备对MOSFET器件的硅氧化物层进行刻蚀，通过调节刻蚀过程中的参数使刻蚀过程中对硅氧化物的刻蚀速率大于对硅的刻蚀速率，通过ICP刻蚀设备对其它区域的硅衬底进行刻蚀，形成沟槽，通过调节刻蚀过程中的参数控制每个沟槽之间均一性，从而实现了在同一刻蚀设备中对MOSFET器件的硅氧化物层和硅衬底进行刻蚀，降低了MOSFET器件的制造工艺的复杂度，在一定程度上提高了MOSFET器件的制造效率。
[0060] 显然，上述实施例仅仅是为清楚地说明所作的举例，而并非对实施方式的限定。对于所属领域的普通技术人员来说，在上述说明的
基础上还可以做出其它不同形式的变化或变动。这里无需也无法对所有的实施方式予以穷举。而由此所引伸出的显而易见的变化或变动仍处于本申请创造的保护范围之中。
