多速率數位鎖相迴路 MULTI-RATE DIGITAL PHASE LOCKED LOOP
阅读：942发布：2023-12-23
专利汇可以提供多速率數位鎖相迴路 MULTI-RATE DIGITAL PHASE LOCKED LOOP专利检索，专利查询，专利分析的服务。并且一種數位鎖相迴路(DPLL)包含一時間/數位轉換器(TDC),該TDC接收一DCO輸出信號及一參考時脈且輸出一第一數位値流。藉由以一高速率來時控該TDC而減少量化雜訊。降低取樣頻率電路將該第一流轉換成一第二流。該第二流被供應至該DPLL之一 相位 偵測求和器,使得該DPLL之一控制部分可以一較低速率進行切換以減少功率消耗。該DPLL因此被稱為一多速率DPLL。由該控制部分輸出的一第三數位調諧字流被升高取樣頻率,然後被供應至該DCO,使得可以較高速率來時控該DCO,藉此減少數位影像。在一接收器應用中,不執行升高取樣頻率,且以該較低速率來時控該DCO,藉此進一步減少功率消耗。，下面是多速率數位鎖相迴路 MULTI-RATE DIGITAL PHASE LOCKED LOOP专利的具体信息内容。
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