专利汇可以提供半导体器件的制造方法专利检索,专利查询,专利分析的服务。并且一种制造 半导体 器件的方法包括:提供限定有单元区域及周边区域的衬底;在衬底上方堆叠导电层、硬掩模层、金属基硬掩模层和非晶 碳 (C)图案,以使用非晶碳(C)图案作为蚀刻掩模来蚀刻金属基硬掩模层,由此形成所得结构;形成 光刻 胶 图案,以 覆盖 在单元区域中的所得结构,同时暴露出在周边区域中的所得结构;减小在周边区域中的蚀刻的金属基硬掩模层的宽度;移除光刻胶图案和非晶C图案;以及通过使用蚀刻的金属基硬掩模层作为蚀刻掩模来蚀刻硬掩模层和导电层,从而形成导电图案。,下面是半导体器件的制造方法专利的具体信息内容。
1.一种制造半导体器件的方法,该方法包括:
提供衬底,在所述衬底中限定有单元区域和周边区域;
在所述衬底上方堆叠导电层、硬掩模层、金属基硬掩模层和非晶碳(C) 图案;
使用非晶碳图案作为蚀刻掩模来蚀刻所述金属基硬掩模层,由此形成 所得结构;
形成光刻胶图案,以覆盖在所述单元区域中的所述所得结构,同时暴 露出在所述周边区域中的所述所得结构;
减少在所述周边区域中的蚀刻的金属基硬掩模层的宽度;
移除所述光刻胶图案和所述非晶碳图案;和
通过使用所述蚀刻的金属基硬掩模层作为蚀刻掩模来蚀刻所述硬掩模 层和所述导电层,以形成导电图案。
2.如权利要求1所述的方法,其中所述金属基硬掩模层包括钨(W)层、钛 (Ti)/氮化钛(TiN)层、四氯化钛(TiCl4)层、WN层、硅化钨(WSix)层和氧化 铝(Al2O3)层中的一种。
3.如权利要求2所述的方法,其中通过湿式蚀刻或干式蚀刻过程来实施 所述蚀刻的金属基硬掩模层的宽度的减少。
4.如权利要求3所述的方法,其中通过使用氢氧化铵-过氧化物混合物 (APM)溶液来实施湿式蚀刻过程,所述APM溶液包括以约1∶1∶5、约1∶4∶20 或约1∶5∶50的比例混合的氨水(NH4OH)、过氧化氢(H2O2)和水(H2O)。
5.如权利要求4所述的方法,其中所述APM溶液具有约21℃至约100℃ 的温度。
6.如权利要求3所述的方法,其中通过使用氟化碳(CF)基气体、CHF基 气体、三氟化氮(NF3)气体、氯气(Cl2)、三氯化硼(BCl3)气体及其气体混合 物的其中之一的等离子体来实施干式蚀刻过程。
7.如权利要求6所述的方法,其中所述CF基气体包括加入氧气(O2)中的 四氟化碳(CF4)气体。
8.如权利要求1所述的方法,其中通过使用添加有氧气(O2)或氩气(Ar) 的CF基气体与CHF基气体的气体混合物来蚀刻所述金属基硬掩模层。
9.如权利要求8所述的方法,其中所述CF基气体包括CF4气体或C2F6 气体,并且所述CHF基气体包括三氟甲烷(CHF3)气体。
10.如权利要求1所述的方法,其中所述导电层具有多晶硅层和金属或金 属硅化物层的堆叠结构,其中所述金属层或金属硅化物层包括钨(W)层、 氮化钨(WN)层、硅化钨(WSix)层和氮化钛(TiN)层中的一种。
11.如权利要求1所述的方法,其中在感应耦合等离子体(ICP)、去耦等离 子体源(DPS)和电子回旋共振(ECR)装置中,通过使用BCl3气体、CF基气 体、NFx气体、SFx气体和氯气(Cl2)中的一种作为主蚀刻气体来蚀刻所述导 电层。
12.如权利要求11所述的方法,其中所述BCl3气体、CF基气体、NFx气 体和SFx气体中的每一种气体的流量为约10sccm至约50sccm,所述氯气 (Cl2)的流量为约50sccm至约200sccm。
13.如权利要求11所述的方法,其中在ICP装置或DPS装置中,通过供 应约500W至约2,000W的源功率并且在所述主蚀刻气体中加入氧气(O2)、 氮气(N2)、氩气(Ar)、氦气(He)及其气体混合物中的一种来蚀刻所述导电层。
14.如权利要求11所述的方法,其中在ECR装置中,通过供应约1,000W 至约3,000W的源功率并且在主蚀刻气体中加入氧气(O2)、氮气(N2)、氩气 (Ar)、氦气(He)及其气体混合物中的一种来蚀刻所述导电层。
15.如权利要求13所述的方法,其中所述氧气(O2)的流量为约1sccm至约 20sccm,所述氮气(N2)的流量为约1sccm至约100sccm,所述氩气(Ar)的 流量为约50sccm至约200sccm,并且所述氦气(He)的流量为约50sccm至 约200sccm。
16.如权利要求1所述的方法,其中所述导电层由与所述金属基硬掩模层 相同的材料制成,并且在蚀刻所述导电层时,移除所述金属基硬掩模层。
17.如权利要求1所述的方法,还包括:
当所述导电层由不同于所述金属基硬掩模层的材料制成时,在蚀刻所 述导电层后,移除所述蚀刻的金属基硬掩模层。
18.如权利要求17所述的方法,其中通过APM清洗过程来移除所述蚀刻 的金属基硬掩模层。
19.如权利要求1所述的方法,其中所述导电层包括多晶硅层和金属或金 属硅化物层,并且形成所述导电图案包括:
蚀刻所述硬掩模层和所述金属或金属硅化物层;
在包括所述蚀刻的硬掩模层和所述蚀刻的金属或金属硅化物层的所得 结构的表面上方形成覆盖氮化物层;
蚀刻所述覆盖氮化物层,以在所述蚀刻的硬掩模层和所述蚀刻的金属 或金属硅化物层的侧壁上形成覆盖氮化物图案,以及
蚀刻所述多晶硅层。
20.如权利要求19所述的方法,其中通过使用NF3气体、CF4气体、SF6 气体、Cl2气体、O2气体、Ar气体、He气体、HBr气体、N2气体及其气 体混合物中的一种来蚀刻所述覆盖氮化物层。
21.如权利要求1所述的方法,其中所述导电层包括多晶硅层,所述方法 还包括使用Cl2气体、O2气体、HBr气体和N2气体来蚀刻多晶硅层。
22.如权利要求19所述的方法,还包括在蚀刻所述多晶硅层后,实施清洗 过程。
23.如权利要求22所述的方法,其中通过使用溶剂、缓冲氧化物蚀刻剂 (BOE)与水或使用臭氧(O3)气体的其中之一来实施所述清洗过程。
24.如权利要求10所述的方法,其中形成所述导电图案包括:
蚀刻所述硬掩模层和所述金属或金属硅化物层;
蚀刻所述多晶硅层的上部;
在所述所得结构的表面上方形成所述覆盖氮化物层,所述所得结构包 括所述蚀刻的硬掩模层、所述蚀刻的金属或金属硅化物层、和所述部分蚀 刻的多晶硅层;
蚀刻所述覆盖氮化物层,以在所述蚀刻的硬掩模层、所述蚀刻的金属 或金属硅化物层、和所述多晶硅层的蚀刻的上部的侧壁上形成所述覆盖氮 化图案;以及
蚀刻所述多晶硅层的剩余部分。
25.一种制造半导体器件的方法,该方法包括:
在衬底上方形成栅极绝缘层,所述衬底包括单元区域和周边区域;
在所述衬底上方形成金属基硬掩模层;
在所述金属基硬掩模层上方形成非晶碳层;
蚀刻所述非晶碳层,以形成非晶碳图案;
使用所述非晶碳图案来蚀刻所述金属基硬掩模层,以形成金属基硬掩 模图案;
形成光刻胶图案,以覆盖在所述单元区域中的所得结构,同时暴露出 所述周边区域;以及
蚀刻所述金属基硬掩模图案的侧壁,以减小在所述周边区域中的所述 金属基硬掩模图案的临界尺寸(CD)。
26.如权利要求25所述的方法,还包括:
在所述栅极绝缘层上方形成多晶硅层;
在所述多晶硅层上方形成导电层;
通过使用所述金属基硬掩模图案来蚀刻所述导电层,以形成导电图案。
27.如权利要求26所述的方法,其中所述导电层包括所述多晶硅层和所述 金属或金属硅化物层,并且形成所述导电图案包括:
在所述导电层上方形成硬掩模层;
蚀刻所述硬掩模层和所述金属或金属硅化物层;
在包括所述蚀刻的硬掩模层和所述蚀刻的金属或金属硅化物层的所得 结构的表面上方形成覆盖氮化物层;
蚀刻所述覆盖氮化物层,以在所述蚀刻的硬掩模层和所述蚀刻的金属 或金属硅化物层的侧壁上形成覆盖氮化物图案,以及
蚀刻所述多晶硅层。
本发明涉及制造半导体器件的方法,更特别涉及制造半导体器件以调整 在周边区域中的栅极图案的临界尺寸(CD)的方法。众所周知,由于半导体 器件变得更高度集成化,因此栅极图案的临界尺寸减小。
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