阵列基板的制备方法、装置及显示面板
阅读：1发布：2021-01-27
专利汇可以提供阵列基板的制备方法、装置及显示面板专利检索，专利查询，专利分析的服务。并且本 发明 公开了一种阵列 基板 的制备方法，包括以下步骤：在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和 光刻 胶 层；基于单缝隙掩膜板对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层；去除 沟道 区域的光刻胶，以在所述沟道区域内露出所述金属层；通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板。本发明还公开了一种阵列基板的制备装置以及 显示面板 。本发明通过实现在防止形成的 薄膜 晶体管沟道宽度过大的同时，亦能防止沟道区域内的 硅 层剩余厚度偏大，从而提高了 薄膜晶体管 阵列基板的 稳定性 。，下面是阵列基板的制备方法、装置及显示面板专利的具体信息内容。
1.一种阵列基板的制备方法，其特征在于，所述阵列基板的制备方法包括以下步骤：
在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和光刻胶层；
基于单缝隙掩膜板对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层；
去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层；
通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板。
2.如权利要求1所述的阵列基板的制备方法，其特征在于，所述通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板的步骤包括：
通过第一混合气体对所述金属层进行干蚀刻，以形成所述金属层的源电极和漏电极；
通过第二混合气体对所述有源层进行干蚀刻；
去除剩余的所述光刻胶层，以形成阵列基板。
3.如权利要求2所述的阵列基板的制备方法，其特征在于，所述第一混合气体包括六氟化硫气体、三氯化硼气体和氯气。
4.如权利要求2所述的阵列基板的制备方法，其特征在于，所述有源层包括非晶硅层和掺杂型非晶硅层，所述通过第二混合气体对所述有源层进行干蚀刻的步骤包括：
通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度。
5.如权利要求2或4所述的阵列基板的制备方法，其特征在于，所述第二混合气体包括六氟化硫气体、氯气和氦气。
6.如权利要求1所述的阵列基板的制备方法，其特征在于，所述基于单缝隙掩膜板对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层的步骤包括：
基于所述单缝隙掩膜板对所述光刻胶层进行曝光，以去除曝光区域的光刻胶，并降低半曝光区域的所述光刻胶层的厚度，以形成所述沟道区域；
对所述光刻胶层剩余覆盖范围外的所述金属层进行湿蚀刻；
对所述光刻胶层剩余覆盖范围外的所述有源层进行干蚀刻。
7.如权利要求1所述的阵列基板的制备方法，其特征在于，所述去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层的步骤包括：
通过灰化工艺除去所述沟道区域的所述光刻胶，以在所述沟道区域内露出所述金属层。
8.如权利要求1所述的阵列基板的制备方法，其特征在于，所述通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板的步骤之后，还包括：
在所述阵列基板上形成包括钝化过孔的钝化层，以及形成通过所述钝化过孔的像素电极。
9.一种阵列基板的制备装置，其特征在于，所述阵列基板的制备装置包括存储器、处理器及存储在所述存储器上并可在所述处理器上运行的阵列基板的制备程序，所述阵列基板的制备程序被所述处理器执行时实现如权利要求1至8中任一项所述的阵列基板的制备方法的步骤。
10.一种显示面板，其特征在于，所述显示面板包括阵列基板，所述阵列基板由权利要求1至8中任一项所述的阵列基板的制备方法形成。
阵列基板的制备方法、装置及显示面板
技术领域
背景技术
[0002] 阵列基板在4-Mask四道光刻工艺制程中，由于光阻以及曝光的局限性，常见的基于HTM半色调掩膜板(Half Tone Mask)的曝光设计(主要为薄膜晶体管沟道区域处)会使得经过曝光的光刻胶光罩形成的凹槽较为平缓，即光罩上HTM开口宽度较大可以保证有源层或者非晶硅层在沟道区域内的剩余厚度达到需求，但会导致上开口较大，引起最终藉由2W2D制程(two wet+two dry)后形成的TFT薄膜晶体管沟道较大，容易引发短路问题；但若缩小光罩上HTM的开口宽度，又会导致有源层或者非晶硅层在沟道区域内的剩余厚度偏大，容易引起漏电问题。
发明内容
[0003] 本发明的主要目的在于提供一种阵列基板的制备方法、装置以及显示面板，实现在防止形成的TFT薄膜晶体管(Thin Film Transistor)沟道宽度过大的同时，亦能防止沟道区域内的硅层剩余厚度偏大，从而提高了薄膜晶体管阵列基板的稳定性。
[0004] 为实现上述目的，本发明提供一种阵列基板的制备方法，所述阵列基板的制备方法包括以下步骤：
[0005] 在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和光刻胶层；
[0006] 基于单缝隙掩膜板，对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层；
[0007] 去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层；
[0008] 通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板。
[0009] 可选地，所述通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板的步骤包括：
[0011] 通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板。
[0012] 可选地，其特征在于，所述基于所述单缝隙掩膜板，通过第一混合气体对所述金属层进行干蚀刻的步骤包括：
[0013] 通过包括SF6六氟化硫气体、BCl3三氯化硼气体和Cl2氯气的所述第一混合气体对所述金属层进行干蚀刻。
[0014] 可选地，所述通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层的步骤包括：
[0015] 通过包括SF6六氟化硫气体、Cl2氯气和He氦气的所述第二混合气体对所述有源层进行干蚀刻；
[0016] 采用灰化工艺去除剩余的所述光刻胶层。
[0017] 可选地，所述有源层包括非晶硅层和掺杂型非晶硅层，所述通过第二混合气体对所述有源层进行干蚀刻的步骤包括：
[0018] 通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度。
[0019] 可选地，所述基于单缝隙掩膜板对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层的步骤包括：
[0020] 基于所述单缝隙掩膜板对所述光刻胶层进行曝光，以去除曝光区域的光刻胶，并降低半曝光区域的所述光刻胶层的厚度，以形成所述沟道区域；
[0022] 对所述光刻胶层剩余覆盖范围外的所述有源层进行干蚀刻。
[0023] 可选地，所述去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层的步骤包括：
[0024] 通过灰化工艺除去所述沟道区域的所述光刻胶，以在所述沟道区域内露出所述金属层。
[0025] 可选地，所述通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板的步骤之后，还包括：
[0027] 为实现上述目的，本发明还提供一种阵列基板的制备装置，所述阵列基板的制备装置包括：
[0028] 所述阵列基板的制备装置包括存储器、处理器及存储在所述存储器上并可在所述处理器上运行的阵列基板的制备程序，所述阵列基板的制备程序被所述处理器执行时实现如上述阵列基板的制备方法的步骤。
[0029] 为实现上述目的，本发明还提供一种显示面板，所述显示面板包括阵列基板，所述阵列基板由上述阵列基板的制备方法形成。
[0030] 本发明提供的阵列基板的制备方法、阵列基板的制备装置以及显示面板，在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和光刻胶层；基于单缝隙掩膜板对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层；去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层；通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板。这样，实现在防止形成的TFT薄膜晶体管沟道宽度过大的同时，亦能防止沟道区域内的硅层剩余厚度偏大，从而提高了薄膜晶体管阵列基板的稳定性。附图说明
[0032] 图2为本发明阵列基板的制备方法的一实施例的流程示意图；
[0033] 图3为本发明阵列基板的制备方法的另一实施例的流程示意图；
[0034] 图4为本发明阵列基板的制备方法的又一实施例的流程示意图；
[0035] 图5为本发明阵列基板的制备方法的又一实施例的流程示意图。
[0036] 本发明目的的实现、功能特点及优点将结合实施例，参照附图做进一步说明。
具体实施方式
[0037] 应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
[0038] 本发明提供一种阵列基板的制备方法，实现在防止形成的TFT薄膜晶体管沟道宽度过大的同时，亦能防止沟道区域内的硅层剩余厚度偏大，从而提高了薄膜晶体管阵列基板的稳定性。
[0039] 如图1所示，图1是本发明实施例方案涉及的实施例终端的硬件运行环境示意图；
[0040] 本发明实施例终端可以是阵列基板的制备装置。
[0041] 如图1所示，该终端可以包括：处理器1001，例如CPU中央处理器(central processing unit)，存储器1002，通信总线1003。其中，通信总线1003用于实现该终端中各组成部件之间的连接通信。存储器1002可以是高速RAM随机存储器(random-access
memory)，也可以是稳定的存储器(non-volatile memory)，例如磁盘存储器。存储器1002可选的还可以是独立于前述处理器1001的存储装置。
memory)，也可以是稳定的存储器(non-volatile memory)，例如磁盘存储器。存储器1002可选的还可以是独立于前述处理器1001的存储装置。
[0042] 本领域技术人员可以理解，图1中示出的终端的结构并不构成对本发明实施例终端的限定，可以包括比图示更多或更少的部件，或者组合某些部件，或者不同的部件布置。
[0043] 如图1所示，作为一种计算机存储介质的存储器1002中可以包括阵列基板的制备程序。
[0044] 在图1所示的终端中，处理器1001可以用于调用存储器1002中存储的阵列基板的制备程序，并执行以下操作：
[0045] 在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和光刻胶层；
[0046] 基于单缝隙掩膜板，对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层；
[0047] 去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层；
[0048] 通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板。
[0049] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0050] 通过第一混合气体对所述金属层进行干蚀刻，以形成所述金属层的源电极和漏电极；
[0051] 通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板。
[0052] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0053] 通过包括SF6、BCl3和Cl2的所述第一混合气体对所述金属层进行干蚀刻。
[0054] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0055] 通过包括SF6、Cl2和He的所述第二混合气体对所述有源层进行干蚀刻；
[0056] 采用灰化工艺去除剩余的所述光刻胶层。
[0057] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0058] 通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度。
[0059] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0060] 基于所述单缝隙掩膜板对所述光刻胶层进行曝光，以去除曝光区域的光刻胶，并降低半曝光区域的所述光刻胶层的厚度，以形成所述沟道区域；
[0061] 对所述光刻胶层剩余覆盖范围外的所述金属层进行湿蚀刻；
[0062] 对所述光刻胶层剩余覆盖范围外的所述有源层进行干蚀刻。
[0063] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0064] 通过灰化工艺除去所述沟道区域的所述光刻胶，以在所述沟道区域内露出所述金属层。
[0065] 进一步地，处理器1001可以调用存储器1002中存储的阵列基板的制备程序，还执行以下操作：
[0066] 在所述阵列基板上形成包括钝化过孔的钝化层，以及形成通过所述钝化过孔的像素电极。
[0067] 参照图2，在一实施例中，所述阵列基板的制备方法包括：
[0068] 步骤S10、在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和光刻胶层。
[0069] 步骤S20、基于单缝隙掩膜板，对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层。
[0070] 本实施例中，可以是在基于4-Mask(四道光刻制程)制造阵列基板。在制造薄膜晶体管基板时，在衬底基板上形成栅极，并图形化衬底基板和栅极，然后在衬底基板和栅极上采用化学气相法沉积形成覆盖栅极的栅极绝缘层，并在栅极绝缘层上依次沉积形成有源层、金属层和光刻胶层。
[0071] 需要说明的是，所述有源层可以是包括非晶硅层和掺杂型非晶硅层，所述掺杂型非晶硅层设于所述非晶硅层上，可选地，所述掺杂型非晶硅层为N型掺杂非晶硅层。
[0072] 所述单缝隙掩膜板(Single Slit Mask，SSM)可以是U型单缝隙掩膜板，也可以是条型单缝隙掩膜板，在单缝隙掩膜板为U型单缝隙掩膜板时，与沟道区域对应的开口宽度可以是1μm、1.5μm、2μm、2.5μm、3μm、3.5μm、4μm、4.5μm或5μm；在在单缝隙掩膜板为条型单缝隙掩膜板时，与沟道区域对应的开口宽度可以是1μm、1.5μm、2μm、2.5μm、3μm或3.5μm。需要说明的是，基于单缝隙掩膜板制备阵列基板的过程中，能够实现精准蚀刻光刻胶层，使形成的沟道区域更为精密，避免形成的沟道区域的宽度过大。
[0073] 利用所述单缝隙掩膜板，通过曝光机对所述光刻胶层进行曝光，以去除曝光区域的光刻胶，并降低半曝光区域对应的所述光刻胶层的厚度，以形成所述沟道区域。
[0075] 基于利用单缝隙掩膜板制备的光刻胶层，基于SF6和Cl2，对所述光刻胶层剩余覆盖范围外的所述有源层进行干蚀刻，以去掉曝光区域的有源层。
[0076] 步骤S30、去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层。
[0077] 步骤S40、通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板。
[0078] 可选地，所述阵列基板为背刻沟道型阵列基板。
[0079] 本实施例中，在去除曝光区域的金属层和有源层后，采用灰化工艺去除与单缝隙掩膜板半曝光区域对应的沟道区域内的光刻胶，以在所述沟道区域内露出所述金属层。
[0080] 基于利用单缝隙掩膜板制备的，以及去除了沟道区域对应范围内的光刻胶的光刻胶层，通过第一混合气体对所述金属层进行干蚀刻，以形成所述金属层的源电极和漏电极，所述金属层的材质可以是锰，或者以锰为主体的合金，所述第一混合气体包括SF6、BCl3和Cl2。需要说明的是，在蚀刻金属层时，采用第一混合气体对金属层进行干蚀刻，能够减小在蚀刻金属层时产生的临界尺寸偏差值(Critical Dimension Bias)。
[0081] 基于利用单缝隙掩膜板制备的，以及去除了沟道区域对应范围内的光刻胶的光刻胶层，通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板，其中，所述第二混合气体包括SF6、Cl2和He，所述有源层包括非晶硅层和掺杂型非晶硅层，所述非晶硅层可以是A-Si材质，所述掺杂型非晶硅层可以是N型掺杂非晶硅层，也可以是P型掺杂非晶硅层。
[0082] 需要说明的是，在蚀刻沟道区域内的有源层时，通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度，并形成阵列基板沟道区域的开口宽度为预设宽度。所述预设厚度可以为 可选地，预设厚度可以为或
所述预设宽度可以是小于4.5μm，或者小于4μm。
所述预设宽度可以是小于4.5μm，或者小于4μm。
[0083] 这样，通过实现有效调控TFT沟道宽度和非晶硅层的剩余厚度，避免薄膜晶体管容易引发短路或漏电的问题，从而提高了制备得到的薄膜晶体管阵列基板的稳定性。
[0084] 这样，除了能有效调控TFT沟道宽度和非晶硅层的剩余厚度的同时，也能够有效去除曝光区域和半曝光区域内的有源层的硅层残留。
[0085] 在对有源层和金属层进行图形化处理完成后，采用灰化工艺去除剩余的所述光刻胶层，以形成阵列基板。当然，基于所述阵列基板，在阵列基板上形成包括钝化过孔的钝化层，以及形成通过所述钝化过孔的像素电极，即可制备得到薄膜晶体管基板。
[0086] 在制备得到薄膜晶体管阵列基板后，基于该薄膜晶体管阵列基板制造显示面板。
[0087] 在一实施例中，在衬底基板上形成栅极、栅极绝缘层、有源层、金属层和光刻胶层；基于单缝隙掩膜板对所述光刻胶层进行曝光，并图形化所述金属层和所述有源层；去除沟道区域的光刻胶，以在所述沟道区域内露出所述金属层；通过干蚀刻图形化所述金属层和所述有源层，形成薄膜晶体管基体结构。这样，基于单缝隙掩模形成沟道宽度适宜的光刻胶层，以及基于该光刻胶层，通过干法蚀刻精准刻蚀薄膜晶体管基体结构沟道区域内的金属层，实现在防止形成的TFT沟道宽度过大的同时，亦能防止沟道区域内的硅层剩余厚度偏大，从而提高了薄膜晶体管阵列基板的稳定性。
[0088] 在另一实施例中，如图3所示，在上述图2所示的实施例基础上，所述通过干蚀刻图形化所述金属层和所述有源层，形成阵列基板的步骤包括：
[0089] 步骤S50、通过第一混合气体对所述金属层进行干蚀刻，以形成所述金属层的源电极和漏电极。
[0090] 步骤S60、通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板。
[0091] 本实施例中，通过第一混合气体对所述金属层进行干蚀刻，以形成所述金属层的源电极和漏电极，所述金属层的材质可以是锰，或者以锰为主体的合金，所述第一混合气体包括SF6、BCl3和Cl2。
[0092] 通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板，其中，所述第二混合气体包括SF6、Cl2和He，所述有源层包括非晶硅层和掺杂型非晶硅层，所述非晶硅层可以是A-Si材质，所述掺杂型非晶硅层可以是N型掺杂非晶硅层，也可以是P型掺杂非晶硅层。
[0093] 需要说明的是，在蚀刻沟道区域内的有源层时，通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度，并形成阵列基板沟道区域的开口宽度为预设宽度。所述预设厚度可以为 可选地，预设厚度可以为或
所述预设宽度可以是小于4.5μm，或者小于4μm。
所述预设宽度可以是小于4.5μm，或者小于4μm。
[0094] 需要说明的是，在实现薄膜晶体管基板在结构沟道区域的开口宽度，即TFT沟道宽度小于4μm，或者小于4.5μm时，能够提高TFT的开态电流，从而提高薄膜晶体管的稳定性。
[0095] 在对有源层和金属层进行图形化处理完成后，采用灰化工艺去除剩余的所述光刻胶层，以形成阵列基板。当然，基于所述阵列基板，在阵列基板上形成包括钝化过孔的钝化层，以及形成通过所述钝化过孔的像素电极，即可制备得到薄膜晶体管基板。
[0096] 在一实施例中，通过第一混合气体对所述金属层进行干蚀刻，以形成所述金属层的源电极和漏电极；通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板。这样，精准蚀刻阵列基板的有源层及金属层，能有效调控TFT沟道宽度和非晶硅层的剩余厚度的同时，也能够有效去除曝光区域和半曝光区域内的有源层的硅层残留。
[0097] 在又一实施例中，如图4所示，在上述图2至图3的实施例基础上，所述通过第一混合气体对所述金属层进行干蚀刻的步骤包括：
[0098] 步骤S51、通过包括SF6、BCl3和Cl2的所述第一混合气体对所述金属层进行干蚀刻。
[0099] 本实施例中，在蚀刻沟道区域内的金属层时，通过基于SF6、BCl3和Cl2对金属层进行干蚀刻，从而实现1W1D制程(one wet+one dry)，而不同于常规对沟道区域内的金属层进行湿蚀刻的方法，即2W2D制程(two wet+two dry)，能够节省阵列基板在4-Mask的制备流程，提高了阵列基板的制备效率。
[0100] 在又一实施例中，如图5所示，在上述图2至图4的实施例基础上，所述有源层包括非晶硅层和掺杂型非晶硅层，所述通过第二混合气体对所述有源层进行干蚀刻的步骤包括：
[0101] 步骤S70、通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度。
[0102] 本实施例中，通过第二混合气体对所述有源层进行干蚀刻，以及去除剩余的所述光刻胶层，以形成阵列基板，其中，所述第二混合气体包括SF6、Cl2和He，所述有源层包括非晶硅层和掺杂型非晶硅层，所述非晶硅层可以是A-Si材质，所述掺杂型非晶硅层可以是N型掺杂非晶硅层，也可以是P型掺杂非晶硅层。
[0103] 需要说明的是，在蚀刻沟道区域内的有源层时，基于所述单缝隙掩膜板，通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度，并形成阵列基板沟道区域的开口宽度为预设宽度。所述预设厚度可以为 可选地，预设厚度可以为或
所述预设宽度可以是小于4.5μm，或者小于4μm。
所述预设宽度可以是小于4.5μm，或者小于4μm。
[0104] 需要说明的是，在实现薄膜晶体管基板在结构沟道区域的开口宽度，即TFT沟道宽度4μm，或者小于4.5μm时，能够提高TFT的开态电流，从而提高薄膜晶体管的稳定性。
[0105] 在一实施例中，通过所述第二混合气体对所述有源层进行干蚀刻，以去除所述沟道区域内的所述掺杂型非晶硅层，并使所述沟道区域内的所述非晶硅层的层间厚度降低至预设厚度。这样，实现阵列基板的沟道开口宽度和沟道区域内的非晶硅层剩余厚度的可调控。
[0106] 此外，本发明还提出一种阵列基板的制备装置，所述阵列基板的制备装置包括存储器、处理器及存储在存储器上并可在处理器上运行的阵列基板的制备程序，所述处理器执行所述阵列基板的制备程序时实现如以上实施例所述的阵列基板的制备方法的步骤。
[0107] 此外，本发明还提出一种显示面板，所述显示面板包括阵列基板，所述阵列基板由上述阵列基板的制备方法形成。
[0108] 上述本发明实施例序号仅仅为了描述，不代表实施例的优劣。
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