专利汇可以提供控制器专利检索,专利查询,专利分析的服务。并且提出一种在处理器(μC)和至少一个另外的 电路 (ASIC 1,2,n)之间具有被定时的数据传输的 控制器 ,其中该处理器(μC)自己输出时钟(SCKr)。该处理器(μC)借助至少两个时钟输出端(10,11)的输出 信号 来监控该时钟(SCKr)。,下面是控制器专利的具体信息内容。
1.在处理器(μC)和至少一个另外的电路(ASIC 1,2,n)之间具 有被定时的数据传输的控制器,其中所述处理器(μC)输出时钟(SCKr), 其特征在于,配置所述处理器(μC),使得所述处理器(μC)借助所述处 理器(μC)的至少两个时钟输出端(10,11)的输出信号来监控所述时 钟(SCKr);所述至少两个时钟输出端(10,11)被布线,使得根据所述 输出信号生成所述时钟(SCKr),其中所述处理器(μC)通过对振荡器信 号进行分频而生成了所述输出信号。
2.按权利要求1的控制器,其特征在于,所述至少两个时钟输出端 (10,11)被布线,使得所述控制器根据所述输出信号生成监控信号。
3.按权利要求2的控制器,其特征在于,设有异或模块(12),所述 输出信号被分别输送给该异或模块,其中根据所述异或模块(12)的信 号生成所述监控信号。
4.按权利要求1的控制器,其特征在于,所述至少两个时钟输出端 (10,11)被布线,使得将所述输出信号分别引回到所述处理器(μC) 的第一和第二输入端(13,14)上,使得所述处理器(μC)监控所述输 出信号并且根据所述输出信号生成监控信号。
5.按权利要求4的控制器,其特征在于,规定所述至少两个时钟输 出端(10,11)互相进行“或”运算,以便形成所述时钟。
6.按权利要求5的控制器,其特征在于,为了所述至少两个时钟输 出端(10,11)进行“或”运算,分别设有二极管(D1,D2)或“或” 门。
7.按权利要求5或6的控制器,其特征在于,所述时钟(SCKr)被 输送给阻抗变换器和/或放大器(V)。
8.按权利要求1的控制器,其特征在于,所述时钟输出端(10,11) 被分配给不同的端口群。
9.按权利要求4的控制器,其特征在于,所述第一和第二输入端(13, 14)被分配给不同的端口群。
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