一种氮化镓基发光二极管外延片及其制作方法
阅读：1025发布：2020-05-21
专利汇可以提供一种氮化镓基发光二极管外延片及其制作方法专利检索，专利查询，专利分析的服务。并且本 发明 公开了一种氮化镓基发光 二极管 外延 片及其制作方法，属于 半导体 技术领域。外延片包括衬底、低温 缓冲层 、三维成核层、二维恢复层、未掺杂氮化镓层、N型半导体层、有源层和P型半导体层，低温缓冲层、三维成核层和二维恢复层依次层叠在衬底上，未掺杂氮化镓层的第一表面铺设在二维恢复层上，未掺杂氮化镓的第二表面设有多个凹坑，每个凹坑呈倒圆锥状，多个凹坑间隔分布在未掺杂氮化镓层的第二表面上；N型半导体层的第一表面铺设在多个凹坑内和未掺杂氮化镓层的第二表面上，N型半导体层的第二表面为平面，有源层和P型半导体层依次层叠在N型半导体层的第二表面上，第二表面为与第一表面相反的表面。本发明可提高LED的 发光效率 。，下面是一种氮化镓基发光二极管外延片及其制作方法专利的具体信息内容。
1.一种氮化镓基发光二极管外延片，所述氮化镓基发光二极管外延片包括衬底、低温缓冲层、三维成核层、二维恢复层、未掺杂氮化镓层、N型半导体层、有源层和P型半导体层，所述低温缓冲层、所述三维成核层和所述二维恢复层依次层叠在所述衬底上，其特征在于，所述未掺杂氮化镓层的第一表面铺设在所述二维恢复层上，所述未掺杂氮化镓的第二表面设有多个凹坑，每个所述凹坑呈倒圆锥状，所述多个凹坑间隔分布在所述未掺杂氮化镓层的第二表面上，所述未掺杂氮化镓层的第二表面为与所述未掺杂氮化镓层的第一表面相反的表面；所述N型半导体层的第一表面铺设在所述多个凹坑内和所述未掺杂氮化镓层的第二表面上，所述N型半导体层的第二表面为平面，所述有源层和所述P型半导体层依次层叠在所述N型半导体层的第二表面上，所述N型半导体层的第二表面为与所述N型半导体层的第一表面相反的表面；所述凹坑的深度为1.5μm～3.5μm，所述凹坑的开口大小与相邻两个所述凹坑之间的距离之比为8～20，所述凹坑的开口大小为2.5μm～6μm。
2.根据权利要求1所述的氮化镓基发光二极管外延片，其特征在于，相邻两个所述凹坑之间的距离为0.1μm～1μm。
3.根据权利要求1或2所述的氮化镓基发光二极管外延片，其特征在于，所述凹坑的开口大小与所述凹坑的深度之比为0.5～0.75。
4.根据权利要求1或2所述的发光二极管外延片，其特征在于，所述未掺杂氮化镓层的厚度为1.5μm～4μm。
5.一种氮化镓基发光二极管外延片的制作方法，其特征在于，所述制作方法包括：
采用化学气相沉积技术在衬底上依次生长低温缓冲层、三维成核层、二维恢复层和未掺杂氮化镓层；
采用激光刻蚀技术在所述未掺杂氮化镓层的表面形成多个凹坑，每个所述凹坑呈倒圆锥状，所述多个凹坑间隔分布在所述未掺杂氮化镓层的表面上；
采用化学气相沉积技术在所述未掺杂氮化镓层上依次生长N型半导体层、有源层和P型半导体层，所述N型半导体层将所述多个凹坑填平；所述凹坑的深度为1.5μm～3.5μm，所述凹坑的开口大小与相邻两个所述凹坑之间的距离之比为8～20，所述凹坑的开口大小为2.5μm～6μm。
6.根据权利要求5所述的制作方法，其特征在于，所述激光刻蚀的脉冲频率为0.5kHz～
1.5kHz。
7.根据权利要求6所述的制作方法，其特征在于，所述激光刻蚀的功率为0.02w～
0.06w。
一种氮化镓基发光二极管外延片及其制作方法
技术领域
背景技术
[0002] 发光二极管(英文：Light Emitting Diode，简称：LED)是一种能发光的半导体电子元件。LED因具有节能环保、可靠性高、使用寿命长等优点而受到广泛的关注，近年来在背光源和显示屏领域大放异彩，并且开始向民用照明市场进军。对于民用照明来说，光效和使用寿命是主要的衡量标准，因此增加LED的发光效率和提高LED的抗静电能力对于LED的广泛应用显得尤为关键。
[0003] 外延片是LED制备过程中的初级成品。现有的LED外延片包括衬底、缓冲层、N型半导体层、有源层和P型半导体层，缓冲层、N型半导体层、有源层和P型半导体层依次层叠在衬底上。P型半导体层用于提供进行复合发光的空穴，N型半导体层用于提供进行复合发光的电子，有源层用于进行电子和空穴的复合发光，衬底用于为外延材料提供生长表面，缓冲层用于缓解衬底和N型半导体层之间的晶格失配。
[0005] 衬底的材料通常选择蓝宝石，N型半导体层等的材料通常选择氮化镓，蓝宝石和氮化镓为异质材料，两者之间存在较大的晶格失配，晶格失配产生的应力和缺陷会随着外延生长而延伸，影响外延片整体的晶体质量，降低LED的发光效率。缓冲层虽然对晶格失配可以起到缓解作用，但是无法避免晶格失配产生应力和缺陷，导致外延片的晶体质量较差，LED的发光效率还有待提高。
发明内容
[0006] 本发明实施例提供了一种氮化镓基发光二极管外延片及其制作方法，能够解决现有技术异质材料晶格失配产生的应力和缺陷影响外延片晶体质量、导致LED发光效率低的问题。所述技术方案如下：
[0007] 一方面，本发明实施例提供了一种氮化镓基发光二极管外延片，所述氮化镓基发光二极管外延片包括衬底、低温缓冲层、三维成核层、二维恢复层、未掺杂氮化镓层、N型半导体层、有源层和P型半导体层，所述低温缓冲层、所述三维成核层和所述二维恢复层依次层叠在所述衬底上，所述未掺杂氮化镓层的第一表面铺设在所述二维恢复层上，所述未掺杂氮化镓的第二表面设有多个凹坑，每个所述凹坑呈倒圆锥状，所述多个凹坑间隔分布在所述未掺杂氮化镓层的第二表面上，所述未掺杂氮化镓层的第二表面为与所述未掺杂氮化镓层的第一表面相反的表面；所述N型半导体层的第一表面铺设在所述多个凹坑内和所述未掺杂氮化镓层的第二表面上，所述N型半导体层的第二表面为平面，所述有源层和所述P型半导体层依次层叠在所述N型半导体层的第二表面上，所述N型半导体层的第二表面为与所述N型半导体层的第一表面相反的表面。
[0008] 可选地，所述凹坑的深度为1.5μm～3.5μm。
[0009] 可选地，所述凹坑的开口大小为2.5μm～6μm。
[0010] 可选地，相邻两个所述凹坑之间的距离为0.1μm～1μm。
[0011] 可选地，所述凹坑的开口大小与相邻两个所述凹坑之间的距离之比为8～20。
[0012] 可选地，所述凹坑的开口大小与所述凹坑的深度之比为0.5～0.75。
[0013] 可选地，所述未掺杂氮化镓层的厚度为1.5μm～4μm。
[0014] 另一方面，本发明实施例提供了一种氮化镓基发光二极管外延片的制作方法，所述制作方法包括：
[0017] 采用化学气相沉积技术在所述未掺杂氮化镓层上依次生长N型半导体层、有源层和P型半导体层，所述N型半导体层将所述多个凹坑填平。
[0019] 可选地，所述激光刻蚀的功率为0.02w～0.06w。
[0020] 本发明实施例提供的技术方案带来的有益效果是：
[0021] 通过在未掺杂氮化镓层的表面间隔设置多个倒圆锥状的凹坑，并用N型半导体层填平，N型半导体层生长在未掺杂氮化镓层凹凸不平的表面上，可以有效释放蓝宝石和氮化镓之间晶格失配产生的应力，同时凹坑呈倒圆锥状，蓝宝石和氮化镓之间晶格失配产生的缺陷延伸到凹坑内生长的N型半导体层上时可以相互抵消，降低102半峰宽，有效提高外延片整体的晶体质量，提高LED的发光效率，增强光致发光强度。而且倒圆锥状的凹坑类似凹凸镜，可以改变光线的传播方向，提高LED的正向出光。附图说明
[0022] 为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
[0023] 图1是本发明实施例提供的一种发光二极管外延片的结构示意图；
[0024] 图2是本发明实施例提供的未掺杂氮化镓层的俯视图；
[0025] 图3是本发明实施例提供的一种氮化镓基发光二极管外延片的制作方法的流程图；
[0026] 图4a-图4c是本发明实施例提供的氮化镓基发光二极管外延片在制作方法的执行过程中的结构示意图。
具体实施方式
[0027] 为使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明实施方式作进一步地详细描述。
[0028] 本发明实施例提供了一种发光二极管外延片，图1为本发明实施例提供的一种发光二极管外延片的结构示意图，参见图1，该发光二极管外延片包括衬底10、低温缓冲层21、三维成核层22、二维恢复层23、未掺杂氮化镓层24、N型半导体层30、有源层40和P型半导体层50。低温缓冲层21、三维成核层22和二维恢复层23依次层叠在衬底10上，未掺杂氮化镓层24的第一表面铺设在二维恢复层23上。未掺杂氮化镓层24的第二表面设有多个凹坑240，图
2为未掺杂氮化镓层的俯视图，参见图2，每个凹坑240呈倒圆锥状，多个凹坑240间隔分布在未掺杂氮化镓层24的第二表面上，未掺杂氮化镓层24的第二表面为与未掺杂氮化镓层24的第一表面相反的表面。如图1所示，N型半导体层30的第一表面铺设在多个凹坑240内和未掺杂氮化镓层24的第二表面上，N型半导体层30的第二表面为平面，有源层40和P型半导体层
50依次层叠在N型半导体层30的第二表面上，N型半导体层30的第二表面为与N型半导体层
30的第一表面相反的表面。
2为未掺杂氮化镓层的俯视图，参见图2，每个凹坑240呈倒圆锥状，多个凹坑240间隔分布在未掺杂氮化镓层24的第二表面上，未掺杂氮化镓层24的第二表面为与未掺杂氮化镓层24的第一表面相反的表面。如图1所示，N型半导体层30的第一表面铺设在多个凹坑240内和未掺杂氮化镓层24的第二表面上，N型半导体层30的第二表面为平面，有源层40和P型半导体层
50依次层叠在N型半导体层30的第二表面上，N型半导体层30的第二表面为与N型半导体层
30的第一表面相反的表面。
[0029] 本发明实施例通过在未掺杂氮化镓层的表面间隔设置多个倒圆锥状的凹坑，并用N型半导体层填平，N型半导体层生长在未掺杂氮化镓层凹凸不平的表面上，可以有效释放蓝宝石和氮化镓之间晶格失配产生的应力，同时凹坑呈倒圆锥状，蓝宝石和氮化镓之间晶格失配产生的缺陷延伸到凹坑内生长的N型半导体层上时可以相互抵消，降低102半峰宽，有效提高外延片整体的晶体质量，提高LED的发光效率，增强光致发光强度。而且倒圆锥状的凹坑类似凹凸镜，可以改变光线的传播方向，提高LED的正向出光。
[0030] 可选地，如图1所示，凹坑的深度h可以为1.5μm～3.5μm。其中，凹坑的深度为凹坑上的各个点与未掺杂氮化镓层的第二表面之间距离的最大值，即圆锥的高度。
[0031] 如果凹坑的深度小于1.5μm，则可能由于凹坑的深度太小而无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力、抵消蓝宝石和氮化镓之间晶格失配产生的缺陷；如果凹坑的深度大于3.5μm，则可能由于凹坑的深度太大而引入其它缺陷，同时也需要更多的N型半导体层材料填平凹坑，浪费材料，降低生产效率，增加制作成本。
[0032] 可选地，如图1所示，凹坑的开口大小r可以为2.5μm～6μm。其中，凹坑的开口大小为一个凹坑在与未掺杂氮化镓层的第二表面同一平面的所有点中两点之间的最大距离，即圆锥的底面直径。
[0033] 如果凹坑的开口大小小于2.5μm，则可能由于凹坑的开口太小而无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力、抵消蓝宝石和氮化镓之间晶格失配产生的缺陷；如果凹坑的开口大小大于6μm，则可能由于凹坑的开口太大而引入其它缺陷，同时也需要更多的N型半导体层材料填平凹坑，浪费材料，降低生产效率，增加制作成本。
[0034] 可选地，如图1所示，相邻两个凹坑之间的距离s可以为0.1μm～1μm。其中，相邻两个凹坑之间的距离为相邻两个凹坑上的点之间的最小距离。
[0035] 如果相邻两个凹坑之间的距离小于0.1μm，则可能由于相邻两个凹坑之间的距离太小而无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力；如果相邻两个凹坑之间的距离大于1μm，则可能由于相邻两个凹坑之间的距离太大而造成凹坑的数量较少，无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力、抵消蓝宝石和氮化镓之间晶格失配产生的缺陷。
[0036] 可选地，凹坑的开口大小与相邻两个凹坑之间的距离之比可以为8～20。
[0037] 如果凹坑的开口大小与相邻两个凹坑之间的距离之比小于8，则可能由于凹坑的开口大小与相邻两个凹坑之间的距离之比太小而造成凹坑的数量较少，无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力、抵消蓝宝石和氮化镓之间晶格失配产生的缺陷；如果凹坑的开口大小与相邻两个凹坑之间的距离之比大于20，则可能由于凹坑的开口大小与相邻两个凹坑之间的距离之比太大而造成相邻两个凹坑之间的距离太小，无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力。
[0038] 可选地，凹坑的开口大小与凹坑的深度之比可以为0.5～0.75。
[0039] 如果凹坑的开口大小与凹坑的深度之比小于0.5，或者凹坑的开口大小与凹坑的深度之比大于0.75，则可能由于凹坑的开口大小与凹坑的深度之比不匹配，对光线的传播方向出现偏差，无法有效提高LED的正向出光。
[0040] 可选地，如图1所示，未掺杂氮化镓层的厚度H可以为1.5μm～4μm。其中，未掺杂氮化镓层的厚度为未掺杂氮化镓层的第一表面和未掺杂氮化镓层的第二表面之间的距离。
[0041] 如果未掺杂氮化镓层的厚度小于1.5μm，则可能由于未掺杂氮化镓层的厚度太小而无法缓解蓝宝石衬底和N型半导体层之间的晶格失配；如果未掺杂氮化镓层的厚度大于4μm，则可能由于未掺杂氮化镓层的厚度太大而造成材料的浪费，增加制作成本。
[0042] 具体地，衬底10的材料可以采用蓝宝石。低温缓冲层21、三维成核层22和二维恢复层23的材料可以采用氮化镓(GaN)。N型半导体层30的材料可以采用N型掺杂的氮化镓。有源层40可以包括多个量子阱和多个量子垒，多个量子阱和多个量子垒交替层叠设置；量子阱的材料可以采用氮化铟镓(InGaN)，量子垒的材料可以采用氮化镓。P型半导体层50的材料可以采用P型掺杂的氮化镓。
[0044] 具体地，N型半导体层30中铝组分的摩尔含量可以为0.05～0.3。
[0045] 如果N型半导体层中铝组分的摩尔含量小于0.05，则可能由于N型半导体层中铝的掺杂浓度太低而无法有效阻挡应力和缺陷继续延伸，达不到提高LED发光效率的效果；如果N型半导体层中铝组分的摩尔含量大于0.3，则可能由于N型半导体层中铝的掺杂浓度太高而导致新的晶格失配，影响外延片的晶格质量，降低LED的发光效率。
[0046] 进一步地，N型半导体层30中铝的掺杂浓度可以保持不变，也可以沿外延片的层叠方向逐渐变化，如逐渐升高、逐渐降低、先逐渐升高再逐渐降低等。
[0047] 在具体实现时，会首先在衬底上低温生长一层较薄的氮化镓，称为低温缓冲层；再在低温缓冲层进行氮化镓的纵向生长，形成多个相互独立的三维岛状结构，称为三维成核层；然后在所有三维岛状结构上和各个三维岛状结构之间进行氮化镓的横向生长，形成二维平面结构，称为二维恢复层；最后在二维生长层上高温生长一层较厚的氮化镓，称为未掺杂氮化镓层。
[0048] 进一步地，量子阱的数量与量子垒的数量相同，量子垒的数量可以为5个～11个。N型半导体层30中N型掺杂剂的掺杂浓度可以为1018cm-3～1020cm-3；P型半导体层50中P型掺杂18 -3 20 -3
剂的掺杂浓度可以为10 cm ～10 cm 。
剂的掺杂浓度可以为10 cm ～10 cm 。
[0049] 更进一步地，N型半导体层30中N型掺杂剂的掺杂浓度可以保持不变，也可以沿外延片的层叠方向逐渐变化，如逐渐升高、逐渐降低、先逐渐升高再逐渐降低等。
[0050] 可选地，如图1所示，该发光二极管外延片还可以包括应力释放层60，应力释放层60设置在N型半导体层30和有源层40之间，以释放外延生长过程中产生的应力和缺陷，提高有源层的生长质量，进而提高LED的发光效率。
[0051] 在本实施例中，应力释放层60铺设在凸起部31和凹陷部32上，有源层40铺设在应力释放层60上，应力释放层60、有源层40和P型半导体层50的厚度之和小于凸起部31的高度。
[0052] 具体地，应力释放层60可以包括多个第一子层和多个第二子层，多个第一子层和多个第二子层交替层叠设置；第一子层的材料可以采用氮化铟镓，第二子层的材料可以采用氮化镓。
[0053] 可选地，如图1所示，该发光二极管外延片还可以包括电子阻挡层70，电子阻挡层70设置在有源层40和P型半导体层50之间，以避免电子跃迁到P型半导体层中与空穴进行非辐射复合，影响LED的发光效率。
[0054] 在本实施例中，电子阻挡层70铺设在有源层40上，P型半导体层50铺设在电子阻挡层70上，有源层40、电子阻挡层70和P型半导体层50的厚度之和小于凸起部31的高度。
[0055] 具体地，电子阻挡层70的材料可以采用P型掺杂的氮化铝镓(AlGaN)。
[0056] 进一步地，电子阻挡层70的材料可以采用P型掺杂的AlyGa1-yN，0.1＜y＜0.5。
[0057] 优选地，如图1所示，该发光二极管外延片还可以包括低温P型层80，低温P型层80设置在有源层40和电子阻挡层70之间，以缓解P型半导体层50高温生长对有源层的影响。
[0058] 在本实施例中，低温P型层80铺设在有源层40上，电子阻挡层70上铺设在低温P型层80上，有源层40、低温P型层80、电子阻挡层70和P型半导体层50的厚度之和小于凸起部31的高度。
[0059] 具体地，低温P型层80的材料可以采用P型掺杂的氮化镓。
[0060] 进一步地，低温P型层80中P型掺杂剂的掺杂浓度可以为1018cm-3～1020cm-3。
[0062] 具体地，P型接触层90的材料可以采用P型掺杂的氮化铟镓。
[0063] 本发明实施例提供了一种氮化镓基发光二极管外延片的制作方法，适用于制作图1所示的氮化镓基发光二极管外延片。图3为本发明实施例提供的发光二极管外延片的制作方法的流程图，参见图3，该制作方法包括：
[0064] 步骤101：采用化学气相沉积技术在衬底上依次生长低温缓冲层、三维成核层、二维恢复层和未掺杂氮化镓层。
[0065] 图4a为本发明实施例提供的氮化镓基发光二极管外延片在步骤101执行之后的结构示意图。其中，10表示衬底，21表示低温缓冲层，22表示三维成核层，23表示二维恢复层，24表示未掺杂氮化镓层。如图4a所示，低温缓冲层21、三维成核层22、二维恢复层23和未掺杂氮化镓层24依次层叠在衬底10的一个表面上。
[0066] 可选地，该制作方法还可以包括：
[0067] 将衬底在氢气气氛中退火1分钟～10分钟；
[0068] 在1000℃～1200℃的温度下进行氮化处理。
[0069] 进一步地，衬底可以采用[0001]晶向的蓝宝石。
[0070] 步骤102：采用激光刻蚀技术在未掺杂氮化镓层的表面形成多个凹坑，每个凹坑呈倒圆锥状，多个凹坑间隔分布在未掺杂氮化镓层的表面上。
[0071] 图4b为本发明实施例提供的氮化镓基发光二极管外延片在步骤102执行之后的结构示意图。其中，240表示凹坑。如图4b所示，多个凹坑240形成在未掺杂氮化镓层24的同一个表面上，未掺杂氮化镓层24形成凹坑240的表面与未掺杂氮化镓层24设置在二维恢复层23上的表面相反。
[0072] 本发明实施例通过激光刻蚀技术直接在未掺杂氮化镓层的表面形成倒圆锥状的凹坑，操作简单方便，实现效果好。
[0073] 在具体实现时，可以通过在激光源和未掺杂氮化镓层之间设置掩膜板，掩膜板上设有间隔排列的多个通孔。同时移动掩膜板和衬底，当激光射到掩膜板上时无法通过，掩膜板下对应的未掺杂氮化镓层保持原状；当激光射到掩膜板上的通孔时，激光通过通孔射到未掺杂氮化镓层上，在未掺杂氮化镓层的表面刻蚀出一个凹坑；最终在未掺杂氮化镓层的表面形成间隔设置的多个凹坑。
[0074] 也可以通过间断开关激光源，同时移动衬底，当激光打开时，射到未掺杂氮化镓层上，在未掺杂氮化镓层的表面刻蚀出一个凹坑；当激光关闭时，正对激光源的未掺杂氮化镓层保持原状；最终也在未掺杂氮化镓层的表面形成间隔设置的多个凹坑。
[0075] 具体地，激光刻蚀的脉冲频率可以为0.5kHz～1.5kHz。
[0076] 另外，凹坑的深度、开口大小等尺寸大小可以通过控制激光刻蚀的功率和时长、衬底的移动速度实现。
[0077] 可选地，激光刻蚀的功率可以为0.02w～0.06w。
[0078] 如果激光刻蚀的功率小于0.02w，则可能由于激光刻蚀的功率太小而造成凹坑的尺寸太小，无法有效释放蓝宝石和氮化镓之间晶格失配产生的应力、抵消蓝宝石和氮化镓之间晶格失配产生的缺陷；如果激光刻蚀的功率大于0.06w，则可能由于激光刻蚀的功率太大而引入其它缺陷，同时也需要更多的N型半导体层材料填平凹坑，浪费材料，降低生产效率，增加制作成本。
[0079] 例如，激光刻蚀设备可以采用355nm脉冲Nd：YAG激光器，脉冲频率为1kHz，激光功率为0.04w，激光器与外延片之间的距离为5μm～20μm，激光刻蚀速率为2.5*105μm/s～5*105μm/s。
[0080] 可选地，在步骤102之后，该制作方法还可以包括：
[0081] 采用去离子水冲洗未掺杂氮化镓层的表面并甩干，以去除表面残余的氮化镓颗粒和其它附着物。
[0082] 步骤103：采用化学气相沉积技术在未掺杂氮化镓层上依次生长N型半导体层、有源层和P型半导体层，N型半导体层将多个凹坑填平。
[0083] 图4c为本发明实施例提供的氮化镓基发光二极管外延片在执行步骤103之后的结构示意图。其中，30表示N型半导体层，40表示有源层，50表示P型半导体层。如图4c所示，N型半导体层30、有源层40、P型半导体层50铺设在未掺杂氮化镓层24上，N型半导体层30将所有凹坑240填平。
[0084] 可选地，在N型半导体层上生长有源层之前，该制作方法还可以包括：
[0085] 在N型半导体层上生长应力释放层。
[0086] 相应地，有源层在应力释放层上生长。
[0087] 可选地，在有源层上生长P型半导体层之前，该制作方法还可以包括：
[0088] 在有源层上生长电子阻挡层。
[0089] 相应地，P型半导体层在电子阻挡上生长。
[0090] 优选地，在有源层上生长电子阻挡层之前，该制作方法还可以包括：
[0091] 在有源层上生长低温P型层。
[0092] 相应地，电子阻挡层在低温P型层上生长。
[0093] 可选地，在步骤104之后，该制作方法还可以包括：
[0094] 在P型半导体层上生长P型接触层。
[0095] 优选地，在P型半导体层上生长P型接触层之后，该制作方法还可以包括：
[0096] 控制温度为650℃～850℃，持续时间为5分钟～15分钟，在氮气气氛中进行退火处理。
[0097] 需要说明的是，控制温度、压力均是指控制生长外延片的反应腔中的温度、压力。实现时以三甲基镓或三甲基乙作为镓源，高纯氮气作为氮源，三甲基铟作为铟源，三甲基铝作为铝源，N型掺杂剂选用硅烷，P型掺杂剂选用二茂镁。
[0098] 本发明实施例提供了另一种发光二极管外延片的制作方法，为图3所示的制作方法的一种具体实现，该制作方法包括：
[0099] 步骤201：控制温度为400℃～600℃，压力为100torr～300torr，在衬底上生长厚度为15nm～35nm的低温缓冲层。
[0100] 步骤202：控制温度为1000℃～1100℃，压力为100torr～500torr，在低温缓冲层上生长厚度为100nm～500nm的三维成核层。
[0101] 步骤203：控制温度为1000℃～1200℃，压力为100torr～500torr，在三维成核层上生长厚度为500nm～800nm的二维恢复层。
[0102] 步骤204：控制温度为1000℃～1200℃，压力为100torr～500torr，在二维恢复层上生长厚度为800nm～1200nm的未掺杂氮化镓层。
[0103] 步骤205：采用激光刻蚀技术在未掺杂氮化镓层的表面形成多个凹坑，每个凹坑呈倒圆锥状，多个凹坑间隔分布在未掺杂氮化镓层的表面上。
[0104] 步骤206：控制温度为1000℃～1200℃，压力为100torr～400torr，在未掺杂氮化镓层上生长厚度为1μm～3μm的N型半导体层，N型半导体层将多个凹坑填平。
[0105] 步骤207：控制温度为800℃～1000℃，压力为100torr～500torr，在N型半导体层上生长厚度为5nm～10nm的应力释放层。
[0106] 步骤208：控制压力为100torr～500torr，在应力释放层上生长有源层，有源层包括交替生长的多个量子阱和多个量子垒，量子阱的厚度为3nm，量子阱的生长温度为720℃～829℃，量子垒的厚度为9nm～12nm，量子垒的生长温度为850℃～959℃。
[0107] 步骤209：控制温度为600℃～800℃，压力为200torr～600torr，在有源层上生长厚度为10nm～50nm的低温P型层。
[0108] 步骤210：控制温度为850℃～950℃，压力为100torr～500torr，在低温P型层上生长厚度为50nm～150nm的电子阻挡层。
[0109] 步骤211：控制温度为800℃～1000℃，压力为100torr～300torr，在电子阻挡层上生长厚度为100nm～500nm的P型半导体层。
[0110] 步骤212：控制温度为850℃～1050℃，压力为100torr～300torr，在P型半导体层上生长厚度为10nm～100nm的P型接触层。
[0111] 本发明实施例提供了又一种发光二极管外延片的制作方法，为图3所示的制作方法的另一种具体实现，该制作方法包括：
[0112] 步骤301：控制温度为400℃～600℃，压力为400torr～600torr，在衬底上生长厚度为15nm～40nm的低温缓冲层。
[0113] 步骤302：控制温度为1000℃～1040℃，压力为400torr～600torr，在低温缓冲层上生长厚度为400nm～600nm的三维成核层。
[0114] 步骤303：控制温度为1040℃～1080℃，压力为400torr～600torr，在三维成核层上生长厚度为500nm～800nm的二维恢复层。
[0115] 步骤304：控制温度为1050℃～1100℃，压力为100torr～500torr，在二维恢复上生长厚度为2μm～5μm的未掺杂氮化镓层。
[0116] 步骤305：采用激光刻蚀技术在未掺杂氮化镓层的表面形成多个凹坑，每个凹坑呈倒圆锥状，多个凹坑间隔分布在未掺杂氮化镓层的表面上。
[0117] 步骤306：控制温度为1000℃～1100℃，压力为100torr～400torr，在未掺杂氮化镓层上生长厚度为1μm～3μm的N型半导体层，N型半导体层将多个凹坑填平，N型半导体层中N型掺杂剂的掺杂浓度为1018cm-3～3*1019cm-3。
[0118] 步骤307：控制温度为800℃～1000℃，压力为100torr～500torr，在N型半导体层上生长厚度为5nm～10nm的应力释放层。
[0119] 步骤308：控制压力为100torr～500torr，在应力释放层上生长有源层，有源层包括交替生长的多个量子阱和多个量子垒，量子阱的厚度为3nm～4nm，量子阱的生长温度为720℃～800℃，量子垒的厚度为9nm～15nm，量子垒的生长温度为900℃～950℃。
[0120] 步骤309：控制温度为750℃～850℃，压力为100torr～500torr，在有源层上生长厚度为30nm～50nm的低温P型层。
[0121] 步骤310：控制温度为900℃～1000℃，压力为200torr～500torr，在低温P型层上生长厚度为50nm～100nm的电子阻挡层。
[0122] 步骤311：控制温度为850℃～950℃，压力为100torr～300torr，在电子阻挡层上生长厚度为100nm～300nm的P型半导体层。
[0123] 步骤312：控制温度为850℃～1000℃，压力为100torr～300torr，在P型半导体层上生长厚度为5nm～100nm的P型接触层。
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