Amplifier circuit
专利汇可以提供Amplifier circuit专利检索，专利查询，专利分析的服务。并且PURPOSE: To prevent an offset from being outputted by inserting a resistor between an input transistor(TR) of a 2nd current mirror circuit connecting to an output of a differential amplifier and a base of an output TR.
CONSTITUTION: A resistor R
2 is inserted between an input transistor(TR) Q5 of a 2nd current mirror circuit 4 connecting to an output of a differential amplifier 1 and a base of an output TR Q6. The resistance of the resistor R
2 is selected to be a value equal to a phase compensation resistor (R1=R2) connecting to a 1st current mirror circuit 3. Then in the static state where no AC signal is impressed between terminals A, B of the differential amplifier 1, since a voltage drop is caused equally respectively across the resistors R1, R2 by a base current of the TRs Q4, Q6, the bias state of the TRs Q4, Q6 is made equal. Thus, a current I3 flowing to the emitter of the TR Q4 is equal to a current I4 flowing to the TR Q6. Thus, the current flowing to an output terminal 6 is made zero.
COPYRIGHT: (C)1993,JPO&Japio，下面是Amplifier circuit专利的具体信息内容。
【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は差動増幅回路に関するものであり、より特定的には差動増幅器の差動をなす一対の出力電流の差に基づく電流を出力として取り出すようにした電流減算型の増幅回路に関するものである。
【０００２】
【従来の技術】従来の増幅回路を図２に示す。 同図において、定電流源２を有する差動増幅器１は一対の差動対トランジスタＱ１、Ｑ２から構成されており、その出力は第１、第２のカレントミラ−回路３、４の入力側トランジスタＱ３、Ｑ５から第１、第２のカレントミラ−回路３、４の出力側のトランジスタトランジスタＱ４，Ｑ
６を介して第３のカレントミラ−回路５へ与えられる。
【０００３】このとき、トランジスタＱ６の出力は第３
のカレントミラ−回路５の入力側トランジスタＱ７のベ−ス及びコレクタに結合され、他方のトランジスタＱ４
の出力は第３のカレントミラ−回路５の出力側トランジスタＱ８のコレクタに結合される。 この図２の増幅回路の出力はトランジスタＱ４のコレクタとトランジスタＱ
８のコレクタとの接続点（イ）から出力端子６へ導出されるが、その出力電流は前記差動増幅器１の差動出力電流Ｉ１、Ｉ２に対応するトランジスタＱ４、Ｑ６の出力電流Ｉ３、Ｉ４の差になる。
【０００４】即ち、トランジスタＱ６の出力電流Ｉ４はカレントミラ−回路５の作用によりトランジスタＱ８のコレクタ側にも流れるので、（イ）点にはトランジスタＱ４より流れ込む電流Ｉ３と、トランジスタＱ８へ流れて行く電流Ｉ４が存在し、その差電流が出力端子６を流れるのである。
【０００５】差動増幅器１の入力端子Ａ、Ｂに交流入力が存しないとき、Ｉ１＝Ｉ２、Ｉ３＝Ｉ４となるように選ばれているので、出力端子６における出力電流は０となる。 ところで、この回路を例えばオペレ−ションアンプに用いる場合、出力を入力側へ一部帰還することを行なうが、図３に示す周波数特性の高域側Ｈで発振が生じることがある。 それを避けるためトランジスタＱ４のベ−スとコレクタ間にコンデンサＣ１を接続し、且つそのベ−スに抵抗Ｒ１を接続している。 これらの抵抗Ｒ１とコンデンサＣ１は位相補償回路をなし、その位相補償によって高域での発振を防止するようになっている。
【０００６】
【発明が解決しようとする課題】ところで、上記従来の増幅回路で抵抗Ｒ１が存在するため、この抵抗による電圧降下によってスタティックな出力電流Ｉ３、Ｉ４にアンバランスが生じて、静的状態での出力電流が０とならない状態（オフセット）が発生する。 これは明らかに増幅誤差となるので、増幅器の精度が落ちることになる。
本発明はこのような問題を解決した電流減算型の増幅回路を提供することを目的とする。
【０００７】
【課題を解決するための手段】上記の目的を達成するため本発明では、差動増幅器の第１の出力を第１のトランジスタを介してカレントミラ−回路の出力側トランジスタの出力電極に結合し第２の出力を第２のトランジスタを介して前記カレントミラ−回路の入力側トランジスタの入力及び出力電極に結合し前記第１のトランジスタと前記カレントミラ−回路の出力側トランジスタの出力電流との結合点から前記第１の出力と第２の出力の差に基づく出力電流を取り出すようにした電流減算型の増幅回路において、前記第１、第２のトランジスタの一方のトランジスタのベ−スに位相補償用の第１の回路素子を挿入するとともに、他方のトランジスタのベ−スに前記第１の回路素子による直流電流のオフセットを補償する第２の回路素子を挿入した構成としている。
【０００８】
【作用】このような構成によると、位相補償用の回路がトランジスタに関して設けられていても、第１のトランジスタとカレントミラ−回路の出力側トランジスタの出力電極との結合点に第１のトランジスタから流れ込む電流と、この結合点からカレントミラ−回路側へ向けて流れ出ていく電流は静的（直流的）には等しくなって出力電流は０となる。 従って、オフセットが生じないので、
増幅誤差も生じない。
【０００９】
【実施例】本発明を実施した図１において、図２の従来例と同一の部分には同一の符号を付して説明を省略する。 本実施例では差動増幅器１の出力側に接続された第２のカレントミラ−回路４の入力トランジスタＱ５と、
出力側トランジスタＱ６のベ−ス間に抵抗Ｒ２を挿入した構成としている。
【００１０】そして、この抵抗Ｒ２の値は第１のカレントミラ−回路３に接続されている位相補償用の抵抗Ｒ１
と同値（Ｒ１＝Ｒ２）に選ばれている。 このようにすると、差動増幅器１の端子Ａ、Ｂに交流信号を印加しないスタティックの状態において、トランジスタＱ４、Ｑ６
のベ−ス電流は抵抗Ｒ１、Ｒ２にそれぞれ同じように電圧降下が生じるので、トランジスタＱ４、Ｑ６のバイアス状態も等しくなる。
【００１１】従って、トランジスタＱ４のエミッタに流れる電流Ｉ３と、トランジスタＱ６に流れる電流Ｉ４はＩ３＝Ｉ４となる。 従って、（イ）点に流れ込む電流Ｉ
３と（イ）点から流れ出す電流Ｉ４が等しくなるので、
出力端子６に流れる電流は０となり、オフセットは生じない。 尚、上記実施例において、抵抗Ｒ１、Ｒ２の代わりに他の回路素子を用いてもよい。
【００１２】
【発明の効果】以上説明したように本発明によれば、位相補償用の回路を設けた電流減算型の増幅器において、
出力にオフセットが生じないので増幅の精度が向上するという効果があり、有効である。
【図１】 本発明を実施した増幅回路の構成図。
【図２】 従来例の回路図。
【図３】 その説明図。
１ 差動増幅器 ３ 第１のカレントミラ−回路 ４ 第２のカレントミラ−回路 ５ 第３のカレントミラ−回路 ６ 出力端子 Ｑ４ トランジスタ（第１のトランジスタ） Ｑ６ トランジスタ（第２のトランジスタ） Ｒ１ 位相補償用の抵抗 Ｒ２ オフセット補償用の抵抗
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成５年１月２８日
【手続補正１】
【補正対象書類名】図面
【補正対象項目名】図１
【補正方法】変更
【補正内容】
【図１】
【手続補正２】
【補正対象書類名】図面
【補正対象項目名】図２
【補正方法】変更
【補正内容】
【図２】
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