送信デジタル−アナログ変換器（ＤＡＣ）スパー減衰

関連出願の相互参照 本出願は、参照によりその内容全体が本明細書に組み込まれている、2015年2月23日に米国特許商標庁に出願した非仮出願第14/628996号の優先権および利益を主張するものである。

本開示は、一般にワイヤレス通信システムに関し、より詳細には、接地低ドロップアウトレギュレータを使用して送信デジタル-アナログ変換器(DAC)スパーを減衰させるための方法および装置に関する。

ワイヤレス通信デバイスは、ますます小型で、かつ、ますます強力になっており、さらにはますます有能になっている。ユーザは、モバイル電話の使用ならびに電子メールおよびインターネットアクセスのためにますますワイヤレス通信デバイスを利用している。それと同時に、デバイスは、そのサイズがより小さくなっている。さらに、デバイスは、現在では、複数の送信機およびアンテナを組み込むことも可能である。これらの要因は、無線周波数(RF)放射へのユーザの露出をさらに増加し得る。セルラー電話、パーソナルデジタルアシスタント(PDA)、ラップトップコンピュータなどのデバイス、および他の同様のデバイスは、カバレージ領域が拡張された信頼性の高いサービスを提供している。そのようなデバイスは、移動局、局、アクセス端末、ユーザ端末、加入者ユニット、ユーザ機器と呼ぶことができ、また、同様の用語であってもよい。

ワイヤレス通信システムは、同時に複数のワイヤレス通信デバイスのための通信をサポートすることができる。使用中、ワイヤレス通信デバイスは、アップリンクおよびダウンリンク上での伝送によって1つまたは複数の基地局と通信することができる。基地局は、アクセスポイント、Node Bと呼ぶことができ、あるいは他の同様の用語であってもよい。アップリンクすなわち逆方向リンクは、ワイヤレス通信デバイスから基地局への通信リンクを意味し、一方、ダウンリンクすなわち順方向リンクは、基地局からワイヤレス通信デバイスへの通信を意味している。

ワイヤレス通信システムは、帯域幅および送信電力などの利用可能なシステム資源を共有することによって複数のユーザとの通信をサポートすることができる多重アクセスシステムであってもよい。そのような多重アクセスシステムの例には、符号分割多重アクセス(CDMA)システム、時分割多重アクセス(TDMA)システム、周波数分割多重アクセス(FDMA)システム、広帯域符号分割多重アクセス(WCDMA(登録商標))システム、モバイルのための広域システム(GSM(登録商標))通信システム、GSM(登録商標)展開のための拡張データ転送速度(EDGE)システムおよび直交周波数分割多重アクセス(OFDMA)システムがある。

ワイヤレスデバイスは、上で説明した機能のうちの多くの機能を実施するためのシステムオンチップ(SoC)を組み込むことができる。近代のSoCは、空間を節約するために同じダイの上に感応アナログ/無線周波数(RF)ブロックを統合している。これらの感応ブロックは、雑音性デジタル処理回路と同じダイの上に配置することができる。デジタルコアによって生成されるスイッチング雑音は、電力および接地配電回路網を介してアナログ/RFブロックへ伝搬し、性能低下の原因になり得る。同じダイの中で実現されるトランジスタおよび機能が多ければ多いほど、より多くのスイッチング雑音が存在するので、この問題は、微細化技術およびパッケージピン総数制限によって一層悪化し得る。この問題は、雑音結合を容易にする、電力ピンおよび接地ピンの制限された数によって倍加される。

DAC信号は、出力スペクトル中にスパーとして出現する符号依存雑音に敏感な感応混合信号である。いくつかのアプリケーションでは、スパーは、対応する帯域内の受信経路を鈍感にする。当分野には、受信帯域中のDACスパーを減衰させるための方法および装置が必要である。

本開示に含まれている実施形態は、送信デジタル-アナログ変換器(DAC)スパーを減衰させるための方法を提供する。方法は、基準電圧が増幅器に注入されると開始する。次に、接地低ドロップアウトレギュレータの出力が測定され、次いで基準電圧と比較される。次いで比較の結果に基づいて増幅器の出力が調整される。基準電圧の方が接地低ドロップアウトレギュレータの出力よりも高い場合、増幅器の出力が接地に調整される。基準電圧の方が接地低ドロップアウトレギュレータの出力よりも低い場合、基準電圧と一致するように増幅器の出力が調整される。

さらなる実施形態は、送信DACスパーを減衰させるための装置を提供する。装置は、増幅器と、増幅器と通信する第1のトランジスタと、第1のトランジスタと通信する第2のトランジスタと、第2のトランジスタと通信する第3のトランジスタと、第1のトランジスタおよび第2のトランジスタと通信する第4のトランジスタと、接地低ドロップアウトレギュレータ(GND LDO)とを含む。トランジスタは、金属酸化膜シリコン電界効果トランジスタ(MOSFET)または他の適切なトランジスタであってもよい。さらに、増幅器は反転増幅器であってもよい。

さらなる実施形態は、送信DAC中のスパーを減衰させるための装置を提供する。装置は、増幅器に基準電圧を注入するための手段と、接地低ドロップアウトレギュレータの出力を測定するための手段と、接地低ドロップアウトレギュレータの出力を基準電圧と比較するための手段と、比較に基づいて増幅器の出力を調整するための手段とを含む。

またさらなる実施形態は、実行されると、プロセッサに、増幅器に基準電圧を注入するステップと、接地低ドロップアウトレギュレータの出力を測定するステップと、接地低ドロップアウトレギュレータの出力を基準電圧と比較するステップと、比較に基づいて増幅器の出力を調整するステップとを実施させる命令を含む非一時的コンピュータ可読媒体を提供する。

本開示の特定の実施形態によるワイヤレス多重アクセス通信システムを示す図である。

本開示の実施形態によるワイヤレス通信システムのブロック図である。

本開示の実施形態による、受信機帯域を鈍感にする雑音接地を示す略図である。

本開示の実施形態による、接地低ドロップアウトレギュレータを使用してDACスパーを減衰させるための装置のブロック図である。

本開示の実施形態による接地低ドロップアウトレギュレータのブロック図である。

本開示の実施形態による、デジタル接地化と、複数のコア間の雑音隔離とを共有するための装置のブロック図である。

本開示の実施形態を使用しない場合の信号のDAC出力スペクトルを示すグラフである。

本開示の実施形態による、接地低ドロップアウトレギュレータを使用した場合のDAC出力スペクトルを示すグラフである。

本開示の実施形態による、DACスパー減衰のための方法の流れ図である。

添付の図面に関連して以下に示される、発明を実施するための形態には、本発明の例示的実施形態についての説明であることが意図されており、本発明が実践され得る唯一の実施形態を表すことは意図されていない。発明を実施するための形態全体を通して使用されている「例示的」という用語は、「例、実例または例証として働く」ことを意味しており、必ずしも他の例示的実施形態に優る好ましい、または有利なものとして解釈してはならない。発明を実施するための形態には、本発明の例示的実施形態についての完全な理解を提供するために特定の詳細が含まれている。本発明の例示的実施形態は、これらの特定の詳細がなくても実践することができることは当業者には明らかであろう。いくつかの実例では、本明細書において提供される例示的実施形態の新規性が曖昧になることを回避するために、よく知られている構造およびデバイスは、ブロック図の形態で示されている。

本出願において使用されているように、「構成要素」、「モジュール」、「システム」、等々という用語には、ハードウェアであれ、ファームウェアであれ、ハードウェアとソフトウェアの組合せであれ、ソフトウェアであれ、あるいは実行中のソフトウェアであれ、コンピュータ関連のエンティティを意味することが意図されている。たとえば構成要素は、それらに限定されないが、プロセッサ上で走るプロセス、集積回路、プロセッサ、オブジェクト、実行可能ファイル、実行スレッド、プログラムおよび/またはコンピュータであってもよい。例証として、コンピューティングデバイス上で走るアプリケーションおよびコンピューティングデバイスは、いずれも構成要素であってもよい。1つまたは複数の構成要素は、プロセスおよび/または実行のスレッド内に常駐させることができ、また、構成要素は、1つのコンピュータ上で局所化することができ、および/または2つ以上のコンピュータの間で分散させることができる。さらに、これらの構成要素は、様々なデータ構造をその上に記憶した様々なコンピュータ可読媒体から実行することができる。構成要素は、1つまたは複数のデータパケット(たとえば局所システム内、分散システム内、および/または他のシステムを有するインターネットなどのネットワーク全体にわたる他の構成要素と信号によって対話する1つの構成要素からのデータ)を有する信号などに従って、局所プロセスおよび/または遠隔プロセスによって通信することができる。

さらに、本明細書においては、アクセス端末および/またはアクセスポイントに関連して様々な態様が説明される。アクセス端末は、音声および/またはデータ接続性をユーザに提供するデバイスを意味することができる。アクセスワイヤレス端末は、ラップトップコンピュータまたはデスクトップコンピュータなどのコンピューティングデバイスに接続することができ、あるいはアクセスワイヤレス端末は、セルラー電話などの自立型デバイスであってもよい。また、アクセス端末は、システム、加入者ユニット、加入者局、移動局、モバイル、遠隔局、遠隔端末、ワイヤレスアクセスポイント、ワイヤレス端末、ユーザ端末、ユーザエージェント、ユーザデバイスまたはユーザ機器と呼ぶことも可能である。ワイヤレス端末は、加入者局、ワイヤレスデバイス、セルラー電話、PCS電話、コードレス電話、セッションイニシエーションプロトコル(SIP)電話、ワイヤレスローカルループ(WLL)局、パーソナルデジタルアシスタント(PDA)、ワイヤレス接続機能を有するハンドヘルドデバイス、またはワイヤレスモデムに接続された他の処理デバイスであってもよい。さもなければ基地局または基地局コントローラ(BSC)と呼ばれるアクセスポイントは、ワイヤレス端末を使用して、1つまたは複数のセクタを介して、エアインターフェースを介して通信するアクセスネットワーク内のデバイスを意味することができる。アクセスポイントは、受信したエアインターフェースフレームをインターネットプロトコル(IP)パケットに変換することにより、ワイヤレス端末と、IPネットワークを含むことができる残りのアクセスネットワークとの間のルータとして作用することができる。また、アクセスポイントは、エアインターフェースのための属性の管理を同じく調整する。

その上、本明細書において説明される様々な態様または特徴は、標準プログラミング技法および/またはエンジニアリング技法を使用した方法、装置または製造品として実現され得る。本明細書において使用されている「製造品」という用語には、任意のコンピュータ可読デバイス、搬送波または媒体からのアクセスが可能なコンピュータプログラムを包含することが意図されている。たとえばコンピュータ可読媒体は、それらに限定されないが、磁気記憶デバイス(たとえばハードディスク、フロッピー(登録商標)ディスク、磁気ストライプ…)、光ディスク(たとえばコンパクトディスク(CD)、デジタル多用途ディスク(DVD)…)、スマートカードおよびフラッシュメモリデバイス(たとえばカード、スティック、キードライブ…)、およびリードオンリメモリ、プログラマブルリードオンリメモリおよび電気的消去可能プログラマブルリードオンリメモリなどの集積回路を含むことができる。

様々な態様は、多数のデバイス、構成要素、モジュール、等々を含むことができるシステムに関して示される。様々なシステムは、追加デバイス、構成要素、モジュール、等々を含むことができ、および/または図に関連して説明されるデバイス、構成要素、モジュール、等々のすべてを含まなくてもよいことを理解し、かつ、認識されたい。また、これらの手法の組合せを使用することも可能である。

保証説明、添付の図面および添付の特許請求の範囲を考察することにより、当業者には本発明の様々な態様の他の態様ならびに特徴および利点が明らかになるであろう。

図1は、一態様による多重アクセスワイヤレス通信システム100を示したものである。アクセスポイント102(AP)は複数のアンテナグループを含み、1つのグループは104および106を含み、別のグループは108および110を含み、また、追加グループは112および114を含む。図1では、各アンテナグループに対して2つのアンテナしか示されていないが、もっと多くのアンテナまたはもっと少ないアンテナを各アンテナグループに対して利用することができる。アクセス端末116(AT)は、アンテナ112および114と通信しており、アンテナ112および114は、ダウンリンクすなわち順方向リンク118を介して情報をアクセス端末116に送信し、また、アップリンクすなわち逆方向リンク120を介してアクセス端末116から情報を受信する。アクセス端末122は、アンテナ106および108と通信しており、アンテナ106および108は、ダウンリンクすなわち順方向リンク124を介して情報をアクセス端末122に送信し、また、アップリンクすなわち逆方向リンク126を介してアクセス端末122から情報を受信する。アクセス端末122は、改良されたサービスを提供するための複数の送信機およびアンテナを有することができる。周波数分割二重(FDD)システムでは、通信リンク118、120、124および126は、異なる周波数を使用して通信することができる。たとえばダウンリンクすなわち順方向118は、アップリンクすなわち逆方向リンク120によって使用される周波数とは異なる周波数を使用することができる。

アンテナの各グループおよび/またはそれらが通信するように設計される領域は、しばしばアクセスポイントのセクタと呼ばれる。一態様では、アンテナグループは、それぞれ、アクセスポイント102によってカバーされる領域のセクタ内のアクセス端末に通信するように設計される。

ダウンリンクすなわち順方向リンク118および124を介した通信では、アクセスポイントの送信アンテナは、異なるアクセス端末116および122のためのダウンリンクすなわち順方向リンクの信号対雑音比(SNR)を改善するためにビーム形成を利用する。また、そのカバレージ全体にわたって無作為に散乱したアクセス端末に送信するためにビーム形成を使用しているアクセスポイントは、単一のアンテナを介してそのすべてのアクセス端末に送信するアクセスポイントよりも、近隣のセルにおけるアクセス端末に対する妨害が少ない。

アクセスポイントは、端末と通信するために使用される固定局であってもよく、また、Node B、発展Node B(eNB)と呼ぶことも可能であり、あるいは何らかの他の用語であってもよい。また、アクセス端末は、移動局、ユーザ機器(UE)、ワイヤレス通信デバイス、端末と呼ぶことも可能であり、あるいは何らかの他の用語であってもよい。特定の態様の場合、AP102またはアクセス端末116、122のいずれかは、以下で説明される技法を利用してシステムの性能を改善することができる。

図2は、ワイヤレス通信デバイス200の例示的設計のブロック図を示したものである。この例示的設計では、ワイヤレスデバイス200は、データプロセッサ210およびトランシーバ220を含む。トランシーバ220は、双方向ワイヤレス通信をサポートする送信機230および受信機250を含む。通常、ワイヤレスデバイス200は、任意の数の通信システムおよび任意の数の周波数帯域のための任意の数の送信機および任意の数の受信機を含むことができる。ワイヤレス通信デバイス200上の各送信機およびアンテナは、RF放射を放出する。

送信経路中では、データプロセッサ210は、送信されるデータを処理して、アナログ出力信号を送信機230に提供する。送信機230内では、アナログ出力信号が増幅器(アンプ)232によって増幅され、デジタル-アナログ変換によって生じるイメージを除去するために低域通過フィルタ234によってフィルタリングされ、VGA236によって増幅され、かつ、ミキサ238によってベースバンドからRFへアップ変換される。アップ変換された信号は、フィルタ240によってフィルタリングされ、ドライバ増幅器242および電力増幅器244によってさらに増幅され、スイッチ/デュプレクサ246を介して経路指定され、かつ、アンテナ248を介して送信される。

受信経路中では、アンテナ248が基地局および/または他の送信機局から信号を受信し、かつ、受信した、スイッチ/デュプレクサ246を介して経路指定され、かつ、受信機250に提供される信号を提供する。受信機250内では、受信した信号がLNA252によって増幅され、帯域通過フィルタ254によってフィルタリングされ、かつ、ミキサ256によってRFからベースバンドへダウン変換される。ダウン変換された信号は、データプロセッサ210に提供されるアナログ入力信号を得るためにVGA258によって増幅され、低域通過フィルタ260によってフィルタリングされ、かつ、増幅器262によって増幅される。

図2は、1つのステージで信号をRFとベースバンドとの間で変換する直接変換アーキテクチャを実現する送信機230および受信機250を示している。また、送信機230および/または受信機250は、複数のステージで信号をRFとベースバンドとの間で周波数変換するスーパヘテロダインアーキテクチャを実現することも可能である。局部発振器(LO)発生器270は、送信および受信LO信号を生成して、それぞれミキサ238および256に提供する。位相固定ループ(PLL)272は、データプロセッサ210から制御情報を受け取り、かつ、適切な周波数の送信および受信LO信号を生成するために制御信号をLO発生器270に提供する。

図2は例示的トランシーバ設計を示したものであり、また、ワイヤレスデバイス200は、複数のトランシーバを含むことができる。通常、送信機230および受信機250内の信号の条件付けは、増幅器、フィルタ、ミキサ、等々のうちの1つまたは複数のステージによって実施することができる。これらの回路は、図2に示されている構成とは別様に配置することができる。図2におけるいくつかの回路は省略することも可能である。トランシーバ220のすべての部分または一部は、1つまたは複数のアナログ集積回路(IC)、RF IC(RFIC)、混合信号IC、等々の上で実現することができる。たとえば送信機230内の増幅器232から電力増幅器244まで、同じくRFIC上で実現することができる。また、ドライバ増幅器242および電力増幅器244は、RFICの外部の別のIC上で実現することも可能である。

データプロセッサ210は、ワイヤレスデバイス200のための様々な機能、たとえば送信および受信データの処理を実施することができる。メモリ212は、データプロセッサ210のためのプログラムコードおよびデータを記憶することができる。データプロセッサ210は、1つまたは複数の特定用途向け集積回路(ASIC)および/または他のIC上で実現することができる。

近代のSoCは、雑音性デジタル処理回路のダイと同じダイの上に感応アナログ/RFブロックを統合している。スイッチング雑音は、複数のスイッチの動作によって生じ得る。デジタルコアによって生成されるスイッチング雑音は、電力および接地配電回路網を介してアナログ/RFブロックへ伝搬し、性能低下の原因になり得る。単一のチップの中で実現されるトランジスタおよび機能が多ければ多いほど、より多くのスイッチング雑音が存在するので、この問題は、微細化技術およびパッケージピン総数制限によって一層悪化し得る。さらに、雑音結合は、デバイス上の電力ピンおよび接地ピンの制限された数によって容易にされ得る。

図3は、典型的な電流ステアリングDAC最上位ビット(MSB)セル306およびそのスイッチドライバ302の最後のステージを含む装置300を示したものである。各セルは、MSBセル306内のpチャネル金属酸化膜半導体(PMOS)電流源M1およびM2、およびMSBセル306内の一対のPMOSスイッチM3およびM4からなっている。スイッチドライバ302はデジタル回路である。スイッチドライバ302は、チップ上の多くの他のデジタル回路と接地を共有している。PMOS電流源およびスイッチは、とりわけ信号鎖内の次のブロックがDACのダイと同じダイの上に存在していない場合、nチャネル金属酸化膜半導体(NMOS)デバイスよりも頻繁に使用される。

動作中、PMOSスイッチは、そのゲートがスイッチドライバ302内のNMOSを介して接地に短絡されるとターンオンする。この時点で、スイッチドライバ302接地304における雑音は、MSBセル306内のスイッチトランジスタM3の電圧V_GSを変調することができる。これにより、正規の電流I_MSBに加えて雑音電流I_Nが生じる。典型的なワイヤレスモデムSoCでは、この接地雑音は、白色雑音のみならず、送信水晶発振器(TCXO)インパルス電流およびモデム送信(TxFE)動作によって生じる有色雑音を同じく含む。上記機構は、接地雑音によるDAC出力の汚染を許容する。結果として生じる雑音電流I_Nは符号依存性であり、したがって|f_signal+/-f_noise|のスパーとしてDAC出力スペクトル中に出現し、f_signalはDAC入力周波数であり、また、f_noiseは接地雑音周波数である。周波数分割二重(FDD)アプリケーションでは、このスパーは、対応する帯域内の受信経路を鈍感にし、貧弱な品質の受信をもたらす。

本開示において説明される実施形態は、上で説明した困難性を克服する方法を提供する。接地雑音誘導スパーを克服するために、以下でさらに詳細に説明される接地低ドロップアウトレギュレータ(GND LDO)が組み込まれる。

図4は、DAC受信帯域中の接地雑音スパーを小さくするための装置を示したものである。装置400は、雑音接地における雑音を減衰させ、かつ、きれいな「接地」をDACコアに提供するGND LDO406を含む。GND LDO406は、増幅器418およびトランジスタ420を含む。また、装置は、電圧低ドロップアウトレギュレータ(VDD LDO)402を同じく含む。VDD LDOは、増幅器410およびトランジスタ412を含む。VDD LDO402は、コンデンサC_DECAP414、他のDAC負荷416および最後のステージのスイッチドライバ404に接続されている。最後のステージのスイッチドライバ404は、C_DECAP414、他のDAC負荷416、GND LDO406およびMSBセル408に接続されている。MSBセル408は、PMOSトランジスタ422および424、ならびにPMOSスイッチ426および428を含む。

GND LDO406は、雑音性接地における雑音を減衰させ、かつ、きれいな「接地」をDACコアに提供するために使用されている。また、DACコアは、スイッチドライバ404およびクロックバッファ、ならびに説明されていない他の追加ブロックを同じく含むことができる。さらなる実施形態は、動的電流を提供するための減結合コンデンサC_DECAP414を並列に提供する。

図5は、本明細書において説明されている実施形態による接地低ドロップアウトレギュレータ(GND LDO)のブロック図である。アセンブリ500は、誤差増幅器506、M5 520およびM6 514からなるソースフォロワステージ、補償回路網およびパストランジスタM_pass524を含む。M5 220のソースは、M5 520が雑音を知覚することができ、また、M6 514と協力して、パストランジスタM_pass524のV_GSを所望の帯域幅内に保持するための共通ゲート単位利得増幅器として動作することができるよう、雑音性接地526に接続されている。C_FF528は、共通ゲート増幅器の高周波数利得を大きくし、延いては雑音除去のために帯域幅を効果的に拡張するために使用されている。抵抗R_Z510およびコンデンサC_C512は、GND LDO500ループが負荷電流の全範囲にわたって安定であることを保証している。

動作中、LDOレギュレータは、供給電圧が出力電圧に極めて近い場合であっても出力電圧を調整することができる直流(DC)電圧レギュレータである。他のDC-DCレギュレータに優るLDOレギュレータの利点は、より小さいスイッチング雑音(スイッチングが生じないため)、より小さいデバイスサイズ(大きいインダクタまたは変圧器を必要としない)、およびより大きい設計単純性を含む。典型的には、LDO設計には、基準、増幅器およびパス要素が組み込まれる。欠点の1つは、線形DCレギュレータが、出力電圧を調整するために調整デバイス全体にわたる電力の散逸を余儀なくされることである。

LDOレギュレータの主な構成要素は、電力電界効果トランジスタ(FET)および誤差増幅器である。誤差増幅器506の一方の入力は、2つの抵抗の間の抵抗比によって決定される出力、すなわち入力の微小部分を監視している。一実施形態では、この入力は、誤差増幅器506の正端子上の入力であるGND LDO出力522である。誤差増幅器506に対する第2の入力は、安定電圧基準、ここではV_ref504からの入力であり、誤差増幅器506の負端子上の入力である。出力電圧が基準電圧に対して過度に高くなると、トランジスタM5 520、M6 514およびM_pass524は、一定の電圧を維持するように調整する。上で言及したように、抵抗R_Z510およびコンデンサC_C512は、可能な装荷電流の全範囲に対する帰還ループの安定性の保証を促進している。

トランジスタ518は、定電流源502を接続して、M6 514と相俟って、M_pass524を調整するための誤差増幅器出力信号のためのソースフォロワステージとして動作し、かつ、雑音性接地526雑音を知覚して、GND LDO522の出力雑音を減衰させる共通ゲート増幅器として動作するM5 520のためのバイアス電圧を生成する。

動作中、電圧基準Vref504が演算増幅器506の反転(-入力)に注入される。回路出力であるGND LDO出力522は、演算増幅器506の非反転反転入力(+入力)に注入される。演算増幅器506の出力は、抵抗R_Z510およびコンデンサC_C512を介して演算増幅器506の非反転側に挿入される。また、演算増幅器506の出力は、第1のnチャネル金属酸化膜シリコン電界効果トランジスタ(NチャネルMOSFET)M₆514のゲートに同じく注入される。第1のnチャネルMOSFET M₆514ドレインは、Vdda502に接続されている。第1のn-MOSFET M₆514は、第2のn-MOSFET M₅520のドレインに接続されたそのソースを有している。コンデンサC_FF528は、M₆514のゲートとソースにわたって接続されている。M₅520のソースは雑音性接地526に接続されている。

基準:電流源は、Vdda502と、第3のn-MOSFET518のゲートおよびドレインとの間に接続されている。n-MOSFET518のソースは低雑音アナログ接地508に接続されている。n-MOSFET518のゲートは、M₅520のゲートに接続されている。これは、M₅520を共通ゲート増幅器構成にバイアスする。また、第1のn-MOSFET M₆514のソースは、第4のn-MOSFET M_pass524のゲートに同じく接続されている。第4のn-MOSFET M_pass524のドレインは、GND LDO出力522に接続されている。第4のn-MOSFET M_pass524のソースは雑音性接地526に接続されている。

第1のn-MOSFET M₆514を介して演算増幅器506によってバイアスし、かつ、第2のn-MOSFET520と相俟って、vdda502と第3のn-MOSFET518との間の定電流源によってバイアスすることにより、雑音性接地から信号が引き出され、かつ、第4のn-MOSFET M_pass524のゲートをバイアスする非反転信号が生成される。第4のn-MOSFET M_pass524は、GND LDO522の雑音を小さくする。

図6は、複数のコアを有するチップへの概念の拡張を示したものである。アセンブリ600は、第1のGND LDO604と共に第1のコア602を含み、第1のGND LDO604は、コア602が共有雑音性デジタル接地(DGND)から潜在的にピックアップし得るあらゆるスパーを減衰させるように動作する。第1のコア602からの出力は、位相固定ループ(PLL)606に入力される。PLL606からの出力は第2のコア608に入力される。第2のGND LDO610は、第2のコア608によって生成される信号を汚染し得る雑音性接地(GND)上のスパーを減衰させるように動作する。第2のコア608からの出力は、アナログ-デジタル変換器(ADC)612に入力される。PLL606からの第2の出力は第3のコア614に入力される。GND LDO616は、雑音性接地DGND上の雑音を除去し、かつ、第3のコア614によって生成される信号の汚染を防止するように動作する。図6に示されているように、GND LDOの使用は、性能が接地雑音にさらされ得る他のアナログ/混合信号設計に拡張することができる。

図7は、シミュレートされたDAC出力スペクトルを示したものである。シミュレーションでは、79MHz、5m Vpp正弦雑音がスイッチドライバ接地304に注入され、2トーンDAC入力信号は、それぞれ6MHzおよび8MHzである。接地雑音は、73MHz、85MHz、71MHzおよび87MHzの4つの-71 dBcスパーを導入することがわかる。これらのスパーなどのスパーは、受信信号鎖を大いに鈍感にし、小さくする必要がある。

図8は、DAC出力スペクトル中のスパーを減衰させるためのGND LDOを使用して可能な改善を示したものである。図8におけるシミュレーション条件は、図7に示されているシミュレーション条件と同じである。しかしながらGND LDOを使用することにより、DACスパーが13dBだけ減衰しており、今では許容可能範囲内である。シミュレーションは、他の受信帯域を損なうことなく受信帯域性能が改善され得ることを示している。

図9は、本明細書において説明されている実施形態による、DACスパーを減衰させる方法のフローチャートである。方法900はステップ902で開始し、増幅器に基準電圧が注入される。ステップ904で、接地低ドロップアウトレギュレータ(GND LDO)の出力が測定される。ステップ906で、GND LDOの出力が基準電圧と比較される。GND LDOの測定された出力の方が基準電圧よりも高い場合、ステップ908で、増幅器出力が接地に調整される。比較が、GND LDO出力の方が基準電圧よりも低いことを示している場合、ステップ910で、増幅器出力が基準電圧に調整される。ステップ908および910において上で説明したように調整が実施された後、プロセスは、ステップ902で再び開始する。

情報および信号は、様々な異なる技術および技法のいずれかを使用して表すことができることは当業者には理解されよう。たとえば上記の説明全体を通して参照され得るデータ、命令、コマンド、情報、信号、ビット、記号およびチップは、電圧、電流、電磁波、磁場または磁性粒子、光場または光学粒子、あるいはそれらの任意の組合せによって表され得る。

さらに、本明細書において開示されている例示的実施形態に関連して説明されている様々な実例論理ブロック、モジュール、回路およびアルゴリズムステップは、電子ハードウェア、コンピュータソフトウェアまたは両方の組合せとして実現することができることは当業者には認識されよう。ハードウェアおよびソフトウェアのこの互換性を明確に示すために、様々な実例構成要素ブロック、モジュール、回路およびステップは、上では、一般にそれらの機能に関して説明されている。そのような機能がハードウェアとして実現されるか、あるいはソフトウェアとして実現されるかどうかは、特定の適用例および全体的なシステムに課される設計制約で決まる。当業者は、説明されている機能を特定の適用例ごとに様々な方法で実現することができるが、そのような実施態様決定は、本発明の例示的実施形態の範囲からの逸脱を生じるものとして解釈してはならない。

本明細書において開示されている例示的実施形態に関連して説明されている様々な実例論理ブロック、モジュールおよび回路は、汎用プロセッサ、デジタル信号プロセッサ(DSP)、特定用途向け集積回路(ASIC)、フィールドプログラマブルゲートアレイ(FPGA)または他のプログラマブル論理デバイス、離散ゲートまたはトランジスタ論理、離散ハードウェア構成要素、あるいは本明細書において説明されている機能を実施するように設計されたそれらの任意の組合せを使用して実現または実行することができる。汎用プロセッサはマイクロプロセッサであってもよいが、代替では、プロセッサは、任意の従来のプロセッサ、コントローラ、マイクロコントローラまたは状態マシンであってもよい。また、プロセッサは、コンピューティングデバイスの組合せ、たとえばDSPとマイクロプロセッサの組合せ、複数のマイクロプロセッサ、DSPコアと関連した1つまたは複数のマイクロプロセッサ、または任意の他のそのような構成として実現することも可能である。

1つまたは複数の例示的実施形態では、説明された機能は、ハードウェア、ソフトウェア、ファームウェアまたはそれらの任意の組合せの中で実現することができる。ソフトウェアの中で実現される場合、機能は、コンピュータ可読媒体上の1つまたは複数の命令あるいはコードとして記憶し、あるいは送信することができる。コンピュータ可読媒体は、ある場所から別の場所へのコンピュータプログラムの転送を容易にする任意の媒体を含む、コンピュータ記憶媒体と通信媒体の両方を含む。記憶媒体は、コンピュータによってアクセスされ得る任意の利用可能な媒体であってもよい。限定ではなく例として、そのようなコンピュータ可読媒体は、RAM、ROM、EEPROM、CD-ROM、もしくは他の光ディスク(disk)記憶装置、または他の磁気記憶デバイス、あるいは命令またはデータ構造の形態で所望のプログラムコードを搬送または記憶するために使用することができ、かつ、コンピュータによってアクセスされ得る任意の他の媒体を含むことができる。また、任意の接続も適切にコンピュータ可読媒体と称される。たとえばソフトウェアが、同軸ケーブル、光ファイバケーブル、ツイストペア、デジタル加入者回線(DSL)、または赤外線、無線およびマイクロ波などのワイヤレス技術を使用して、ウェブサイト、サーバまたは他の遠隔ソースから送信される場合、同軸ケーブル、光ファイバケーブル、ツイストペア、DSL、または赤外線、無線およびマイクロ波などのワイヤレス技術は、媒体の定義に含まれる。本明細書において使用されているように、ディスク(diskおよびdisc)は、コンパクトディスク(disc)(CD)、レーザディスク(disc)、光ディスク(disc)、デジタル多用途ディスク(disc)(DVD)、フロッピー(登録商標)ディスク(disk)およびブルーレイディスク(disc)を含み、diskは、通常、データを磁気的に再生し、一方、discは、レーザを使用してデータを光学的に再生する。上記の組合せも、コンピュータ可読媒体の範囲内に含まれるものとする。

開示された例示的実施形態の上記の説明は、すべての当業者による本発明を構築または使用を可能にするために提供されている。当業者には、これらの例示的実施形態に対する様々な修正が容易に明らかであり、また、本明細書において定義されている一般原理は、本発明の精神または範囲を逸脱することなく他の実施形態に適用され得る。したがって本発明には、本明細書において示されている例示的実施形態に限定されることは意図されておらず、本明細書において開示されている原理および新規な特徴と一致する最も広い範囲が与えられるべきである。

100 多重アクセスワイヤレス通信システム 102 アクセスポイント(AP) 104 アンテナ 106 アンテナ 108 アンテナ 110 アンテナ 112 アンテナ 114 アンテナ 116 アクセス端末(AT) 118 ダウンリンクすなわち順方向リンク(通信リンク) 120 アップリンクすなわち逆方向リンク(通信リンク) 122 アクセス端末(AT) 124 ダウンリンクすなわち順方向リンク(通信リンク) 126 アップリンクすなわち逆方向リンク(通信リンク) 200 ワイヤレス通信デバイス 210 データプロセッサ 212 メモリ 220 トランシーバ 230 送信機 232 増幅器(アンプ) 234 低域通過フィルタ 236 VGA 238 ミキサ 240 フィルタ 242 ドライバ増幅器 244 電力増幅器 246 スイッチ/デュプレクサ 248 アンテナ 250 受信機 252 LNA 254 帯域通過フィルタ 256 ミキサ 258 VGA 260 低域通過フィルタ 262 増幅器 270 局部発振器(LO)発生器 272 位相固定ループ(PLL) 300 装置 302 スイッチドライバ 304 接地 306 電流ステアリングDAC最上位ビット(MSB)セル 400 装置 402 電圧低ドロップアウトレギュレータ(VDD LDO) 404 最後のステージスイッチドライバ 406 GND LDO 408 MSBセル 410 増幅器 412 トランジスタ 414 コンデンサC_DECAP 416 他のDAC負荷 418 増幅器 420 トランジスタ 422 PMOSトランジスタ 424 PMOSトランジスタ 426 PMOSスイッチ 428 PMOSトランジスタ 500 アセンブリ 502 定電流源、Vdda 504 V_ref 506 誤差増幅器、演算増幅器 508 低雑音アナログ接地 510 抵抗R_Z 512 コンデンサC_C 514 トランジスタM6、第1のnチャネル金属酸化膜シリコン電界効果トランジスタ(NチャネルMOSFET) 518 トランジスタ、第3のn-MOSFET 520 トランジスタM5、第2のn-MOSFET 522 GND LDO出力 524 パストランジスタM_pass、第4のn-MOSFET 526 雑音性接地 528 C_FF 600 アセンブリ 602 第1のコア 604 第1のGND LDO 606 位相固定ループ(PLL) 608 第2のコア 610 第2のGND LDO 612 アナログ-デジタル変換器(ADC) 614 第3のコア 616 GND LDO