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用于对级联纠错码的有效解码的方法和系统
申请号	CN201210024401.1	申请日	2012-01-31	公开(公告)号	CN102624403B	公开(公告)日	2017-12-29
申请人	马维尔国际贸易有限公司;			发明人	N·瓦尼卡; 阳学仕; S·K·奇拉帕加里;
摘要	本发明涉及用于对级联纠错码的有效解码的方法和系统。对所接收的数据进行解码包括：使用根据第一解码过程对数据进行解码的第一纠错电路对所接收的数据进行解码；在第一纠错电路完成执行用于纠正数据的第一解码过程之前终止对该第一解码过程的执行，并且输出经部分解码的数据；确定经部分解码的数据是否需要进一步解码；以及响应于确定经部分解码的数据需要进一步解码，使用根据第二解码过程对数据进行解码的第二纠错电路对经部分解码的数据进行解码。一种系统，其根据该方法对数据进行解码。
权利要求	1.一种用于对数据进行解码的方法，所述方法包括：接收待解码数据；使用根据第一迭代解码过程对数据进行解码的第一纠错电路对所接收的数据进行解码；在所述第一纠错电路完成执行所述第一迭代解码过程之前终止对用于纠正所述数据的所述第一迭代解码过程的执行；响应于所述终止，产生经部分解码的中间数据，所述经部分解码的中间数据由终止的所述第一迭代解码过程导致；通过确定所述第一迭代解码过程是否已失败来确定所述经部分解码的中间数据是否需要进一步解码；以及响应于确定所述第一迭代解码过程尚未失败，使用根据第二解码过程对数据进行解码的第二纠错电路对所述经部分解码的中间数据进行解码。 2.根据权利要求1所述的方法，其中所述第一纠错电路包括迭代解码器，并且其中终止对所述第一迭代解码过程的执行包括：导出解码器错误度量；将所述解码器错误度量与停止规则相比较；确定所述解码器错误度量是否已满足所述停止规则；以及响应于确定所述解码器错误度量已满足所述停止规则而在完成所述第一迭代解码过程之前终止对所述第一迭代解码过程的执行。 3.根据权利要求2所述的方法，其中对所述所接收的数据进行解码还包括计算所述第一迭代解码过程的中间结果的可靠性度量。 4.根据权利要求2所述的方法，其中所述解码器错误度量包括可靠性度量。 5.根据权利要求4所述的方法，其中所述可靠性度量包括校验子权重或者整体LLR度量。 6.根据权利要求1所述的方法，其中对所述所接收的数据进行解码包括确定在预定时间间隔中在所述第一迭代解码过程中的翻转的位的数目。 7.根据权利要求1所述的方法，其中所述第一纠错电路包括迭代解码器，并且其中终止对所述第一迭代解码过程的执行包括确定是否已发生预定时间事件，所述预定时间事件包括所述第一纠错电路的时间单位，其中所述时间单位是时钟周期或者所述迭代解码器的迭代。 8.根据权利要求1所述的方法，其中所述第一纠错电路包括迭代解码器，并且其中确定所述经部分解码的中间数据是否需要进一步解码还包括：确定解码器错误度量是否指示发散。 9.根据权利要求1所述的方法，其中所述第一纠错电路包括迭代解码器，并且其中是否使用第二纠错电路对所述经部分解码的中间数据进行解码依赖于解码器错误度量是否指示发散。 10.一种用于对数据进行解码的系统，包括：纠错电路，其被配置成根据第一迭代解码过程对所接收的数据进行解码，其中所述纠错电路被配置成：在完成所述第一迭代解码过程之前终止对用于纠正所述数据的所述第一迭代解码过程的执行；响应于终止所述执行，产生经部分解码的中间数据，所述经部分解码的中间数据由终止的所述第一迭代解码过程导致；通过确定所述第一迭代解码过程是否已失败来确定所述经部分解码的中间数据是否需要进一步解码；以及响应于确定所述第一迭代解码过程尚未失败，根据第二解码过程对所述经部分解码的中间数据进行解码。 11.根据权利要求10所述的系统，其中所述纠错电路包括迭代解码器，并且其中所述纠错电路进一步被配置成：导出解码器错误度量；将所述解码器错误度量与停止规则相比较；确定所述解码器错误度量是否已满足所述停止规则；以及响应于确定所述解码器错误度量已满足所述停止规则而在完成所述第一迭代解码过程之前终止对所述第一迭代解码过程的执行。 12.根据权利要求11所述的系统，其中所述纠错电路进一步被配置成计算所述第一迭代解码过程的中间结果的可靠性度量。 13.根据权利要求11所述的系统，其中所述解码器错误度量包括可靠性度量。 14.根据权利要求13所述的系统，其中所述可靠性度量包括校验子权重或者整体LLR度量。 15.根据权利要求10所述的系统，其中所述纠错电路进一步被配置成确定在预定时间间隔中在所述第一迭代解码过程中的翻转的位的数目。 16.根据权利要求10所述的系统，其中所述纠错电路进一步被配置成确定是否已发生预定时间事件，所述预定时间事件包括所述纠错电路的时间单位，其中所述时间单位是时钟周期或者所述第一迭代解码过程的迭代。 17.根据权利要求10所述的系统，其中所述纠错电路包括迭代解码器，并且其中所述纠错电路进一步被配置成确定解码器错误度量是否指示发散。 18.根据权利要求10所述的系统，其中所述纠错电路包括迭代解码器，并且其中所述纠错电路进一步被配置成依赖于解码器错误度量是否已指示发散而确定是否使用第二解码过程对所述经部分解码的中间数据进行解码。
说明书全文	用于对级联纠错码的有效解码的方法和系统 [0001] 相关申请的交叉引用 [0002] 本申请基于35U.S.C.§119(e)要求于2011年1月31日递交的美国临时申请No.61/437，954的权益，该申请通过引用的方式全文并入于此。技术领域 [0003] 本公开总体上涉及通信或者存储系统和方法，并且更具体地，涉及用于对级联纠错码进行解码的系统和方法。背景技术 [0004] 在此提供的背景技术描述是出于总体上呈现本公开的上下文的目的。本发明人的工作，就在本背景技术部分中所描述的而言，以及就在提交时并适合作为现有技术的描述的方面而言，并不明示或者暗示其为针对本公开的现有技术。 [0005] 为了改善通信和存储系统的可靠性，通常向所传达或者存储的数据应用纠错码(ECC)，而这向数据流添加了冗余。为了增加纠错的能力，多个纠错码可以相继级联。在许多情形中，两个纠错码级联在一起：内部码和外部码。内部码用于纠正大部分错误，而外部码用于纠正内部码未纠正的相对少的剩余错误。 [0006] 为了纠正大部分错误，内部解码器利用比外部解码器更强的代码。内部解码器所使用的更强的代码需要较多的资源(例如能量和时间)来完成纠正。在内部解码器完成其解码操作之后，完成的经解码的结果被提供给外部解码器。完成的经解码的结果可以包含内部解码器在其完成解码过程期间未能纠正的附加错误。外部解码器能够纠正内部解码器未能纠正的附加错误。在外部解码器完成之后，提供了最终的经解码的结果。 [0007] 如上所述，级联多个纠错码需要数据流中的更多冗余，以允许纠正更大量的错误。然而，典型的级联纠错码解码器系统可能消耗大量资源以便实现高水平的纠错能力。发明内容 [0008] 根据一个实施方式，提供了一种用于对数据进行解码的方法。该方法包括：接收待解码数据；使用根据第一解码过程对数据进行解码的第一纠错电路对所接收的数据进行解码；在第一纠错电路完成执行第一解码过程之前终止对用于纠正数据的该第一解码过程的执行，并且输出经部分解码的数据；确定经部分解码的数据是否需要进一步解码；以及响应于该确定，使用根据第二解码过程对数据进行解码的第二纠错电路对经部分解码的数据进行解码。 [0009] 根据另一实施方式，在前述方法中，终止对第一解码过程的执行包括导出解码器错误度量；将解码器错误度量与停止规则相比较；确定解码器错误度量是否已满足停止规则；以及响应于确定解码器错误度量已满足停止规则而在完成第一解码过程之前终止对第一解码过程的执行。 [0010] 根据第三实施方式，在前述方法中，终止对第一解码过程的执行包括确定是否已发生预定时间事件，该预定时间事件包括第一纠错电路的时间单位，其中该时间单位是时钟周期或者迭代解码器的迭代。 [0011] 根据第四实施方式，在前述方法中，确定经部分解码的数据是否需要进一步解码包括确定解码器错误度量是否指示发散。 [0012] 根据第五实施方式，一种用于对数据进行解码的系统。该系统包括纠错电路，其被配置成根据第一解码过程对所接收的数据进行解码。该纠错电路被配置成在完成第一解码过程之前终止对用于纠正数据的该第一解码过程的执行，并且输出经部分解码的数据；确定经部分解码的数据是否需要进一步解码；以及响应于确定经部分解码的数据需要进一步解码而根据第二解码过程对经部分解码的数据进行解码。 [0013] 根据第六实施方式，纠错电路包括迭代解码器。 [0014] 根据第七实施方式，该纠错电路进一步被配置成：导出解码器错误度量；将该解码器错误度量与停止规则相比较；确定解码器错误度量是否已满足停止规则；以及响应于确定解码器错误度量已满足停止规则而在完成第一解码过程之前终止对第一解码过程的执行。 [0015] 根据第八实施方式，该纠错电路进一步被配置成：确定预定时间间隔中在第一解码过程中的翻转的位的数目。 [0016] 根据第九实施方式，该纠错电路进一步被配置成：确定是否已发生预定时间事件，该预定时间事件包括纠错电路的时间单位。该时间单位是时钟周期或者第一解码过程的迭代。 [0017] 根据第十实施方式，该纠错电路进一步被配置成：确定解码器错误度量是否指示发散。附图说明 [0018] 当与附图结合考虑以下详细描述时，本公开的其他特征、本公开的本质以及各种优势将变得明显，在附图中，相似的参考符号通篇指示相似的元素，并且在附图中： [0019] 图1示出了根据本公开的一个实施方式的存储系统的示例； [0020] 图2示出了根据本公开的一个实施方式的纠错电路的示例； [0021] 图3A至图3B示出了用于根据本公开的一个实施方式对所接收的数据进行解码的说明性过程；以及 [0022] 图4示出了用于根据本公开的另一实施方式对所接收的数据进行解码的说明性过程。具体实施方式 [0023] 为了提供对本公开的整体理解，现在将描述某些说明性实施方式。然而，在此描述的系统和方法可以被适应和修改为适合于所处理的应用，并且在此描述的系统和方法可以在其他适当的应用中采用，以及此类其他添加和修改将不会脱离其范围。 [0024] 图1示出了根据本公开的一个实施方式的存储系统100的示例。系统100可以用于将所接收的数据104从存储电路102传递到纠错电路106。在纠错电路106处理所接收的数据104以产生经解码的输出数据之后，经解码的输出数据被提供给输出端114。控制器电路108将控制器信号110提供给纠错电路106，这配置并且控制纠错电路106的操作。控制器信号 110可以从纠错电路106传送到控制器电路108，以便控制器电路108决定纠错电路106应当利用来进行操作的过程，以及确定向纠错电路106提供的配置和控制信号110。 [0025] 存储电路102可以表示其中存储有所接收的数据104的任何适当的存储介质，诸如磁存储设备(例如，硬盘)、电存储设备(例如，闪存、RAM)或者光存储设备(例如，CD-ROM)。在某些买施方式中，存储电路102可以表示闪存系统。备选地，存储电路102可以表示通过其传达所接收的数据104的任何适当的有线或者无线传输介质。存储电路102内的传输或者存储介质可以引起所接收的数据104受依赖于信号的噪声或者不依赖于信号的噪声和/或干扰所影响。该噪声可以在所接收的数据104中造成错误。为了纠正所接收的数据104中可能存在的错误，由纠错电路106对所接收的数据104进行解码。 [0026] 可以使用一个或者多个数据承载信号将所接收的数据104从存储电路102传递到纠错电路106。数据承载信号可以通过存储电路102内的可能使信号退化的传输或者存储介质来传递。 [0027] 纠错电路106从存储电路102接收所接收的数据104。如前所述，引入到经编码的数据中的噪声和/或干扰或者在存储电路102处所接收的噪声和/或干扰可以在所接收的数据104中造成错误。纠错电路106尝试基于这些错误对数据进行解码。 [0028] 图2示出了根据本公开的一个实施方式的纠错电路106的示例。纠错电路106接收所接收的数据104并且处理该数据，以便纠正可能存在的错误。从控制器电路108接收的配置和控制信号110用来配置和控制纠错电路106的操作。 [0029] 在某些实施方式中，纠错电路106可以使用其中使用了多个纠错码的级联编码方案。图2示出了级联编码方案，其包括第一纠错电路202和第二纠错电路204。第一纠错电路202和第二纠错电路204可以使用相同、相似或者不同的解码技术。在某些实施方式中，第一纠错电路202用于去除所接收的数据104中的大部分错误，从而使得第二纠错电路204接收可以被校正并且被提供给输出端114的相对少的错误。与第二纠错电路204相比，第一纠错电路202可能消耗更多的功率以执行其解码过程。 [0030] 某些实施方式中，第一纠错电路202可以被实现为迭代解码器，诸如LDPC解码器或者Turbo解码器。LDPC解码器的示例为硬解码器(诸如位翻转解码器)或者软解码器(诸如基于对数似然性的解码器)。迭代解码器允许在所接收的数据104上发生解码过程的多个迭代。每个迭代尝试改善由之前的纠错迭代执行的纠错。在某些实施方式中，第一纠错电路202可以被实现为允许解码过程在完成之前终止并且可以提供经部分解码的输出的任何纠错解码器。 [0031] 在某些实施方式中，第二纠错电路204可以基于代数码以产生使用硬解码模式的输出。这些类型的代码的示例为里得-所罗门(Reed-Solomon)码或者BCH码。如前所述，第二纠错电路204可以被配置成用于纠正比第一纠错电路202相对更少的错误，从而允许第二纠错电路204具有更短的平均解码时间并且消耗比第一纠错电路202更少的功率。 [0032] 在某些实施方式中，第一纠错电路202处理所接收的数据104以产生第一经解码的输出212。基于某些停止规则，执行终止电路206可以在控制器电路108的引导下产生终止信号220。停止规则可以是向第一纠错电路202指示不需要进一步纠错的预定规则。如果第一纠错电路202从执行终止电路206接收到用于终止的信号，则控制器电路108可以引导第一纠错电路202提早终止执行，并且产生经部分解码的输出。如果第一纠错电路202完成，并且并未提早终止执行，则输出经完全解码的数据。 [0033] 在第一纠错电路202终止或者完成之后，第一经解码的输出212可以被提供给选择电路208。选择电路208可以包括MUX、de-MUX、交换机或者允许输入被路由到所选输出的任何电路。选择电路208在控制器电路108的引导下选择是将第一经解码的输出216b直接提供给输出选择电路210、还是将第一经解码的输出216a提供给第二纠错电路204。该选择可以基于停止规则。如果第一经解码的输出216a被提供给第二纠错电路204，则第二纠错电路204对第一经解码的输出216a进行解码，并且纠正可能剩余的错误。第二纠错电路204继而可以在控制器电路108的引导下提供第二经解码的输出214给输出选择电路210。基于停止规则，输出选择电路210可以在控制器电路108的引导下向输出端114提供第一经解码的输出216b，或者如果执行了第二纠错电路204的解码过程，则提供第二经解码的输出214。 [0034] 通过允许第一纠错电路202早些终止，可以降低第一纠错电路的功耗和解码时间，并且剩余错误可以由更低功率且更快的第二纠错电路204来纠正。由于大部分时间和功率被第一纠错电路202所消耗，所以通过减少由第一纠错电路202所使用的资源，可以降低整体系统功率和解码时间。 [0035] 在图3A至图3B以及图4中更加详细地描述了在纠错电路106内的解码过程。这些附图示出了如下方法，该方法描述了不同电路之间的交互，特别是执行终止电路206、第一纠错电路202与第二纠错电路204之间的交互以及停止规则如何帮助控制器电路108控制和配置每个电路。 [0036] 图3A至图3B示出了用于根据本公开的一个实施方式对所接收的数据104进行解码的说明性过程300和304。图3A描述了由纠错电路106执行的整体过程。在302处，纠错电路106从存储电路102接收所接收的数据104。在304处，第一纠错电路202执行第一解码过程。在第一解码过程终止之后，在306处，由控制器电路108做出是否需要进一步解码的判定。在 312处，如果不需要进一步解码过程，则控制器电路108引导选择电路208和输出选择电路 210在314处将第一经解码的输出212发送给输出端114。否则，如果需要进一步解码，则在 310处，选择电路208被引导以发送第一经解码的输出212给第二纠错电路204，以在308处执行第二解码过程。一旦第二纠错电路204完成，则由第二纠错电路204产生的第二经解码的输出214通过输出选择电路210在314处被递送给输出端114。 [0037] 图3B更详细地讨论了使用第一纠错电路202处理第一解码过程以及确定在第一解码过程期间何时终止的方法304。在302处，在接收所接收的数据104之后，在316处，控制器电路108引导第一纠错电路202执行第一解码过程。在316处，执行第一解码过程，直到已发生预定时间事件为止。预定时间事件可以包括预定的时间单位，其可以是时钟周期、迭代解码器的迭代或者第一解码过程的预定阶段。 [0038] 在318处，在经过预定的时间单位之后，控制器电路108确定第一解码过程是否已完成。在326处，如果第一解码过程已完成，则在322处，控制器电路108引导第一纠错电路202终止第一解码过程，并且输出经完全解码的数据。在328处，如果第一解码过程并未完成，则在320处，控制器电路108通过将终止信号220从执行终止电路206发送到第一纠错电路202来确定是否提早终止第一解码过程。 [0039] 控制器电路108基于停止规则确定是否终止第一解码过程。停止规则是指示第一纠错电路202是否要求进一步解码的预定规则。例如，如果控制器电路108估计在当前经处理的用户数据中的剩余错误的经计算的数目非常有可能是预定错误阈值、等于或者小于预定错误阈值，则可以不要求进一步解码。在某些实施方式中，如果控制器电路108估计在当前经处理的用户数据中的剩余错误的经计算的数目等于或者小于预定错误阈值，则可以不要求进一步解码。在另一示例中，基于计算的校验子权重(syndrome weight)与预定阈值的比较，可以不要求进一步解码。校验子权重是由第一纠错电路202计算的、指示在当前经处理的所接收的数据中的剩余错误的似然性的经计算值。这些经计算值中的每个经计算值是指示当前经处理的所接收的数据的可靠性的可靠性度量。 [0040] 在330处，如果控制器电路108确定第一解码过程不应当早些终止，则在316处，第一解码过程继续处理，直到已过去另一预定的时间单位为止。否则，在332处，如果控制器电路108确定第一解码过程应当早些终止，则在324处，终止第一解码过程，并且输出经部分解码的数据。 [0041] 如前所述，停止规则指示是否要求使用第一解码过程的进一步处理。如果经估计，当前经处理的所接收的数据内的错误的数目对于供第二纠错电路204进行纠正而言足够低的话，则可以不要求使用第一解码过程的进一步解码。通过使用第二纠错电路204，可以降低整体系统功率和整体解码时间。 [0042] 备选地，如果进一步处理不是针对纠错而做出的，则可以不要求第一解码过程的进一步处理。时间单位之间的经解码的数据值的改变可以用作对第一解码过程是否正在进展的指示符。 [0043] 附加地，不同时间单位之间的用户数据的改变的数目也可以指示在第一解码过程是否正在做出进展。不是确定错误是否已被纠正，而是控制器电路108可以计算用户数据内的改变的数目。几乎没有改变或者没有改变可以指示第一解码过程已停顿(stall)。用户数据的较大改变可以指示第一解码过程已失败，并且进一步解码可能增加错误的数目。当确定对于纠错而言没有进展时，终止该第一解码过程可以节省解码功率，并且减少解码时间，这是由于利用第一纠错电路202的附加使用将几乎不会带来进展或者不会带来进展。 [0044] 用于终止第一解码过程的执行的方法中的每个方法可以单独使用或者组合在一起使用。 [0045] 在某些实施方式中，用于确定当前经处理的所接收的数据内的错误的数目较低的方法可以包括确定校验子权重是否在预定阈值以下。解码过程的校验子权重可以指示在经处理的所接收的数据中剩余的错误的似然性。校验子权重由第一纠错电路202的第一解码过程计算。校验子权重的计算可以基于预定的时间单位而频繁更新，或者每当控制器电路108确定第一解码过程的进一步处理时更新。 [0046] 较低的校验子权重可以指示用户数据中几乎没有剩余的错误。较低的校验子权重也可以用来指示已达到困境状态(trapping state)。当在用户数据中剩余错误的数目较低时，可能发生困境状态，其中不再有错误得到纠正。当处于困境状态中时，执行对使用第一解码过程的用户数据的进一步解码可能不会导致纠正更多的错误。通过标识校验子权重在某一阈值之下，可以避免困境状态，从而防止发生由于不能纠正更多错误的浪费的处理。 [0047] 为了降低功耗并且改善解码时间，控制器电路108可以引导第一纠错电路202早些终止第一解码过程，并且引导第二纠错电路204尝试纠正剩余错误中的剩余部分。如果校验子权重指示不存在错误，则控制器电路108可以引导纠错电路106跳过第二纠错电路204的第二解码过程。控制器电路108可以使用多个预定阈值来确定是否提早终止第一解码过程。继而，控制器电路108可以引导第二纠错电路204执行使用第二解码过程的进一步处理，或者引导选择电路208和输出选择电路210将第一纠错电路202的经解码的输出212提供给输出端114。 [0048] 在某些实施方式中，用于确定当前经处理的用户数据内的错误的数目未在减少的方法可以包括确定校验子权重是否在预定阈值之上。如前所述，校验子权重可以指示在经处理的用户数据中剩余的错误的似然性。较大的校验子权重可以指示剩余错误的数目较高。错误的数目可能过大以至于不能由第一纠错电路202的第一解码过程进行纠正。对用户数据的进一步处理可能不会对纠错过程提供任何改善，并且可能只是消耗功率和时间。在其中错误的数目可能较大的情况中，系统可以依靠备选方法(即，存储电路102内的重试和重传机制)来纠正这些错误电路。通过控制器电路108确定校验子权重是否超过预定阈值，第一解码过程可以终止，而不浪费功率和时间。 [0049] 备选地，控制器电路108可以跨多个预定时间单位之间比较校验子权重的改变。校验子权重的减小可以指示正在做出纠错进展，并且第一解码过程可以能够纠正错误。相反，校验子权重的增加可以指示解码过程正在引入更多的错误而不是纠正错误。通过跨多个时间单位相比较，控制器电路108可以确定进一步解码是否可能是有益的。 [0050] 在某些实施方式中，用于确定第一解码过程是否正向经解码的数据提供改变的方法可以包括确定在给定时间单位中，其值改变的位或者符号的数目、翻转的位的数目、或者经处理的所接收的数据的位的似然性的改变。控制器电路108可以通过将经解码的数据的改变与预定阈值相比较而评估第一解码过程的进展。后续时间单位之间的小的改变可以指示第一解码过程未在进展。如果几乎没有改变或者不发生改变，则第一解码过程可能处于稳定状态，其中不能够纠正附加的错误。为了防止浪费功率并且为了减小解码时间，控制器电路108可以引导执行终止电路206将终止信号220发送给第一纠错电路202，以当确定了稳定状态时早些终止。 [0051] 备选地，后续时间单位之间的非常大的改变也可以指示第一解码过程未在正确的方向上进展。例如，如果第一纠错电路被配置成纠正多达100个错误，而在给定时间单位中翻转了200个比特，则解码过程可能已失败，并且将不会实现进一步进展。在该情况中，解码过程的早些终止防止功率和解码时间的进一步浪费。针对给定预定时间单位，将其值改变的位/符号的数目(即，翻转的位的数目)与预定阈值相比较允许控制器电路108确定是否可以实现进一步进展。 [0052] 在某些实施方式中，用于确定第一解码过程可能不需要进一步处理的方法可以基于对数似然比(LLR)。第一纠错电路202可以计算对数似然比(LLR)度量，以指示经解码的数据或者所接收的数据的位为1或者0的似然性。大量的位具有为1或者0的高似然性可以指示剩余错误的数目较低。当剩余错误的数目较低时，控制器电路108可以引导执行终止电路206向第一纠错电路202发送终止信号220以终止执行，并且继而引导第二纠错电路204来纠正剩余错误。 [0053] 备选地，大量位具有为0或者1的低似然性可以指示剩余错误的数目较高。在后续时间单位之后似然性几乎没有改变或者没有改变可以指示第一解码过程已失败，并且不能实现进展。在该情形中，解码过程的早些终止防止功率和解码时间的进一步浪费。针对给定预定时间单位，将LLR度量的改变相比较允许控制器电路108确定是否可以实现进一步进展。 [0054] 图4示出了用于根据本公开的另一个实施方式对所接收的数据进行解码的说明性过程400。在402处，由纠错电路106从存储电路102接收所接收的数据。所接收的数据104被提供给第一纠错电路202，并且在404处，执行第一解码过程。在过去预定的时间单位之后，在406处，控制器电路108确定第一纠错电路202的第一解码过程是否已完成。在422处，如果第一解码过程未完成，则在408处，控制器电路108确定是否已满足停止规则。否则，在420处，如果第一解码过程已完成，则在412处，第一纠错电路202已终止第一解码过程。 [0055] 如上所述，在408处，确定是否已满足停止规则包括由控制器电路108将由第一纠错电路202计算的经计算的解码器错误度量与停止规则相比较。解码器错误度量可以包括可靠性度量。停止规则可以包括预定阈值，并且可靠性度量可以包括在预定的时间单位中改变的或者翻转的位/符号的数量的计算值、LLR的改变、校验子权重或者校验子权重的改变。 [0056] 在424处，如果并未满足停止规则，则在410处，控制器电路108引导第一纠错电路202继续第一解码过程持续另一预定时间单位。在426处，如果停止规则已满足，则在412处，控制器电路108引导执行终止电路206向第一纠错电路202发送终止信号，以早些终止第一解码过程。 [0057] 在第一解码过程已终止之后，在414处，控制器电路108确定在第一解码过程期间是否已发生发散。发散指示经解码的输出数据中的剩余错误的数目不会通过进一步解码减少。由控制器电路108进行的发散确定可以包括分析停止规则，以确定是否第一解码过程已失败，而大量错误和剩余错误无法被纠正。在430处，如果已发生发散，则在418处，控制器电路108可以引导选择电路208和输出选择电路210将由第一纠错电路202产生的经解码的输出数据212递送给输出端114。否则，在428处，如果并未发生发散，则在416处，经解码的输出数据212被提供给第二纠错电路204，以执行第二解码过程。在第二解码过程完成之后，在418处，控制器电路108引导第二纠错电路204和输出选择电路210，以提供结果给输出端 114。 [0058] 前述仅示例说明了本公开的原理，并且可以在不脱离本公开的范围的情况下进行各种修改。本公开的上述实施方式是出于示例说明而不是限制的目的而呈现，并且本公开仅由以下权利要求书限制。

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