使用以处理器为基础的系统中用于分区资源的内插而提供精
细度的服务质量控制
[0002] 本申请要求2017年8月29日提交的标题为“
使用以处理器为基础的系统中用于分区资源的内插而提供精细度的服务质量控制”的美国
专利申请序列号15/689,543的优先权，所述美国专利申请以引用方式全文并入本文中。
技术领域
[0003] 本公开的技术大体上涉及以处理器为基础的系统中的分区资源，且具体地说涉及用于分区资源的服务质量(QoS)机构。
背景技术
[0004] 常规以处理器为基础的系统提供资源(例如系统高速缓冲
存储器及/或存储器存取带宽)，其可在多个资源客户端之间共享。为增加并行度，资源可再分为可大部分彼此独立地操作及/或存取的多个分区。举例来说，系统
高速缓冲存储器(例如，作为非限制性实例，末阶高速缓存)可分区成多个“切片”或“例项”，各自提供相同数目个高速缓存通路。通过不同资源客户端进行的高速缓存存取操作可使用常规地址到分区映射技术基于例如高速缓存存取操作的存储器地址的散列而指配给高速缓冲存储器分区中的一个。
[0005] 为促进共享，服务质量(QoS)机构可在不同资源客户端之间选择性地分配资源的部分，不同资源客户端可根据不同优先权、相对重要性及/或性能目标操作。举例来说，在上文所描述的高速缓存实例中，对应于资源客户端的“通路屏蔽”(即，包含每一高速缓存通路的位的位屏蔽)可用于分配用于每一高速缓冲存储器分区的高速缓存通道的子集以供所述资源客户端使用。作为非限制性实例，20通路组联高速缓存可再分为八个(8)分区，其中每一资源客户端的通路屏蔽具有20个位以指示20个通路中的哪一个经分配到所述资源客户端。因为每一资源客户端的通路屏蔽应用于所有分区，所以可分配到每一资源客户端的最小高速缓存空间为5％，或在八(8)个分区内的20个通路中的一个(1)。
[0006] 同样地，还可使用在概念上类似的控制分配存储器存取带宽。作为实例，以处理器为基础的系统可提供四个(4)存储器
控制器作为存储器存取带宽提供者。每一资源客户端可经指配四个(4)位的“存储器步幅值”以指示对于存储器带宽的
请求如何经加权用于所述资源客户端，其中较低存储器步幅值指示较高权重。因为存储器步幅值可具有16个不同值(即0到15)，所以可经分配到每一资源客户端的最小存储器存取带宽为总存储器存取带宽的6.25％(或1/16)。
[0007] 然而，精细度的QoS控制可为分配共享资源所需要。上文所描述的QoS机构允许仅仅相对粗糙控制，其限制分配
分辨率并抑制可存取给定共享资源的资源客户端的数目。此外，用于实施精细度的QoS控制的许多机构可导致较高
硬件实施成本。
发明内容
[0008] 根据本公开的方面包含使用以处理器为基础的系统中用于分区资源的内插而提供精细度的服务质量(QoS)控制。就此来说，在一个方面中，以处理器为基础的系统提供分区资源(即，作为非限制性实例，系统高速缓冲存储器或到共享系统存储器的存储器存取带宽)，所述分区资源再分为多个分区且被配置成为多个资源客户端服务。对于资源客户端与分区的每一组合，分配指示符经提供以指示针对资源客户端的分区的分配。作为非限制性实例，其中分区资源为具有多个通路的分区高速缓存的方面可提供分配指示符以指示分区的多少通路可分配到资源客户端。类似地，其中分区资源为多个存储器存取带宽提供者的方面可规定分配指示符指示在执行资源客户端的存储器存取操作时待通过存储器控制器应用的步幅。
[0009] 因为每一分配指示符对于资源客户端与分区的每一组合可为不同的，所以所述分配指示符的内插为每一资源客户端提供较高分辨率聚合资源分配。举例来说，如果分区资源为分成四个(4)分区的10通路组联高速缓存，那么常规QoS机构将仅仅允许高速缓存以10％的最小分辨率(即，最小分配为10个中的1个通路)来分配。然而，根据本文所公开的方面，给定资源客户端的分配指示符对于每一分区可变化。作为非限制性实例，资源客户端可经分配第一及第二分区的50％，及第三及第四分区的60％。此导致用于资源客户端的55％的高速缓存的总聚合分配。
[0010] 在另一方面中，公开一种用于提供分区资源的精细度的QoS控制的以处理器为基础的系统。所述以处理器为基础的系统包括经再分为多个分区且被配置成为多个资源客户端服务的分区资源。所述以处理器为基础的系统进一步包括资源分配代理及多个分配指示符，每一分配指示符对应于所述多个分区中的一分区及多个资源客户端中的一资源客户端，且表示针对资源客户端的分区的分配。资源分配代理被配置成基于用于所述多个资源客户端中的每一资源客户端的所述多个分配指示符的内插在所述多个资源客户端之间分配分区资源。
[0011] 在另一方面中，公开一种用于提供分区资源的精细度的QoS控制的以处理器为基础的系统。所述以处理器为基础的系统包括用于基于多个分配指示符的内插在多个资源客户端之间分配分区资源的装置，所述分区资源再分为多个分区，每一分配指示符对应于所述多个分区中的一分区及多个资源客户端中的一资源客户端，且表示针对资源客户端的分区的分配。
[0012] 在另一方面中，公开一种用于提供分区资源的精细度的QoS控制的方法。所述方法包括通过以处理器为基础的系统的资源分配代理基于多个分配指示符的内插在多个资源客户端之间分配分区资源，所述分区资源再分为多个分区，每一分配指示符对应于所述多个分区中的一分区及多个资源客户端中的一资源客户端，且表示针对资源客户端的分区的分配。
[0013] 在另一方面中，提供一种非暂时性计算机可读媒体。所述非暂时性计算机可读媒体在上面存储计算机可执行指令，所述计算机可执行指令在由处理器执行时促使所述处理器基于多个分配指示符的内插在多个资源客户端之间分配分区资源，所述分区资源再分为多个分区，每一分配指示符对应于所述多个分区中的一分区及多个资源客户端中的一资源客户端，且表示针对资源客户端的分区的分配。
附图说明
[0014] 图1为用于通过采用资源分配代理及分配指示符使用分区资源的内插而提供精细度的服务质量(QoS)控制的示例性以处理器为基础的系统的
框图；
[0015] 图2为包含系统高速缓冲存储器及高速缓存控制器的图1的以处理器为基础的系统的示例性实施的框图；
[0016] 图3为绘示通过图2的高速缓存控制器进行以提供图2的系统高速缓冲存储器的精细度的QoS控制的分配指示符的示例性内插的框图；
[0017] 图4为包含共享系统存储器及存储器管理单元(MMU)的图1的基于处理器的系统的示例性实施的框图；
[0018] 图5为绘示通过图4的MMU进行以提供用于图4的共享系统存储器的存储器存取带宽的精细度的QoS控制的分配指示符的示例性内插的框图；
[0019] 图6为绘示用于通过图1的资源分配代理使用用于分区资源的内插而提供精细度的QoS控制的示例性程序的
流程图；
[0020] 图7为绘示用于接收存取请求并指配存取请求给分区资源的分区的图1的资源分配代理的其它示例性操作的流程图；且
[0021] 图8为可包含图1的资源分配代理的示例性以处理器为基础的系统的框图。
具体实施方式
[0022] 现参考附图，描述本公开的若干示例性方面。词语“示例性”在本文中用以意味着“充当实例、例子或说明”。本文中被描述为“示例性”的任何方面未必被认作比其它方面优选或更有利。
[0023] 公开于具体实施方式中的方面包含使用以处理器为基础的系统中用于分区资源的内插而提供精细度的服务质量(QoS)控制。就此来说，图1绘示包含中央处理单元(CPU)102及在多个资源客户端106(0)到106(C)之间共享的分区资源104的示例性以处理器为基础的系统100。根据一些方面的分区资源104可包括系统高速缓冲存储器(例如末阶高速缓存)，及/或可经由多个存储器控制器(图中未绘示)存取的共享系统存储器的存储器存取带宽。作为非限制性实例，资源客户端106(0)到106(C)可包括并行执行的
软件程序、
虚拟机、硬件装置，或被配置成存取分区资源104的其它实体。应理解，图1的以处理器为基础的系统
100可涵盖已知数字逻辑元件、
半导体电路及处理核心中的任一者，及/或存储器结构、以及其它元件或其组合。本文中所描述的方面并不限于任何特定的元件的布置，且所公开的技术可容易地延伸到半导
体模具或封装上的各种结构及布局。应理解，以处理器为基础的系统100的一些方面可包含除图1中所绘示的那些元件以外的元件。
[0024] 为促进通过分区资源104的资源客户端106(0)到106(C)的并行使用，以处理器为基础的系统100规定分区资源104再分为多个分区108(0)到108(P)，其中的每一个可进一步分成可在资源客户端106(0)到106(C)之间选择性分配的子单元。举例来说，在其中分区资源104包括系统高速缓冲存储器(例如，末阶高速缓存，作为非限制性实例)的以处理器为基础的系统100的方面中，分区108(0)到108(P)可包括高速缓存“切片”或“例项”，其中的每一个提供相同数目个高速缓存通路。类似地，分区资源104包括用于共享系统存储器的存储器存取带宽提供者的以处理器为基础的系统100的方面可规定：分区108(0)到108(P)中的每一个包括存储器存取带宽提供者，例如一存储器控制器。在两个方面中，来自资源客户端106(0)到106(C)，例如资源客户端106(0)的存取请求110基于例如与存取请求110相关联的存储器地址的散列而指配给分区108(0)到108(P)中的一个。
[0025] 然而，如上文所提及，用于在资源客户端106(0)到106(C)之间分配分区资源104的常规QoS机构不可能提供足够分配分辨率(即，可通过QoS机构分配的分区资源104的最小可分配部分对于精确分配来说仍可能过大)。此外，这些粗糙的QoS机构可对可存取给定共享资源的资源客户端的数目强加固有限制。因此，需要实施精细度的QoS机构以提供较高分配分辨率而不招致过度较高硬件实施成本。
[0026] 就此来说，图1的以处理器为基础的系统100提供资源分配代理112。虽然资源分配代理112在图1中绘示为独立元件，但在一些方面中，资源分配代理112可集成到CPU102中、集成到高速缓存控制器(图中未绘示)或存储器管理单元(MMU)(图中未绘示)中、集成到以处理器为基础的系统100的其它元件中或跨越以处理器为基础的系统100的其它元件分布，及/或部分通过软件实体(图中未绘示)，例如由以处理器为基础的系统100的CPU 102执行的
操作系统或超管理器来实施。资源分配代理112采用与分区108(0)到108(P)相关联的多个分配指示符114(0)到114(C)、114'(0)到114'(C)。分配指示符114(0)到114(C)、114'(0)到114'(C)中的每一个对应于资源客户端106(0)到106(C)中的一个与分区108(0)到108(P)中的一个的独特组合，且表示针对对应资源客户端106(0)到106(C)的分区108(0)到108(P)的分配。举例来说，在图1中，假设分配指示符114(0)对应于用于资源客户端106(0)的分区108(0)，而分配指示符114'(0)对应于用于资源客户端106(0)的分区108(P)。取决于存取请求110是指配给分区108(0)还是分区108(P)，分配指示符114(0)或分配指示符114'(0)将由资源分配代理112使用以确定对应分区108(0)、108(P)中的多少可被分配到资源客户端106(0)以满足存取请求110。
[0027] 不同于常规QoS机构，用于资源客户端106(0)到106(C)中的给定资源客户端的分配指示符114(0)到114(C)、114'(0)到114'(C)中的每一个可跨越不同分区108(0)到108(P)而变化。结果，例如资源客户端106(0)的资源客户端可经分配分区108(0)到108(P)中的每一个的不同部分。通过内插不同分配指示符114(0)到114(C)、114'(0)到114'(C)，可达到较高分配分辨率，因此使得分区资源104的较小部分能够在必要时被分配到资源客户端106(0)到106(C)中的每一个。
[0028] 为绘示以处理器为基础的系统100的示例性方面，提供图2到5。图2绘示图1的以处理器为基础的系统100的示例性实施，其中分区资源104包括系统高速缓冲存储器且资源分配代理112包括高速缓存控制器，而图4绘示图1的以处理器为基础的系统100的示例性实施，其中分区资源104包括用于共享系统存储器的存储器存取带宽提供者且资源分配代理112包括MMU。图3及5经提供以绘示分配指示符114(0)到114(C)、114'(0)到114'(C)的内插如何在前述方面中的每一个中提供精细度的QoS控制。
[0029] 如图2中所见，以处理器为基础的系统100的一个方面可提供对应于图1的资源分配代理112的高速缓存控制器200。图2进一步提供对应于图1的分区资源104的系统高速缓冲存储器202，及对应于图1的分区108(0)到108(P)的多个高速缓冲存储器分区204(0)到204(H)。因此，本文中关于图1的资源分配代理112、分区资源104及分区108(0)到108(P)的公开内容分别应用于图2的高速缓存控制器200、系统高速缓冲存储器202及高速缓冲存储器分区204(0)到204(H)。作为非限制性实例，系统高速缓冲存储器202可包括1阶(L1)高速缓存、2阶(L2)高速缓存、3阶(L3)高速缓存及/或末阶高速缓存。在接收包括存储器地址208的高速缓存存取请求206后，高速缓存控制器200指配高速缓存存取请求206给高速缓冲存储器分区204(0)到204(H)中的一个(例如基于存储器地址208的散列)。
[0030] 在图2的实例中的分配指示符114(0)到114(C)、114'(0)到114'(C)各自包括提供多个位指示符(图中未绘示)的通路屏蔽(图中未绘示)。分配指示符114(0)到114(C)、114'(0)到114'(C)的每一位指示符对应于系统高速缓冲存储器202的高速缓冲存储器分区204(0)到204(H)中的一个的一个通路，且指示对应通路是否已分配到相关联资源客户端106(0)到106(C)。使用通过分配指示符114(0)到114(C)、114'(0)到114'(C)提供的通路屏蔽，高速缓存控制器200分配经指配高速缓冲存储器分区204(0)到204(H)的一部分以代表资源客户端106(0)到106(C)进行高速缓存存取请求206。
[0031] 图3提供在图2的实例中的分配指示符114(0)到114(C)、114'(0)到114'(C)可如何经内插以提供图2的系统高速缓冲存储器202的精细度的QoS控制的更详细说明。在此实例中，假设高速缓冲存储器分区204(0)到204(H)的数目为四(即，H＝3)，且进一步假设系统高速缓冲存储器202的高速缓冲存储器分区204(0)到204(3)由10个通路组成。因此，分配指示符114(0)到114(3)、114'(0)到114'(3)提供通路屏蔽300(0)到300(3)、300'(0)到300'(3)，其中的每一个是由对应于10个通路的10个位组成。分配指示符114(0)到114(3)分别表示针对资源客户端106(0)的系统高速缓冲存储器202的高速缓冲存储器分区204(0)到204(3)的分配。分配指示符114'(0)到114'(3)分别表示针对资源客户端106(C)的系统高速缓冲存储器202的高速缓冲存储器分区204(0)到204(3)的分配。
[0032] 因为在此实例中的系统高速缓冲存储器202由10个通路组成，所以常规QoS机构将能够仅仅以10％的增量分配系统高速缓冲存储器202。然而，通过内插分配指示符114(0)到114(3)、114'(0)到114'(3)以确定针对资源客户端106(0)、106(C)的系统高速缓冲存储器
202的聚合分配，可达到较高分配分辨率。在图3的实例中，替代10％的分辨率，系统高速缓冲存储器202可通过在高速缓冲存储器分区204(0)到204(3)中的一个(1)中分配一个(1)通路，及在剩余的高速缓冲存储器分区204(0)到204(3)中分配零个(0)通路而以小如2.5％(即，在此实例中，通路的数目(10)除以高速缓冲存储器分区204(0)到204(3)的数目)的增量分配。应理解，上文所论述的百分比特定针对于图3的实例，且可在一些方面中根据通路的数目及高速缓冲存储器分区204(0)到204(H)的数目而变化。
[0033] 在图3的实例中，分配指示符114(0)及114(1)具有设定为一(1)值的前五个(5)位指示符，其指示高速缓冲存储器分区204(0)及204(1)的前五个(5)通路(即，50％)分别分配到资源客户端106(0)。分配指示符114(2)及114(3)具有设定为一(1)值的前六个(6)位指示符，其指示高速缓冲存储器分区204(2)及204(3)的前六个(6)通路(即，60％)分别分配到资源客户端106(0)。因此，针对资源客户端106(0)的系统高速缓冲存储器202的总聚合分配为55％(即，(50+50+60+60)/4)。同样地，分配指示符114'(0)及114'(1)具有设定为一(1)值的后五个(5)位指示符，其指示高速缓冲存储器分区204(0)及204(1)的后五个(5)通路(即
50％)分别分配到资源客户端106(C)。分配指示符114'(2)及114'(3)具有设定为一(1)值的后四个(4)位指示符，其指示高速缓冲存储器分区204(2)及204(3)的后四个(4)通路(即，
40％)分别分配到资源客户端106(C)。针对资源客户端106(C)的系统高速缓冲存储器202的总聚合分配因此为45％(即，(50+50+40+40)/4)，使用具有较粗糙分辨率的常规QoS机构将是不可能的分配。
[0034] 现参考图4，在另一方面中，图1的以处理器为基础的系统100可提供对应于图1的资源分配代理112的MMU 400、对应于图1的分区资源104的存储器存取带宽提供者402，及对应于图1的分区108(0)到108(P)的多个存储器控制器404(0)到404(M)。本文中关于图1的资源分配代理112、分区资源104及分区108(0)到108(P)的公开内容因此可分别应用于图4的MMU 400、存储器存取带宽提供者402及存储器控制器404(0)到404(M)。以处理器为基础的系统100还包含可通过资源客户端106(0)到106(C)经由存储器控制器404(0)到404(M)存取的共享系统存储器406。在一些方面中，作为非限制性实例，共享系统存储器406可包括动态
随机存取存储器(DRAM)。
[0035] 在图4的实例中，分配指示符114(0)到114(C)、114'(0)到114'(C)各自包括指示与对于对应资源客户端106(0)到106(C)的存储器存取带宽的请求相关联的权重的存储器步幅值(图中未绘示)。在一些方面中，存储器步幅值与指配给对于存储器存取带宽的请求的权重成反比，使得较低存储器步幅值指示较高权重。当MMU 400接收包括存储器地址410的存储器存取请求408时，MMU 400指配待由存储器控制器404(0)到404(M)中的一个处置的存储器存取请求408。作为非限制性实例，存储器存取请求408可基于存储器地址410的散列而指配给存储器控制器404(0)到404(M)中的一个。
[0036] 图5更详细地绘示图4的存储器存取带宽提供者402的精细度的QoS控制可如何通过内插分配指示符114(0)到114(C)、114'(0)到114'(C)而提供。在图5中，假设存储器控制器404(0)到404(M)的数目为四(即，M＝3)。分配指示符114(0)到114(3)、114'(0)到114'(3)提供存储器步幅值500(0)到500(3)、500'(0)到500'(3)，其具有四个(4)位的大小且指示指配给对于对应资源客户端106(0)到106(C)及存储器控制器404(0)到404(3)的存储器存取带宽的请求的相对权重。具体地说，分配指示符114(0)到114(3)分别表示针对资源客户端106(0)的存储器存取带宽提供者402的存储器控制器404(0)到404(3)的分配，而分配指示符114'(0)到114'(3)分别表示针对资源客户端106(C)的存储器存取带宽提供者402的存储器控制器404(4)到404(3)的分配。
[0037] 因为对于四位存储器步幅值500(0)到500(3)、500'(0)到500'(3)中的每一个存在16个可能值，所以常规QoS机构将能够仅仅以6.25％(即1/16)的增量分配存储器存取带宽提供者402。然而，在图5的实例中，较高分配分辨率可通过内插分配指示符114(0)到114(3)、114'(0)到114'(3)以提供分数存储器步幅值用于资源客户端106(0)、106(C)来达成。
在图5的实例中，替代6.25％的分辨率，存储器存取带宽提供者402可通过选择存储器控制器404(0)到404(M)中的一个(1)的为一(1)的存储器步幅值500(0)到500(3)、500'(0)到
500'(3)，及选择剩余存储器控制器404(0)到404(3)中的为零(0)的存储器步幅值500(0)到
500(3)、500'(0)到500'(3)而以小如1.5625％(即，在此实例中，1/16除以存储器控制器404(0)到404(3)的数目)的增量分配。应理解，上文所论述百分比特定针对于图5的实例，且可在一些方面中根据存储器步幅值500(0)到500(3)、500'(0)到500'(3)的大小及存储器控制器404(0)到404(3)的数目而变化。
[0038] 如图5中所见，分配指示符114(0)及114(1)已分别经指配存储器步幅值500(0)及500(1)，各自具有为二(2)的值。分配指示符114(2)及114(3)已分别经指配存储器步幅值
500(2)及500(3)，其中的每一个具有为一(1)的值。因此，用于资源客户端106(0)的存储器存取带宽提供者402的总聚合存储器步幅值为1.5。类似地，分配指示符114'(0)及114'(1)已分别经指配存储器步幅值500'(0)及500'(1)，各自具有为四(4)的值，而分配指示符114'(2)及114'(3)已分别经指配存储器步幅值500'(2)及500'(3)，各自具有为三(3)的值。用于资源客户端106(C)的存储器存取带宽提供者402的总聚合存储器步幅值因此为3.5。
[0039] 图6绘示用于使用用于分区资源104的内插而提供精细度的QoS控制的图1的以处理器为基础的系统100及资源分配代理112的示例性操作。为清楚起见，在描述图6时参考图1的元件。在图6中，操作以以处理器为基础的系统100提供分区资源104开始(框600)，所述分区资源再分为多个分区108(0)到108(P)且被配置成为多个资源客户端106(0)到106(C)服务。就此来说，以处理器为基础的系统100在本文中可被称作“用于提供再分为多个分区且被配置成为多个资源客户端服务的分区资源的装置”。
[0040] 资源分配代理112(例如，作为非限制性实例，图2的高速缓存控制器200及/或图4的MMU 400)接着基于多个分配指示符114(0)到114(C)、114'(0)到114'(C)的内插在所述多个资源客户端106(0)到106(C)之间分配分区资源104，每一分配指示符对应于所述多个分区108(0)到108(P)中的一分区108(0)到108(P)及所述多个资源客户端106(0)到106(C)中的一资源客户端106(0)到106(C)，并表示针对资源客户端106(0)到106(C)的分区108(0)到108(P)的分配(框602)。因此，资源分配代理112在本文中可被称作“用于基于多个分配指示符的内插在多个资源客户端之间分配分区资源的装置，每一分配指示符对应于所述多个分区中的一分区及多个资源客户端中的一资源客户端，且表示针对资源客户端的分区的分配”。
[0041] 为绘示用于接收存取请求(例如图1的存取请求110)并指配所述存取请求给分区资源104的分区108(0)到108(P)的图1的资源分配代理112的其它示例性操作，提供图7。为清楚起见，在描述图7时参考图1到5的元件。图7中的操作开始于资源分配代理112从所述多个资源客户端106(0)到106(C)中的一资源客户端106(0)到106(C)接收对于分区资源104的存取请求110(框700)。在提供图2的系统高速缓冲存储器202的以处理器为基础的系统100的方面中，用于接收存取请求110的框700的操作可通过高速缓存控制器200实施，且可包括接收包括存储器地址208的高速缓存存取请求206(框702)。同样地，包含图4的共享系统存储器406的以处理器为基础的系统100的方面可规定用于接收存取请求110的框700的操作可通过MMU 400实施，且可包括接收包括存储器地址410的存储器存取请求408(框704)。
[0042] 接下来，存取请求110经指配给分区资源104的分区108(0)到108(P)(框706)。根据图2及3中所绘示的方面用于指配存取请求110的框706的操作可包括基于存储器地址208的散列选择系统高速缓冲存储器202的多个高速缓冲存储器分区204(0)到204(H)中的一高速缓冲存储器分区204(0)到204(H)(框708)。在图4及5中所绘示的方面中，用于指配存取请求110的框706的操作可包括基于存储器地址410的散列选择所述多个存储器控制器404(0)到
404(M)中的一存储器控制器404(0)到404(M)来存取存储器存取带宽(框710)。资源分配代理112(例如，作为非限制性实例，图2的高速缓存控制器200及/或图4的MMU 400)基于多个分配指示符114(0)到114(C)、114'(0)到114'(C)中的一分配指示符114(0)到114(C)、114'(0)到114'(C)将分区资源104的分区108(0)到108(P)的一部分分配到资源客户端106(0)到
106(C)，每一分配指示符对应于多个分区108(0)到108(P)中的一分区108(0)到108(P)及多个资源客户端106(0)到106(C)中的一资源客户端106(0)到106(C)(框712)。
[0043] 根据本文所公开的方面使用以处理器为基础的系统中用于分区资源的内插而提供精细度的QoS控制可在任何以处理器为基础的装置中提供或集成到以处理器为基础的装置中。实例(非限制性地)包含机顶盒、娱乐单元、导航装置、通信装置、固定
位置数据单元、移动位置数据单元、全球
定位系统(GPS)装置、
移动电话、蜂窝式电话、智能电话、会话起始协议(SIP)电话、平板计算机、平板手机、
服务器、计算机、便携式计算机、移动计算装置、可佩戴式计算装置(例如，智能
手表、保健或健康
跟踪器、
护目镜等)、台式计算机、
个人数字助理(PDA)、监视器、计算机监视器、电视、调谐器、收音机、卫星收音机、音乐播放器、数字音乐播放器、便携式音乐播放器、数字视频播放器、视频播放器、数字视频光盘(DVD)播放器、便携式数字视频播放器、
汽车、车辆组件、航电系统、无人机及多旋翼
飞行器。
[0044] 就此来说，图8绘示对应于图1、2及4的以处理器为基础的系统100并可采用图1中所绘示的资源分配代理112的以处理器为基础的系统800的实例。以处理器为基础的系统800包含一或多个CPU 802，各自包含一或多个处理器804。一或多个CPU 802可具有耦合到一或多个处理器804以用于快速存取暂时存储的数据且在一些方面中可包括图1的资源分配代理112的高速缓冲存储器806。一或多个CPU 802耦合到
系统总线808且可将包含于以处理器为基础的系统800中的主控装置与从属装置相互耦合。如所熟知，一或多个CPU 802通过经由系统总线808交换地址、控制及数据信息而与这些其它装置通信。举例来说，一或多个CPU 802可将总线交易请求传达到作为从属装置的实例的存储器控制器810。根据一些方面，存储器控制器810可对应于图4的存储器控制器404(0)到404(M)。
[0045] 其它主控装置及从属装置可连接到系统总线808。如图8中所绘示，作为实例，这些装置可包含存储器系统812、一或多个输入装置814、一或多个输出装置816、一或多个网络
接口装置818及一或多个显示控制器820。在一些方面中，存储器系统812可包括图1的资源分配代理112。一或多个输入装置814可包含任何类型的输入装置，包含但不限于输入键、交换器、语音处理器等。一或多个输出装置816可包含任何类型的输出装置，包含但不限于音频、视频、其它视觉指示器等。一或多个网络接口装置818可为被配置成允许去到及来自网络822的数据交换的任何装置。网络822可为任何类型的网络，包含但不限于有线或无线网络、私用或公用网络、局域网(LAN)、无线局域网(WLAN)、广域网(WAN)、BLUETOOTHTM网络及因特网。一或多个网络接口装置818可被配置成支持任何类型的所要通信协议。存储器系统812可包含一或多个存储器单元824(0)到824(N)。
[0046] 一或多个CPU 802还可被配置成经由系统总线808存取一或多个显示控制器820以控制发送到一或多个显示器826的信息。一或多个显示控制器820发送信息到一或多个显示器826以待经由一或多个视频处理器828显示，所述视频处理器处理所述信息而以适合于一或多个显示器826的格式来显示。一或多个显示器826可包含任何类型的显示器，包含但不限于
阴极射线管(CRT)、
液晶显示器(LCD)、等离子显示器等。
[0047] 所属领域的技术人员应进一步了解，结合本文中所公开的方面描述的各种说明性逻辑
块、模块、电路及
算法可实施为
电子硬件、存储于存储器或另一计算机可读媒体中且由处理器或其它处理装置执行的指令，或这两者的组合。作为实例，本文中所描述的主控装置及从属装置可用于任何电路、硬件组件、集成电路(IC)或IC芯片中。本文中公开的存储器可为任何类型及大小的存储器，且可被配置成存储所需的任何类型的信息。为清楚地说明此互换性，上文已大体上就其功能性来说描述各种说明性组件、块、模块、电路及步骤。如何实施此功能性取决于特定应用、设计选项及/或强加于整个系统的设计约束。对于每一特定应用来说，所属领域的技术人员可针对每一特定应用而以变化的方式实施所描述的功能性，但不应将这些实施决策解译为致使脱离本公开的范围。
[0048] 可通过处理器、数字
信号处理器(DSP)、
专用集成电路(ASIC)、现场可编程
门阵列(FPGA)或经设计以执行本文中所描述的功能的其它可编程逻辑装置、离散门或晶体管逻辑、离散硬件组件或其任何组合来实施或执行结合本文中所公开的方面而描述的各种说明性逻辑块、模块及电路。处理器可为
微处理器，但在替代例中，处理器可为任何常规处理器、控制器、
微控制器或状态机。处理器还可实施为计算装置的组合(例如，DSP与微处理器的组合、多个微处理器、结合DSP核心的一或多个微处理器，或任何其它此类配置)。
[0049] 本文中所公开的方面可体现于硬件及存储于硬件中的指令中，且可驻留于例如随机存取存储器(RAM)、快闪存储器、
只读存储器(ROM)、电可编程ROM(EPROM)、电可擦可编程ROM(EEPROM)、寄存器、
硬盘、可移动磁盘、CD-ROM或所属领域中已知的任何其它形式的计算机可读媒体中。示例性存储媒体耦合到处理器，使得处理器可从存储媒体读取信息并将信息写入到存储媒体。在替代例中，存储媒体可与处理器成一体式。处理器及存储媒体可驻留于ASIC中。ASIC可驻留在远程站中。在替代例中，处理器及存储媒体可作为离散组件驻留在远程站、基站或服务器中。
[0050] 还应注意，描述在本文中示例性方面中的任一者中所描述的操作步骤以提供实例及论述。可以不同于所说明的序列的众多不同序列进行所描述的操作。此外，实际上可以数个不同步骤来执行单一操作步骤中描述的操作。此外，可组合示例性方面中所论述的一或多个操作步骤。应理解，流程图中所说明的操作步骤可经受所属领域的技术人员将容易明白的许多不同
修改。所属领域的技术人员还将理解，可使用多种不同技术及技法中的任一者来表示信息及信号。举例来说，可由
电压、
电流、
电磁波、
磁场或
磁性粒子、光场或光学粒子，或其任何组合来表示在贯穿以上描述中可能引用的数据、指令、命令、信息、信号、位、符号及码片。
[0051] 提供本公开的先前描述以使得任何所属领域的技术人员能够制造或使用本公开。所属领域的技术人员将容易地显而易见对本公开的各种修改，且本文中定义的一般原理可在不背离本公开的精神或范围的情况下应用于其它变体。因此，本公开并不希望限于本文中所描述的实例及设计，而应符合与本文中所公开的原理及新颖特征相一致的最广泛范围。
