专利汇可以提供一种应用于8位灰度图像匹配的高性能并行乘加电路专利检索,专利查询,专利分析的服务。并且本 发明 属于 硬件 设计技术领域,具体涉及一种应用于8位灰度图像匹配的高性能并行乘加 电路 。本发明的电路包括 配对 电路、数据组合电路、XtremeDSP、数据拆分电路和累加电路。解决了 现有技术 中积相关匹配电路使用过多DSP资源的技术问题,在占用传统电路一半DSP资源的情况下获得与传统电路相同的并行乘加运算性能。,下面是一种应用于8位灰度图像匹配的高性能并行乘加电路专利的具体信息内容。
1.一种应用于8位灰度图像匹配的高性能并行乘加电路,包括配对电路、和累加电路,其特征在于:还包括数据组合电路、XtremeDSP和数据拆分电路;
配对电路形成小图和大图中与小图相同大小的相关子图的对应点对;
数据组合电路对每一个对应点对,形成一个25位数据和一个18位数据,对于所述25位数据:第7位至第0位为相关子图像素点灰度值,第15位至第8位置零值,第23位至第
16位为小图像素点灰度值,第24位为符号位;对于所述18位数据:第7位至第0位为相关子图像素点灰度值,第16位至第8位置零值,第17位为符号位;
数据组合电路组合而成的25位数据和18位数据输入至XtremeDSP硬核的乘法输入端,输出一个42位数据;
数据拆分电路将所述42位数据拆分成三个数据:1#数据为第15位到第0位数据,2#数据为第31位到第16位数据,3#数据为第41位至到第32位数据;
加和累加电路分别对每一个对应点对的1#数据进行加和累加、对每一个对应点对的
2#数据进行加和累加。
2.根据权利要求1所述的一种应用于8位灰度图像匹配的高性能并行乘加电路,其特征在于:
配对电路从小图和大图的相关子图的缓存区内按照行的顺序每次取出两个对应行的图像数据点,设取出小图第i行Bi0Bi1Bi2…Bin-2Bin-1和相关子图第i行按照点对应关系配成n对对应点对(Aij,Bij),0≤j<n;
配对电路产生的对应点对输出至数据组合电路,在数据组合电路中,形成两个组合数据Vij和Uij:Vij包括25位数据,第7位至第0位为相关子图像素点灰度值Aij,第15位至第
8位置零值,第23位至第16位为小图像素点灰度值Bij,第24位为符号位;Uij包括18位数据,第7位至第0位为相关子图像素点灰度值Aij,第16位至第8位置零值,第17位为符号位;
将Vij和Uij输入到第i个XtremeDSP硬核的乘法输入端,得到有符号的42位结果Pij;
将42位Pij输入到数据拆分电路进行拆分:第15位到第0位数据同步输出Tij,第31位到第16位数据同步输出Sij,Sij=Aij×Bij;第41位至到第32位作悬空处理;
数据Sij和Tij分别输出至加和累加电路进行加和累加,分别得到 和
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