专利汇可以提供一种占空比调整电路专利检索,专利查询,专利分析的服务。并且本 发明 公开了一种占空比调整 电路 ,占空比调整电路包括:工艺 角 检测电路和占空比调整电路,工艺角检测电路的输出端连接占空比调整电路的第一输入端,占空比调整电路的第二输入端连接输入时钟;工艺角检测电路用于检测当前芯片工作的工艺角,根据工艺角产生控制 信号 发送至占空比调整电路;占空比调整电路用于根据 控制信号 调整输入时钟的占空比,输出占空比调整后的输出时钟。本发明通过工艺角检测电路检测当前芯片工作的工艺角,根据工艺角控制占空比调整电路调整输入时钟的占空比,达到时序最优化,从而使芯片能够正常工作。,下面是一种占空比调整电路专利的具体信息内容。
1.一种占空比调整电路,其特征在于,所述占空比调整电路包括:工艺角检测电路和占空比调整电路,所述工艺角检测电路的输出端连接所述占空比调整电路的第一输入端,所述占空比调整电路的第二输入端连接输入时钟;
所述工艺角检测电路用于检测当前芯片工作的工艺角,根据所述工艺角产生控制信号发送至所述占空比调整电路;
所述占空比调整电路用于根据所述控制信号调整所述输入时钟的占空比,输出占空比调整后的输出时钟。
2.根据权利要求1所述的占空比调整电路,其特征在于,所述工艺角检测电路包括:环形振荡器和频率检测模块,所述环形振荡器的输出端连接所述频率检测模块的输入端,所述频率检测模块的输出端连接所述占空比调整电路的第一输入端;
所述环形振荡器用于产生一个与工艺角有关的震荡时钟信号;
所述频率检测模块用于检测所述震荡时钟信号的频率,根据所述频率得到当前芯片工作的工艺角,根据所述工艺角产生控制信号发送至所述占空比调整电路。
3.根据权利要求2所述的占空比调整电路,其特征在于,所述占空比调整电路包括:可控延迟模块和逻辑电路,所述可控延迟模块的第一输入端连接所述频率检测模块的输出端,所述可控延迟模块的第二输入端连接所述输入时钟,所述可控延迟模块的输出端连接所述逻辑电路的第一输入端,所述逻辑电路的第二输入端连接所述输入时钟;
所述可控延迟模块用于根据所述控制信号对所述输入时钟进行延时,将延时后的时钟输入所述逻辑电路;
所述逻辑电路用于对所述输入时钟和所述延时后的时钟进行逻辑运算,输出占空比调整后的输出时钟。
4.根据权利要求3所述的占空比调整电路,其特征在于,所述可控延迟模块包括:依次连接的第一反相器、第二反相器、第三反相器、第四反相器、第五反相器、第六反相器、第七反相器和第八反相器,第一NMOS管,第一PMOS管,第二NMOS管,第二PMOS管,第三NMOS管,第三PMOS管,译码器;
所述第一反相器的输入端连接所述输入时钟,所述第一反相器的输出端连接所述第三NMOS管、所述第三PMOS管的漏极,所述第二反相器的输出端连接所述第二NMOS管、所述第二PMOS管的漏极,所述第三反相器的输出端连接所述第一NMOS管、所述第一PMOS管的漏极,所述第五反相器的输出端连接所述第一NMOS管、所述第一PMOS管的源极,所述第六反相器的输出端连接所述第二NMOS管、所述第二PMOS管的源极,所述第七反相器的输出端连接所述第三NMOS管、所述第三PMOS管的源极,所述第八反相器的输出端连接所述逻辑电路的第一输入端;
所述译码器的输入端连接所述频率检测模块的输出端,所述译码器的第一输出端连接所述第一PMOS管、所述第二PMOS管、所述第三PMOS管的栅极,所述译码器的第二输出端连接所述第一NMOS管、所述第二NMOS管、所述第三NMOS管的栅极。
5.根据权利要求3所述的占空比调整电路,其特征在于,所述逻辑电路包括以下任一种逻辑:与非门、或非门、异或门、同或门。
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