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序号 专利名 申请号 申请日 公开(公告)号 公开(公告)日 发明人
101 电荷相环、电容倍增方法及数控回路滤波器 CN201410084194.8 2014-03-10 CN104052470B 2017-11-24 高亭; 严杰锋
用于针对相环采用一个电荷的电容倍增的系统和方法,采用了以时分模式操作的数控回路滤波器。在当数字控制启动时,回路滤波器的实施例根据数字控制阻挡来自电荷泵电流,使得电荷泵不能对积分电容器充电或放电。由于电流的至少一部分被阻挡,电荷泵需要更多的时间将电容器充电或放电至特定电平。随后,相对于锁相环的操作,电容器看起来比其实际值大。
102 电子设备 CN201410121164.X 2011-12-02 CN103906348B 2017-11-24 加藤登; 多胡茂; 佐佐木纯; 栗田淳一; 佐佐木怜
发明提供能容易弯曲、且能抑制信号线的特性阻抗从规定特性阻抗偏离的高频信号线路及电子设备。电介质单元体(12)通过层叠保护层(14)及电介质片材(18a~18c)来构成且具有表面及背面。信号线(20)是设置在电介质单元体(12)上的线状导体。接地导体(22)设置在电介质单元体(12)上,且经由电介质片材(18a)与信号线(20)相对,并沿信号线(20)连续延伸。接地导体(24)设置在电介质单元体(12)上,且隔着信号线(20)与接地导体(22)相对,并沿信号线(20)排列设置有多个开口(30)。相对于信号线(20)位于接地导体(22)一侧的电介质单元体12的表面与电池组(206)接触
103 数字预失真数据的处理的方法及装置 CN201210409076.0 2012-10-24 CN103780523B 2017-11-24 洪艺伟
发明公开了一种数字预失真数据的处理方法及装置,该方法包括:FPGA三阶交调频谱检测模对不同功率等级不同通道的数据轮训,当某个数据功率和优先级达到最大时,预采集前向数据和反馈数据进行峰值筛选,对筛选出来的反馈数据进行三阶交调频谱分量检测,判断数字预失真和功放非线性的拟合程度,当确定拟合程度差时,将筛选出来的前向数据和反馈数据对齐后发送给所述DSP解算模块,进行误差向量解算,当确定误差向量高时,采集当前前向数据和反馈数据进行预处理后再进行DPD解算。通过三阶交调频谱分量检测和误差向量解算两轮有效性计算,确保采集数据的过程发生在需要进行新一轮的DPD解算的时刻,采集的数据更能反映当前时刻整体的数据特性。
104 一种基于单片集成技术的太赫兹混频电路 CN201710631383.6 2017-07-28 CN107370458A 2017-11-21 张波; 牛中乾; 杨益林; 纪东峰; 丰益年; 刘洋; 陶源; 杨柯
一种基于单片集成技术的太赫兹混频电路,包括射频3dB分支波导定向耦合器本振135度相移3dB分支波导定向耦合器、同轴探针、中频耦合环、中频信号和两个太赫兹分谐波混频器,所述太赫兹分谐波混频器包括射频波导-微带过渡、单片集成肖特基二极管对、本振波导-微带过渡、中频滤波器和本振低通滤波器;其中,所述单片集成肖特基二极管对为反向并联的二极管对。本发明太赫兹混频电路中的谐波混频器采用半导体技术得到,可精确控制二极管位置以及微带电路的尺寸,误差远小于人工装配,极大地减小了装配误差对混频电路性能的影响;同时,该混频电路可有效消除本振噪声,提高了系统的噪声性能和效率。
105 一种隔离型同步整流控制电路及其装置与控制方法 CN201510681520.8 2015-10-21 CN105305844B 2017-11-21 宗强; 吴寿化; 管磊; 殷忠
发明公开了一种隔离型同步整流控制电路及其装置与控制方法,控制电路包括:供电模、基准模块、比较器模组、原边开通判定单元、副边断续预估单元、逻辑单元及驱动单元;控制装置包括:变压器;旁路电容,用于提供稳定电压;时间常数设置电阻,用于设定原边开通的时间常数和副边续流时间预估的判断;同步整流控制电路,用于其时间设置端流入的电流判定原边是否开通同时预估副边断续时间,并根据结果生成导通或关断的逻辑控制信号对同步整流管进行驱动;输出电容,连接整流控制电路的电压端,用于电容的输出。本发明采用原边开通判定和副边断续时间预估电路,及双电压的判定机制,保证同步整流管在面临复杂的工作情况下精准工作。
106 高频振荡电路及其操作方法 CN201380038053.6 2013-07-18 CN104854789B 2017-11-21 K.A.詹金斯; 林佑民
一种方法包括提供具有场效应晶体管振荡器,所述场效应晶体管与谐振电路相连接。所述场效应晶体管具有耦合到栅极电压源的栅电极、源电极、漏电极、和位于所述源电极和所述栅电极之间并电连接至所述源电极和所述漏电极的石墨烯通道。所述方法进一步包括:通过所述栅电极偏置所述石墨烯通道到负微分电阻运行区,以引起振荡器产生具有谐振频率f0的频率信号。还可以包括附加的步骤以改变所述栅极电压的方法,从而偏置所述石墨烯通道到所述负微分电阻运行区,及所述负微分电阻运行区之外,以便分别调整所述频率信号的开和关。
107 变频谐振电路和变频滤波器 CN201410742342.0 2014-12-05 CN104702242B 2017-11-21 柚木泰志; 谷口哲夫; 片渊启介
发明提供了一种变频谐振电路,在所设定的多个通频带中,通频带带宽几乎不发生变化。变频谐振电路(10),包括:第一输入输出端子(P1),第二输入输出端子(P2);在连接第一、第二输入输出端子(P1),(P2)的传输线和地线之间,连接有谐振电路部rc,该谐振电路部rc由电感(21)和第一、第二LC串联电路组成。第一LC串联电路由电感(22)和可变电容(31)串联连接而成的电路构成。第二LC串联电路由电感(23)和固定电容(32)串联连接而成的电路构成。第一LC串联电路和第二LC串联电路并联连接在电感(21)和地线之间。电感(21)和电感(22)被设置为可发生正耦合的相互感应。
108 供给系统以及电力供给系统的控制方法 CN201380043700.2 2013-07-05 CN104584362B 2017-11-21 藤田武志
发明的电控制装置(9)具备:供电目标值获取部(21),其获取负载中当前消耗的电力来作为供电目标值;发电电力检测部(22),其检测相对于供电目标值由燃料电池(2)进行发电而得到的发电电力值;电力补偿量计算部(23),其求出供电目标值与发电电力值的偏差来计算要从蓄电池(6)向负载供给的电力补偿量;以及输出电力控制部(24),其求出蓄电池(6)的当前的过渡响应特性,基于当前的过渡响应特性来进行控制使得蓄电池(6)的输出电力成为电力补偿量。
109 延迟线环形振荡器装置 CN201310574807.1 2013-11-15 CN104426542B 2017-11-21 马炎涛
发明提供一种内建延迟线环形振荡器装置包括双逻辑电路缓冲器、时脉输入缓冲器以及延迟相回路电路。双门逻辑电路接收时脉致能信号、特定模态信号以及延迟时脉输出信号。双门逻辑电路在时脉致能信号、特定模态信号以及延迟时脉输出信号上执行逻辑操作,用以产生模态选择信号。缓冲器依据模态选择信号与控制信号产生反馈信号。时脉输入缓冲器依据反馈信号决定是否传输输入时脉信号至时脉输入缓冲器的输出端。延迟锁相回路电路产生延迟时脉输出信号。反馈信号的频率依据控制信号而被调整。
110 用于带电粒子检测的前置放大器 CN201410105851.2 2014-03-20 CN104065347B 2017-11-21 R·赫明
提供了一种用于对从带电粒子检测电极接收的信号中存在的过冲或者下冲效应进行校正的前置放大器。该前置放大器与该带电粒子检测电极是接地隔离的并且包括:一个主放大级,被配置成用于接收和放大隔离的信号;一个前馈级,被配置成用于从所放大的接地隔离的信号生成一个补偿信号,该补偿信号被生成用于反映过冲或下冲效应;以及一个输出,被安排成用于提供一个输出信号,该输出信号为所放大的接地隔离的信号与该补偿信号的组合。还提供了一种包括该前置放大器的带电粒子检测装置。
111 可变长度编码的数据流的高带宽解压 CN201280060474.4 2012-11-12 CN103975533B 2017-11-21 K·B·阿加瓦尔; H·P·霍夫斯蒂; D·A·詹姆塞克; A·K·马丁
提供用于对可变长度编码的数据流解码的机制。数据处理系统的解码器接收数据输入线。数据输入线是可变长度编码的数据流的一部分。解码器确定数据输入线向下一数据输入线上的位溢出数量。解码器基于确定的位溢出数量对准数据输入线以在符号边界开始。解码器令牌化对准的数据输入线以生成令牌集合。每个令牌对应于在对准的下一数据输入线中的编码的符号。解码器基于令牌集合生成数据输出字。数据输出字对应于原有数据集中的数据字。
112 一种减小在线监测海量数据存储的系统及方法 CN201710546227.X 2017-07-06 CN107359879A 2017-11-17 陈沂; 王江波; 刘士钢
发明公开了一种减小在线监测海量数据存储的系统,包括传感器信号调理电路模数转换器、处理器以及网络通讯单元;所述传感器与信号调理电路连接,信号调理电路与模数转换器连接,模数转换器连接与处理器连接,本发明能够减小海量数据存贮,对数据进行实时分布式计算,前端过滤后续不关心的数据,既有效减少在线监测系统的通讯带宽,又大大减少了后端服务器的海量存储数据量,提高客户端数据处理的效率。
113 半导体器件和半导体装置 CN201710187607.9 2017-03-27 CN107359155A 2017-11-17 沼部英雄; 立野孝治; 小岛勇介; 横井芳彦; 石田慎哉; 松浦仁
发明提供一种半导体器件和半导体装置,所述半导体器件包括功率器件和温度检测二极管。所述半导体器件具有被配置成使功率器件的电线与温度检测二极管之间绝缘的器件结构。
114 用于实施扩展范围逐次逼近模/数转换器的方法及系统 CN201610048436.7 2016-01-25 CN105828004B 2017-11-17 辛勒·米克尔森; 托雷·马丁努森
发明涉及用于实施扩展范围逐次逼近模/数转换器的方法及系统。一种实施扩展范围逐次逼近模/数转换器ADC的方法以读出电路获取来自彩色像素阵列中的行的图像数据开始。所述读出电路中的ADC电路接着产生用于所述行的ADC消隐脉冲电平。包含于ADC电路中的逐次逼近寄存器SAR接着存储ADC消隐脉冲电平。SAR包含多个位及是所述多个位中的一者的复制品的额外位。ADC电路对照存储于SAR中的ADC消隐脉冲电平而对来自所述行的所述图像数据进行取样以获得所取样输入数据。ADC电路接着将所述所取样输入数据从模拟转换到数字以获得ADC输出值。描述其它实施例
115 一种使相环系统快速锁定的自动频带校准方法 CN201510601133.9 2015-09-18 CN105119600B 2017-11-17 吴建辉; 丁欣; 陈超; 黄成; 李红
发明公开了一种使相环系统快速锁定的自动频带校准方法,AFC模对VCO的频带进行校正,并且根据目标频点自动选择频带,实现锁相环的快速锁定。本发明采用闭环校正,控制分频器的分频比跳变,利用锁相环环路锁定Vctrl电压,依次得到每条频带的特征分频比,实现每条频带在实际电路中对应的特征频率的校正,并用寄存器保存特征分频比控制字。基于上述过程中锁存的特征分频比结果,正常工作状态下,外界给出目标频点所对应的分频比,自动推算出频点所处的频带,直接置频带编码,实现锁相环的快速锁定。本发明中提出的AFC算法仅需数目较小的寄存器就可记录、推算大量频点的校正数据,既节约资源又可实现锁相环的快速锁定。
116 前置放大器光接收器、光终端装置及光通信系统 CN201380070127.4 2013-01-16 CN104919700B 2017-11-17 三田大介; 野田雅树; 野上正道
电流旁路电路(230)与电流电压转换放大电路(210)的输入端子连接,从受光元件(100)输出的光电流的一部分流过电流旁路电路(230)。将利用电压电平转换电路(240)对输出电压进行电平转换后的电压输入电流旁路电路(230),使得电流旁路电路(230)以比与电流电压转换放大电路(210)的反馈电阻(212)并联连接的二极管(220)成为导通状态的光电流小的光电流成为导通状态。由此,能够按照与受光电平对应的光电流的大小,分三级切换电流电压转换增益。
117 数模转换器装置以及数模转换器装置的操作、校正方法 CN201510026128.X 2015-01-20 CN104811205B 2017-11-17 曾伟信
发明提供一种数模转换器装置,包含数模转换器,具有输入总线端、第一输出端、第二输出端以及多个控制端,数模转换器用于生成多个电流电阻‑电容电路,用于在校正期间形成积分器以形成Σ‑Δ模数转换器,以及用于在数模转换期间形成低通滤波器,电阻‑电容电路包含运算放大器、第一电容、第二电容、第一电阻、第二电阻、第一开关、以及第二开关;量化器,具有第一输入端、第二输入端以及输出端,且用于根据运算放大器的输出生成多个偏移值;以及控制器,具有输入端以及的输出总线端,且用于根据多个偏移值控制多个电流对运算放大器的耦合。本发明通过以上方案,可以有效地解决数模转换器中电流源的不匹配的问题,并可以节省制程面积。
118 电路 CN201410592962.0 2014-10-29 CN104617925B 2017-11-17 维巴胡·夏尔马; 阿杰伊·卡谱; 拉尔夫·马尔察恩
一种电路,基于主从交叉耦合的反相器对配置。从电路的反相器耦合至高电压轨和低电压轨,其中对于两个反相器中的每一个,通过电阻性元件来实现与电压轨之一的耦合。这种电路设计无需内部时钟缓冲器,并实现了单相时钟控制,因此不需要内部时钟信号反转。可以以低功率来实现该电路,当输入数据信号和输出数据信号相同时,不存在针对冗余转变的动态功耗。
119 锯齿波振荡器和装置 CN201410524691.5 2014-10-08 CN104518763B 2017-11-17 苏家弘; 马旦·莫汉·丽迪·维穆拉
本公开的多个方面针对涉及提供时钟信号的方法和装置。根据本文的一个或多个实施例,以有利于低功耗操作的方式产生锯齿波信号。在一些实施方案中,使用在不必采用R‑C电路的前提下进行操作的和/或在没有满幅电压供给的前提下进行操作的振荡器(例如,通过非线性振荡器),来产生锯齿波信号。将所述锯齿波信号用于产生梯形波信号,使用所述梯形波信号产生时钟信号
120 用于可编程器件阵列的基于自旋转移矩的存储器元件 CN201280071955.5 2012-03-30 CN104335282B 2017-11-17 A·雷什欧迪伊; J·J·查汉茨; V·德
本文公开了半导体器件阵列,例如,现场可编程阵列(FPGA)和复杂可编程逻辑阵列(CPLA),其使用了基于高密度自旋转移矩(STT)的存储器元件。基于STT的存储器元件可以是独立的FPGA/CPLA,或者可以被嵌入在微处理器和/或数字信号处理器(DSP)片上系统(SoC)中以提供灵活的设计,从而实现低功率、可升级、安全以及可重构的硬件构架。因为该配置被存储在FPGA/CPLA管芯本身上,所以当器件上电时,每次都从外部存储载入配置的需求被消除了。除了瞬间启动以外,消除配置I/O通信量实现了省电以及引脚数减少。通过消除在外部存储器中存储配置数据的需求来大大提升了安全性。
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